fpga+arm 文章進(jìn)入fpga+arm技術(shù)社區(qū)

嵌入式開發(fā)的轉(zhuǎn)變將如何影響未來計(jì)算

當(dāng)前，開發(fā)者正在利用安全且性能增強(qiáng)的技術(shù)實(shí)現(xiàn)小型低功耗嵌入式系統(tǒng)的開發(fā)，賦能過往無(wú)法想象的語(yǔ)音、視覺和振動(dòng)等 AI 應(yīng)用，而這些應(yīng)用正在改變著世界。嵌入式領(lǐng)域正經(jīng)歷一場(chǎng)深刻的變革。連接設(shè)備正逐漸演變?yōu)榭筛鶕?jù)所收集的數(shù)據(jù)自行做出決策的系統(tǒng)。相較于在物聯(lián)網(wǎng)網(wǎng)關(guān)或云端進(jìn)行數(shù)據(jù)處理而言，在更接近采集源之處完成數(shù)據(jù)處理的方式，將有望加快決策速度、減少延遲、解決數(shù)據(jù)隱私問題、降低成本并提高能效。很多應(yīng)用領(lǐng)域都在推升邊緣計(jì)算在性能和功能方面的需求，諸如工業(yè)自動(dòng)化、機(jī)器人、智慧城市和家居自動(dòng)化等。
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PSG獨(dú)立運(yùn)作拯救的是英特爾還是FPGA

根據(jù)英特爾官方的公告，2024年1月1日起，可編程解決方案部門（PSG）將獨(dú)立運(yùn)營(yíng)，并計(jì)劃2年內(nèi)開啟IPO。值得一提的是，英特爾的PSG其實(shí)就是以2015年5月達(dá)成收購(gòu)協(xié)議的Altera為主體，從當(dāng)年花費(fèi)167億美元成為英特爾最大一筆收購(gòu)，到現(xiàn)在要獨(dú)立運(yùn)營(yíng)甚至上市套現(xiàn)，種種操作背后蘊(yùn)含了哪些原因我們不得而知，不過這筆投資的回報(bào)價(jià)值幾何也許能終見分曉。在半導(dǎo)體行業(yè)，作為霸占銷售額榜首位置最久的公司，英特爾在收購(gòu)方面表現(xiàn)得一直很積極，但從另一個(gè)角度來看，英特爾的收購(gòu)交易獲得較高評(píng)價(jià)的也不多，很多交易即使計(jì)算
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FPGA串行接口（RS-232）

串行接口是將FPGA連接到PC的簡(jiǎn)單方法。我們只需要一個(gè)發(fā)射器和接收器模塊。異步發(fā)射器它通過序列化要傳輸?shù)臄?shù)據(jù)來創(chuàng)建信號(hào)“TxD”。異步接收器它從 FPGA 外部獲取信號(hào)“RxD”，并將其“解串化”，以便在 FPGA 內(nèi)部輕松使用。串行接口 1 - RS-232 串行接口的工作原理RS-232接口具有以下特點(diǎn)：使用 9 針連接器“DB-9”（較舊的 PC 使用 25 針“DB-25”）。允許雙向全雙工通信（PC可以同時(shí)發(fā)送和接收數(shù)據(jù)）?？梢砸源蠹s 10KBytes/s 的最大速度進(jìn)行通信。DB-9 連接
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FPGA計(jì)數(shù)器的藝術(shù)

計(jì)數(shù)器構(gòu)成了一個(gè)基本的FPGA構(gòu)建塊。它們有各種形狀和形式......計(jì)數(shù)器 1 - 二進(jìn)制計(jì)數(shù)器最簡(jiǎn)單的計(jì)數(shù)器可以使用幾行 Verilog 構(gòu)建快速高效的二進(jìn)制計(jì)數(shù)器。例如，下面是一個(gè) 32 位計(jì)數(shù)器。reg [31:0] cnt;always @(posedge clk) cnt <= cnt+1;此類計(jì)數(shù)器從 0 計(jì)數(shù)到 4294967295，然后回滾 0 以繼續(xù)其進(jìn)程。它占用的資源很少，并且在FPGA中運(yùn)行速度快，這要?dú)w功于隱藏的攜帶鏈（稍后會(huì)詳細(xì)介紹）。現(xiàn)在，讓我們看看一些變化。首先
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實(shí)現(xiàn)最高效的數(shù)據(jù)轉(zhuǎn)換：深入了解Achronix JESD204C解決方案

長(zhǎng)期以來，Achronix為不同行業(yè)的數(shù)據(jù)密集型和高帶寬應(yīng)用提供了創(chuàng)新性的FPGA產(chǎn)品和技術(shù)，并幫助客戶不斷打破性能極限。其中一些應(yīng)用需要與先進(jìn)的模擬/數(shù)字轉(zhuǎn)換器（ADC）和數(shù)字/模擬轉(zhuǎn)換器（DAC）進(jìn)行對(duì)接——可由JESD204C完美地完成這項(xiàng)任務(wù)。JESD204B/C是由JEDEC定義和開發(fā)的高速數(shù)據(jù)轉(zhuǎn)換器串行接口標(biāo)準(zhǔn)。該標(biāo)準(zhǔn)減少了高速數(shù)據(jù)轉(zhuǎn)換器和其他高性能器件（如Achronix Speedster7t FPGA）之間的數(shù)據(jù)輸入和輸出數(shù)量。這種數(shù)字和模擬信號(hào)鏈的組合使設(shè)計(jì)人員能夠獲得簡(jiǎn)化的小尺寸電路
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萊迪思即將舉辦網(wǎng)絡(luò)研討會(huì)探討全新推出的創(chuàng)新中端FPGA

萊迪思半導(dǎo)體，低功耗可編程器件的領(lǐng)先供應(yīng)商，近日宣布將舉辦一場(chǎng)網(wǎng)絡(luò)研討會(huì)，介紹其最新的兩款創(chuàng)新型中端FPGA器件系列，萊迪思Avant?-G和Avant?-X，分別為通用FPGA和高級(jí)互連FPGA。在網(wǎng)絡(luò)研討會(huì)上，萊迪思將介紹這些新型FPGA相關(guān)的技術(shù)，新產(chǎn)品旨在為通信、計(jì)算、工業(yè)和汽車市場(chǎng)的中端應(yīng)用提供低功耗、先進(jìn)的連接和優(yōu)化的計(jì)算能力等特性?！? ?主辦方：萊迪思半導(dǎo)體●? ?內(nèi)容：萊迪思最新推出的中端FPGA——Avant-G和Avant-X●? &
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跨越時(shí)鐘域

FPGA設(shè)計(jì)可以使用多個(gè)時(shí)鐘。每個(gè)時(shí)鐘在FPGA內(nèi)部形成一個(gè)“時(shí)鐘域”，如果在另一個(gè)時(shí)鐘域中需要在一個(gè)時(shí)鐘域中生成的信號(hào)，則需要格外小心。跨時(shí)鐘域1-信號(hào)假設(shè) clkB 域中需要來自 clkA 域的信號(hào)。它需要“同步”到 clkB 域，因此我們要構(gòu)建一個(gè)同步器設(shè)計(jì)，它從 clkA 域獲取一個(gè)信號(hào)，并在 clkB 域中創(chuàng)建一個(gè)新信號(hào)。在第一種設(shè)計(jì)中，我們假設(shè)與 clkA 和 clkB 時(shí)鐘速度相比，“信號(hào)輸入”變化緩慢。您需要做的就是使用兩個(gè)觸發(fā)器將信號(hào)從 clkA 移動(dòng)到 clkB。module Sig
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用FPGA邏輯消抖動(dòng)

我們將一個(gè)開關(guān)連接到FPGA上，連接方式如下圖：機(jī)械開關(guān)的問題就是有抖動(dòng)，每次按一下開關(guān)，你會(huì)得到下面的信號(hào)：這種信號(hào)很少碰到，多數(shù)情況是下面的這種：我們可以用FPGA的計(jì)數(shù)器來記錄按鍵的次數(shù)，并通過數(shù)碼管顯示出來：上電的時(shí)候，一起是好的：如果按十次鍵，得到下面的結(jié)果：顯然不對(duì)。那如何解決呢？一種方式是添加一個(gè)R/C濾波器，再跟一個(gè)施密特觸發(fā)器之后送給FPGA，當(dāng)然還有更簡(jiǎn)單的方式，就是在FPGA內(nèi)部進(jìn)行消抖動(dòng)。 FPGA擅長(zhǎng)簡(jiǎn)單的運(yùn)算，讓我們使用FPGA中的計(jì)數(shù)器來查看按下或釋放按鈕的時(shí)間。只有當(dāng)計(jì)
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用FPGA做正交解碼

FPGA非常適合用邏輯來實(shí)現(xiàn)正交解碼的功能。什么是正交信號(hào)？正交信號(hào)是兩個(gè)相位差為90度的信號(hào)。它們?cè)跈C(jī)械系統(tǒng)中用于確定軸的運(yùn)動(dòng)（或旋轉(zhuǎn)）。這是一個(gè)向前移動(dòng)幾步的軸。如果對(duì)脈沖計(jì)數(shù)，則可以說軸移動(dòng)了3步。如果計(jì)算邊緣，則可以說軸移動(dòng)了12步。這就是我們?cè)诖隧?yè)面上所做的?，F(xiàn)在，軸向后移動(dòng)了相同的量。因此，想法是通過查看邊緣和水平，我們可以確定運(yùn)動(dòng)的方向和距離。這是一個(gè)示例，其中軸向前移動(dòng)10步，然后向后移動(dòng)7步。它們?cè)谀睦锸褂?？在機(jī)械手軸中，用于反饋控制。用旋鈕確定用戶輸入。在電腦鼠標(biāo)中，確定運(yùn)動(dòng)方向。如果
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RISC—V助力國(guó)產(chǎn)芯片加速崛起

2019年7月，阿里巴巴旗下半導(dǎo)體公司“平頭哥”正式發(fā)布玄鐵910，并宣稱是“業(yè)內(nèi)最強(qiáng)RISC-V處理器之一”，號(hào)稱性能可比肩Arm v8架構(gòu)Cortex A7X系列，并且在今年3月， David Patterson在阿里平頭哥玄鐵RISC-V生態(tài)大會(huì)上也大膽預(yù)言：“3到5年后，RISC-V將無(wú)處不在！。但在過去，RISC-V的普及度較低，在中國(guó)的知名度就更低了，更多流行的是x86架構(gòu)和ARM架構(gòu)，所以人們不禁發(fā)出疑問，什么是RISC-V？它與x86和ARM的區(qū)別是什么？Milk-V 推出 Meles S
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一文讀懂SWD接口

SWD接口是一種用于訪問ARM調(diào)試接口的雙線協(xié)議，它是ARM調(diào)試接口規(guī)范(ARM Debug Interface Architecture Specification)的一部分，是JTAG的替代品。SWD接口的主要特點(diǎn)和優(yōu)勢(shì)有：SWD接口只需要兩條信號(hào)線：SWDIO（雙向數(shù)據(jù)線）和SWCLK（時(shí)鐘線），相比JTAG接口占用的引腳更少，有利于節(jié)約電路板空間和成本。SWD接口可以直接訪問串行線調(diào)試端口（SW-DP），SW-DP可以訪問一個(gè)或多個(gè)接入端口（AP），通過AP可以訪問系統(tǒng)的內(nèi)存和寄存器。SWD接口具
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文本LCD模塊的控制FPGA

文本LCD模塊便宜且易于使用微控制器或FPGA進(jìn)行接口。這是一個(gè)1行x 16個(gè)字符的模塊：要控制LCD模塊，您需要11個(gè)IO引腳來驅(qū)動(dòng)8位數(shù)據(jù)總線和3個(gè)控制信號(hào)。3個(gè)控制信號(hào)是：E：?jiǎn)⒂没颉?LCD選擇”。高活躍。讀/寫：讀/寫。0寫入，1讀取。RS：寄存器選擇，0表示命令字節(jié)，1表示數(shù)據(jù)字節(jié)。大多數(shù)LCD模塊都基于HD44780芯片或是兼容的。查閱Wikipedia以獲取更多信息。7位設(shè)計(jì)讓我們用FPGA板驅(qū)動(dòng)LCD模塊。這是我們?cè)O(shè)計(jì)的框圖：Pluto從PC串行端口接收數(shù)據(jù)，對(duì)其進(jìn)行反序列化，然后將其發(fā)
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R/C伺服電機(jī)FPGA

FPGA適用于控制R / C伺服電機(jī)。什么是遙控伺服器？R / C伺服（“遙控伺服電機(jī)”）由一個(gè)電機(jī)，一些電子設(shè)備和一組裝在一個(gè)小盒子中的齒輪組成。單軸從伺服器出來。您可以通過向伺服器發(fā)送脈沖來精確控制軸的旋轉(zhuǎn)角度。軸旋轉(zhuǎn)角度限制為大約270度（它不能旋轉(zhuǎn)一整圈，而只能旋轉(zhuǎn)3/4圈）。這是一個(gè)伺服器的圖片（已被咬住，但已說明了我們的目的）。有用的信息鏈接包括：RC伺服控制RC飛機(jī)伺服系統(tǒng)使用指南遙控伺服器101R / C Servos用于：在遙控模型中（汽車，飛機(jī)…）。在機(jī)器人技術(shù)中。電氣連接
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使用Verilog來編程FPGA

FPGA是依賴數(shù)字邏輯的數(shù)字器件，計(jì)算機(jī)硬件使用的是數(shù)字邏輯，每一個(gè)計(jì)算，屏幕上每一個(gè)像素的呈現(xiàn)，音樂軌的每一個(gè)note都是使用數(shù)字邏輯構(gòu)成的功能塊來實(shí)現(xiàn)的。雖然多數(shù)時(shí)候，數(shù)字邏輯是抽象的數(shù)學(xué)概念，而不是物理電子，邏輯門以及其它的數(shù)字邏輯器件則是由刻蝕在集成電路上的晶體管來實(shí)現(xiàn)的。對(duì)于FPGA來講，可以通過繪制邏輯門構(gòu)成的電路，將這些門映射到FPGA的通用門上，并將它們連接起來以實(shí)現(xiàn)你設(shè)想的邏輯設(shè)計(jì)。另外一種方式是，使用Verilog（或其它的）硬件描述語(yǔ)言來實(shí)現(xiàn)邏輯。你依然可以購(gòu)買能夠?qū)崿F(xiàn)小數(shù)量邏
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看好FPGA的增長(zhǎng)潛力，萊迪思拓展中端產(chǎn)品線

1 FPGA市場(chǎng)年增7.8%，高中低三分天下?lián)袌?chǎng)調(diào)查公司Scoop.market.us的數(shù)據(jù)，全球現(xiàn)場(chǎng)可編程門陣列（FPGA）市場(chǎng)有望在未來幾年以7.8%的復(fù)合年增長(zhǎng)率穩(wěn)步增長(zhǎng)。2022年，F(xiàn)PGA市場(chǎng)收入為65億美元，預(yù)計(jì)2023年將增至70億美元。增長(zhǎng)趨勢(shì)將持續(xù)下去，預(yù)計(jì)2030年收入將達(dá)到115億美元，2031年將達(dá)到124億美元，2032年將達(dá)到135億美元。2022年，小型FPGA總貢獻(xiàn)23億美元，中端FPGA貢獻(xiàn)18億美元，高端FPGA貢獻(xiàn)24億美元?？梢姡咧械褪袌?chǎng)基本三分天下。不過，這個(gè)
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