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數(shù)字語音解碼器的低功耗設(shè)計
- 近年來,隨著個人手持多媒體設(shè)備的快速增長,低功耗設(shè)計變得越來越重要,甚至成為決定產(chǎn)品是否成功的關(guān)鍵,如筆記本電腦、PDA、移動電話等時尚消費和商務(wù)類電子產(chǎn)品,對電池的供電時間要求越來越高,高功耗。
- 關(guān)鍵字: 數(shù)字語音解碼器 低功耗設(shè)計 SoC
IC設(shè)計中的低功耗解決方案
- Cadence Low-Power Solution是業(yè)界第一個將邏輯設(shè)計、驗證和實現(xiàn)技術(shù)與Si2認(rèn)可的Common Power Format(CPF)相結(jié)合的完整流程。將這種全面的方法應(yīng)用于低功耗設(shè)計
- 關(guān)鍵字: SoC
基于H.264視頻編解碼SoC滿足高清DVR設(shè)計
- 硬盤錄像機(jī)(DVR)作為監(jiān)控系統(tǒng)的核心部件之一,在10年里高速發(fā)展,從模擬磁帶機(jī)的替代品演變成具有自己獨特價值的專業(yè)監(jiān)控數(shù)字平臺,并被市場廣泛接受。監(jiān)控系統(tǒng)伴隨DVR這些年的發(fā)展向著IP化、智能化發(fā)展.
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IPC報告詳述PCB制造商技術(shù)發(fā)展趨勢
- IPC—國際電子工業(yè)聯(lián)接協(xié)會?本月發(fā)布全球調(diào)研報告:《2016年P(guān)CB 技術(shù)趨勢》。報告采用數(shù)據(jù)調(diào)研的方式,內(nèi)容集中在PCB制造商如何滿足當(dāng)前技術(shù)發(fā)展要求以及截止到2021年影響行業(yè)的技術(shù)變革問題。 此報告收集了來自全球118家電子組裝公司和PCB制造商的數(shù)據(jù),按照以下五大應(yīng)用領(lǐng)域分類:汽車、國防和航空航天、高端系統(tǒng)、工業(yè)、醫(yī)療電子;全文237頁?! 蟾嫜芯康膬?nèi)容涉及板材性能方面,如:厚度、層數(shù)、散熱和公差;微型化方面,如:線寬和間距、I/O節(jié)距、通孔孔徑、縱橫比、通孔結(jié)構(gòu)等;材料方面,
- 關(guān)鍵字: IPC PCB
新型電動汽車鋰電池管理系統(tǒng)的研究與實現(xiàn) — SOC 估計的四元模型
- 隨著全球環(huán)保意識的增強(qiáng)和能源問題的突出,電動汽車已成為綠色車輛最主要的發(fā)展方向之一。但是制約電動汽車發(fā)展的問題依然是儲能電池和應(yīng)用技術(shù)。如何延長電池使用壽命、提高電池的能量效率和運行可靠性,是電動汽車產(chǎn)業(yè)化的必需解決的問題,因此研究電池管理技術(shù)及系統(tǒng)具有十分重大的意義。
- 關(guān)鍵字: 鋰電池管理系統(tǒng) SoC 電動汽車
使用可定制微控制器高效開發(fā)系統(tǒng)級芯片(SoC)
- 可定制微控制器是特定應(yīng)用系統(tǒng)級芯片的高效開發(fā)平臺。其設(shè)計流程能夠解決系統(tǒng)級芯片設(shè)計的大多數(shù)問題,而且開發(fā)成本較低、風(fēng)險較小,并能提高硬件制備和軟件開發(fā)的首次成功率。而本文所描述的架構(gòu)和設(shè)計流程由愛特梅爾的CAP 可定制微控制器系列所實現(xiàn)。
- 關(guān)鍵字: 可定制微控制器系統(tǒng)級芯片(SoC)
基于FPGA的數(shù)字顯示系統(tǒng)設(shè)計
- 本文以Virtex-II系列PlatformFPGA為例,說明采用FPGA方案進(jìn)行數(shù)字顯示系統(tǒng)設(shè)計所具有的靈活、快速和低成本等特性。
- 關(guān)鍵字: 數(shù)字顯示系統(tǒng) SoC FPGA
一種安全可控的SoC可測性設(shè)計
- 提出了一種安全可控的可測性設(shè)計DFT(Design For Test)。DFT既能夠完成對SoC的測試,又能保障SoC自身敏感信息和關(guān)鍵技術(shù)的安全。
- 關(guān)鍵字: SoC 可測性設(shè)計 信息安全
SoundWaveIP子系統(tǒng)常見問題解答
- 一個IP子系統(tǒng)將多種經(jīng)驗證的IP模塊單元和完整的軟件解決方案整合到一個集成化設(shè)計之中,以完成一種諸如音頻、視頻及圖像這樣的系統(tǒng)級功能。
- 關(guān)鍵字: 音頻IP子系統(tǒng) SoC 軟件集成流程
基于CPLD的片內(nèi)振蕩器設(shè)計及其優(yōu)化
- 本文介紹一種通用的基于CPLD的片內(nèi)振蕩器設(shè)計方法,它基于環(huán)形振蕩器原理,只占用片上普通邏輯資源(LE),無需使用專用邏輯資源(如MaxII中的UFM),從而提高了芯片的資源利用率。
- 關(guān)鍵字: 片內(nèi)振蕩器 SoC CPLD
基于IP的智能傳感器SOC設(shè)計
- 利用SOC/IP芯片能組成完整的智能傳感器系統(tǒng)。智能傳感器傳感參數(shù)可能是多種多樣的。但從功能模塊組成來講,它主要包括數(shù)據(jù)采集模塊、補(bǔ)償與校正模塊、數(shù)據(jù)處理模塊、數(shù)據(jù)網(wǎng)絡(luò)通信模塊、人機(jī)界面和任務(wù)管理與調(diào)度模塊等功能單元。從而基于IP的智能傳感器SOC設(shè)計過程為:首先正確建立智能傳感器的通用模塊模型;然后合理劃分各摸塊功能規(guī)范,制定各模塊之間的接口協(xié)議與標(biāo)準(zhǔn);再設(shè)計出一系列通用的IP核;最后把所需的通用IP核搭建整合在一起構(gòu)成完整的智能傳感器系統(tǒng)。
- 關(guān)鍵字: 智能傳感器系統(tǒng) SoC IP核
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