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Cadence推出面向硅設計的全新Neo NPU IP和NeuroWeave SDK,加速設備端和邊緣AI性能及效率

  • ●? ?Neo NPU可有效地處理來自任何主處理器的負載，單核可從 8 GOPS 擴展到 80 TOPS，多核可擴展到數(shù)百 TOPS●? ?AI IP可提供業(yè)界領先的 AI 性能和能效比，實現(xiàn)最佳 PPA 結果和性價比●? ?面向廣泛的設備端和邊緣應用，包括智能傳感器、物聯(lián)網(wǎng)、音頻/視覺、耳戴/可穿戴設備、移動視覺/語音 AI、AR/VR 和 ADAS●? ?全面、通用的 NeuroWeave SDK 可通過廣泛的 Caden
  • 關鍵字： Cadence  Neo NPU IP  NeuroWeave SDK  

任意網(wǎng)絡上的任意媒體(第5篇)—— Dante

  • 在《任意網(wǎng)絡上的任意媒體》系列的開篇中，我們探討了 AV-over-IP 以及業(yè)界多大程度上開始以某種形式采用它。這種采用見于企業(yè)、高等教育、廣播和直播活動等廣泛市場。每個系統(tǒng)都有著不同的需求，而這些不同需求可能會使設置過程變得復雜、耗時且成本高昂。這正是 AMD 合作伙伴 Audinate 推出其 Dante 產(chǎn)品線的價值所在。該產(chǎn)品易于集成和使用的特點令音視頻系統(tǒng)的設置和安裝變得簡單。圖1 Dante Brooklyn 3 模塊（來源：Audinate）Dante助力滿足您的網(wǎng)絡需求部署傳統(tǒng)音視頻系統(tǒng)
  • 關鍵字： 任意媒體  Dante  AMD  AV-over-IP  

英特爾和新思科技深化合作,提供基于英特爾先進制程節(jié)點的領先IP

  • 新聞亮點：●? ?該多代合作協(xié)議將進一步推動英特爾IDM 2.0戰(zhàn)略的發(fā)展；●? ?通過擴大合作伙伴關系和加快提供IP的速度，該合作將支持英特爾代工服務生態(tài)的發(fā)展；●? ?該合作建立在新思科技與英特爾長期的IP和EDA戰(zhàn)略合作伙伴關系之上。英特爾和新思科技（Synopsys）宣布已經(jīng)達成最終協(xié)議，深化在半導體IP和EDA（電子設計自動化）領域的長期戰(zhàn)略合作伙伴關系，共同為英特爾代工服務的客戶開發(fā)基于Intel 3和Intel 18A制程節(jié)點的IP
  • 關鍵字： 英特爾  新思科技  IP  

CEVA推出增強型NeuPro-M NPU IP系列，大力推動生成式AI

  • 全球領先的無線連接、智能感知技術及定制SoC解決方案的授權許可廠商CEVA, Inc. (納斯達克股票代碼： CEVA)宣布推出增強型NeuPro-M NPU系列，以業(yè)界領先的性能和能效滿足下一代生成式人工智能(Generative AI)的處理需求，適用于從云端到邊緣的各類別的人工智能推理工作負載。NeuPro-M NPU架構和工具經(jīng)過重新設計，除支持CNN和其他神經(jīng)網(wǎng)絡外，還支持transformer網(wǎng)絡，并支持未來的機器學習推理模型，因而能夠在通信網(wǎng)關、光連接網(wǎng)絡、汽車、筆記本電腦和平板電腦、AR/
  • 關鍵字： CEVA  NPU IP  生成式人工智能  Generative AI  

網(wǎng)絡常見的9大命令，非常實用！

  • 1．ping 命令PING （Packet Internet Groper），因特網(wǎng)包探索器，用于測試網(wǎng)絡連接量的程序 。Ping是工作在 TCP/IP網(wǎng)絡體系結構中應用層的一個服務命令， 主要是向特定的目的主機發(fā)送 ICMP（Internet Control Message Protocol 因特網(wǎng)報文控制協(xié)議）Echo 請求報文，測試目的站是否可達及了解其有關狀態(tài) 。簡單的說，ping 就是一個測試程序，如果 ping 運行正確，大體上就可以排除網(wǎng)絡訪問層、網(wǎng)卡、Modem 的輸入輸出線路、電纜和路由
  • 關鍵字： 網(wǎng)絡  計算機  主機  IP  網(wǎng)卡  

全新Arm IP Explorer平臺助力SoC架構師與設計廠商加速IP選擇

  • Arm 推出全新 Arm IP Explorer 平臺，該平臺是一套由 Arm 提供的云平臺服務，旨在為基于 Arm 架構設計系統(tǒng)的硬件工程師與 SoC 架構師，加速其 IP 選擇和 SoC 設計，為 IP 選擇流程帶來躍階式的效率提升，進而有效提高其開發(fā)和生產(chǎn)效率。為了加快產(chǎn)品推向市場，搶占商機，能在 SoC 設計流程的任一環(huán)節(jié)中提速都至關重要。Arm全新推出的 Arm IP Explorer 在針對用戶選擇 IP 的痛點進行流程優(yōu)化，通過探索、設計和分享三方面的多樣功能達到效率提升?！?nbsp;&n
  • 關鍵字： Arm IP Explorer  

大聯(lián)大品佳集團推出基于芯唐科技產(chǎn)品的IP CAM方案

  • 2023年7月6日，致力于亞太地區(qū)市場的國際領先半導體元器件分銷商---大聯(lián)大控股宣布，其旗下品佳推出基于芯唐科技（Nuvoton）MA35D1芯片的IP CAM方案。                                               圖示1-
  • 關鍵字： 大聯(lián)大品佳  芯唐  IP CAM  

新思科技與三星擴大IP合作,加速新興領域先進SoC設計

  • 摘要：●? ?新思科技接口IP適用于USB、PCI Express、112G以太網(wǎng)、UCIe、LPDDR、DDR、MIPI等廣泛使用的協(xié)議中，并在三星工藝中實現(xiàn)高性能和低延遲●? ?新思科技基礎IP，包括邏輯庫、嵌入式存儲器、TCAM和GPIO，可以在各先進節(jié)點上提供行業(yè)領先的功耗、性能和面積（PPA）●? ?新思科技車規(guī)級IP集成到三星的工藝中，有助于確保ADAS、動力總成和雷達SoC的長期運行并提高可靠性●? ?三星工藝中
  • 關鍵字： 新思科技  三星  IP  SoC設計  

Dolphin Design推出用于聲音分類的創(chuàng)新IP,可減少99%的功耗

  • Dolphin Design是提供電源管理、音頻和處理器以及ASIC設計服務的半導體IP解決方案的領導者，今天宣布推出WhisperExtractor，這是一個改變游戲規(guī)則的混合信號IP，用于支持語音和音頻的SoC。WhisperExtractor IP能夠以μW級別的功耗實現(xiàn)語音和聲音分類，為突破性的在線語音用戶界面和在線聲音檢測鋪平道路。該IP增強了旨在實現(xiàn)關鍵詞識別（KWS）、自動語音識別（ASR）、自然語言處理（NLP）或智能安全攝像頭等電池供電的高能效聲音分類應用。WhisperExtracto
  • 關鍵字： Dolphin Design  聲音分類  IP  

Dolphin Design推出用于聲音分類的創(chuàng)新IP，可減少99%的功耗

  • 2023年6月28日，格勒諾布爾。Dolphin Design是提供電源管理、音頻和處理器以及ASIC設計服務的半導體IP解決方案的領導者，今天宣布推出WhisperExtractor，這是一個改變游戲規(guī)則的混合信號IP，用于支持語音和音頻的SoC。WhisperExtractor IP能夠以μW級別的功耗實現(xiàn)語音和聲音分類，為突破性的在線語音用戶界面和在線聲音檢測鋪平道路。該IP增強了旨在實現(xiàn)關鍵詞識別（KWS）、自動語音識別（ASR）、自然語言處理（NLP）或智能安全攝像頭等電池供電的高能效聲音分類應
  • 關鍵字： Dolphin Design  聲音分類  IP  

CEVA將在上海世界移動通信大會展示消費類電子用芯片和軟件IP

  • 全球領先的無線連接和智能感知技術及共創(chuàng)解決方案的授權許可廠商CEVA, Inc.（納斯達克股票代碼：CEVA）參加2023年6月28至30日在上海舉辦的世界移動通信大會。在這次展會上，CEVA團隊將與SoC和OEM客戶面對面溝通交流，探討最新的技術創(chuàng)新，并介紹如何充分利用CEVA IP開發(fā)無線連接和智能感知應用以實現(xiàn)產(chǎn)品設計目標。 CEVA將在行政會議室展示用于邊緣AI、5G、計算機視覺、空間音頻(spatial-audio)和物聯(lián)網(wǎng)連接的最新解決方案，包括： ● 邊緣AI推
  • 關鍵字： CEVA  上海世界移動通信大會  IP  

Cadence發(fā)布面向TSMC 3nm工藝的112G-ELR SerDes IP展示

  • 3nm 時代來臨了！Cadence 在 2023 年 TSMC 北美技術研討會期間發(fā)布了面向臺積電 3nm 工藝（N3E）的 112G 超長距離（112G-ELR）SerDes IP 展示，這是 Cadence 112G-ELR SerDes IP 系列產(chǎn)品的新成員。在后摩爾時代的趨勢下，F(xiàn)inFET 晶體管的體積在 TSMC 3nm 工藝下進一步縮小，進一步采用系統(tǒng)級封裝設計（SiP）。通過結合工藝技術的優(yōu)勢與 Cadence 業(yè)界領先的數(shù)字信號處理（DSP）SerDes 架構，全新的 112G-ELR
  • 關鍵字： Cadence  TSMC  3nm工藝  SerDes IP  

芯原股份：公司的神經(jīng)網(wǎng)絡處理器IP系列產(chǎn)品可廣泛適用于AIoT、智慧汽車等應用場景

  • 2023年5月8日，芯原股份（688521.SH）在互動平臺表示，芯原用于人工智能的神經(jīng)網(wǎng)絡處理器IP（NPU）業(yè)界領先，已經(jīng)在10多個領域、60多家客戶的110多款芯片中被采用。根據(jù)目前市場的需求，芯原基于自身神經(jīng)網(wǎng)絡處理器IP可伸縮可擴展的特性，已發(fā)展了覆蓋從高性能云計算到低功耗邊緣計算的垂直解決方案；同時還推出了從攝像頭輸入到顯示器輸出的完整智能像素解決方案。因此，在人工智能領域，芯原的神經(jīng)網(wǎng)絡處理器IP系列產(chǎn)品可廣泛適用于包括智慧物聯(lián)網(wǎng)（AIoT）、智慧汽車、智慧可穿戴、智慧家居、視頻數(shù)據(jù)中心、智
  • 關鍵字： 芯原股份  IP  神經(jīng)網(wǎng)絡處理器IP  

楷登電子成功流片基于臺積電N3E工藝的16G UCIe先進封裝IP

  • 近日，楷登電子（Cadence）宣布基于臺積電3nm（N3E）工藝技術的Cadence? 16G UCIe? 2.5D先進封裝IP成功流片。該IP采用臺積電3D Fabric? CoWoS-S硅中介層技術實現(xiàn)，可提供超高的帶寬密度、高效的低功耗性能和卓越的低延遲，非常適合需要極高算力的應用。據(jù)悉，楷登電子目前正與許多客戶合作，來自N3E測試芯片流片的UCIe先進封裝IP已開始發(fā)貨并可供使用。這個預先驗證的解決方案可以實現(xiàn)快速集成，為客戶節(jié)省時間和精力。
  • 關鍵字： 楷登電子  臺積電  N3E  UCIe  先進封裝  IP  

為什么嵌入式FPGA（eFPGA）IP是ADAS應用的理想選擇？

  • 提高汽車電氣化和自動駕駛的一個主要方面是先進駕駛輔助系統(tǒng)（ADAS）的普及。如今，這些系統(tǒng)正迅速應用于市場上幾乎所有的車輛，而且隨著技術的成熟，這一趨勢只會持續(xù)下去。然而，隨著技術的發(fā)展，ADAS設計人員面臨的硬件挑戰(zhàn)變得越來越復雜。在本文中，我們將介紹ADAS的硬件需求，F(xiàn)PGA如何填補這些空白，以及為什么eFPGA IP將成為下一個ADAS硬件趨勢。ADAS的硬件要求ADAS在現(xiàn)代汽車中的發(fā)展給底層硬件帶來了一些嚴峻的挑戰(zhàn)。在像ADAS這樣的關鍵任務應用中，最重要的目標是確保車輛乘員的安全。這個目標要
  • 關鍵字： 嵌入式FPGA  eFPGA  IP  ADAS  
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ucie ip介紹

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