基于FPGA的數(shù)字脈沖壓縮系統(tǒng)實(shí)現(xiàn)
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2．2．3 塊浮點(diǎn)數(shù)據(jù)格式
在數(shù)字信號(hào)處理系統(tǒng)中，數(shù)據(jù)表示格式可分為定點(diǎn)制、浮點(diǎn)制和塊浮點(diǎn)制，它們?cè)趯?shí)現(xiàn)時(shí)對(duì)系統(tǒng)資源的要求不同，工作速度也不同，有著不同的適用范圍。定點(diǎn)表示法使用最多，簡(jiǎn)單且速度快，但動(dòng)態(tài)范圍有限，需要用合適的溢出控制規(guī)則(如定比例法)適當(dāng)壓縮輸入信號(hào)的動(dòng)態(tài)范圍，但這樣會(huì)降低輸出信號(hào)的信噪比。浮點(diǎn)表示法的優(yōu)點(diǎn)是動(dòng)態(tài)范圍大，可避免溢出，能在很大的動(dòng)態(tài)范圍內(nèi)達(dá)到很高的信噪比，主要缺點(diǎn)是系統(tǒng)實(shí)現(xiàn)復(fù)雜，硬件需求量大，成本和功耗高，而且速度較慢。
塊浮點(diǎn)表示法兼有定點(diǎn)法和浮點(diǎn)法的某些優(yōu)點(diǎn)，是以上2種表示法的結(jié)合。這種表示法首先對(duì)一組數(shù)據(jù)進(jìn)行檢測(cè)，歸一化最大數(shù)的小數(shù)部分，再建立適當(dāng)?shù)闹笖?shù)。接著把剩下數(shù)據(jù)的小數(shù)部分轉(zhuǎn)化為合適的數(shù)，使它們可以使用最大數(shù)的指數(shù)。塊浮點(diǎn)算法的主要優(yōu)點(diǎn)是：大動(dòng)態(tài)范圍、低截?cái)?或舍入)噪聲，是一種有效的數(shù)據(jù)表示形式。從芯片實(shí)現(xiàn)角度上看，塊浮點(diǎn)表示法能夠保證較高的信號(hào)處理質(zhì)量，尤其適用于FFT運(yùn)算的場(chǎng)合。脈壓模塊中的FFT核帶有塊浮點(diǎn)運(yùn)算的功能，整個(gè)運(yùn)算過(guò)程中的數(shù)據(jù)格式表示如圖5所示。本文引用地址：http://butianyuan.cn/article/191544.htm
ADC輸入數(shù)據(jù)為14 b的二進(jìn)制補(bǔ)碼形式，對(duì)其低位補(bǔ)零擴(kuò)展為16 b(IP核要求的輸入精度)后送入FFT運(yùn)算單元，輸出結(jié)果為16 b的定點(diǎn)數(shù)以及指數(shù)EXP1。復(fù)乘包括乘法和累加運(yùn)算，即FFT結(jié)果與匹配系數(shù)進(jìn)行16 b×16 b的乘法運(yùn)算，所得結(jié)果再進(jìn)行加法運(yùn)算；在進(jìn)行加法運(yùn)算前，所有數(shù)據(jù)擴(kuò)展為33 b以防止溢出的發(fā)生，最終數(shù)據(jù)截取高16 b送入IFFT處理單元，輸出為16 b的定點(diǎn)數(shù)和指數(shù)EXP2，將其與EXPl相加后
得到指數(shù)EXP。脈壓的最終結(jié)果即為IFFT后的16 b定點(diǎn)數(shù)以及指數(shù)EXP，兩者分別存儲(chǔ)在FPGA片內(nèi)RAM中。
2．3 脈沖壓縮模塊的測(cè)試
設(shè)輸入理想LFM信號(hào)參數(shù)如下：帶寬B=40 MHz；時(shí)寬T=6μs；系統(tǒng)樣本速率為60 MHz；使用海明窗加權(quán)。在上述條件下，脈沖壓縮系統(tǒng)的輸出結(jié)果對(duì)數(shù)圖如圖6所示。
在圖6中，橫軸代表距離采樣單元，即系統(tǒng)最小距離分辨率。通過(guò)系統(tǒng)實(shí)際處理結(jié)果與Madab仿真結(jié)果的對(duì)比驗(yàn)證了設(shè)計(jì)的正確性和實(shí)用性。
3 結(jié)語(yǔ)
系統(tǒng)采用ADS5500完成14位、60 MSPS的數(shù)據(jù)采集，并在FPGA中實(shí)現(xiàn)1 024點(diǎn)的數(shù)字脈沖壓縮。設(shè)計(jì)采用并行流水方式提高工作速度，而塊浮點(diǎn)算法則充分保證運(yùn)算的精度。IP核的復(fù)用大大降低硬件規(guī)模，從而使整個(gè)系統(tǒng)具有高速度、高精度和低功耗的特點(diǎn)。
評(píng)論