雷達視頻積累算法在FPGA上的實現(xiàn)

小滑窗檢測器是一種窗孔長度L(累加的脈沖數(shù)為L)小于天線波束掃過目標時收到回波脈沖數(shù)N的檢測器。L一般比N小很多，例如N在10～20以上，而L取5～7。小滑窗檢測方法進行視頻積累的原理框圖如圖2所示。

在本設計中，通過FPGA軟件編程采用FPGA+SRAM的方式來實現(xiàn)視頻積累。小滑窗檢測器的延時主要通過將信號量化后存儲在高速SRAM的方式完成。FPGA軟件編程實現(xiàn)視頻積累的原理圖如圖3所示。

圖3中的clk為系統(tǒng)主時鐘；count_dist為距離計數(shù)器；acc_en為視頻積累的使能信號，acc_en為高電平時有效；count_dist，clk與acc_en為控制時序關系的主要系統(tǒng)變量；acc_data為求模后輸入的非相參信號，系統(tǒng)的視頻信號實時不斷地輸入到FPGA中。

FPGA通過時序控制將acc_data信號量化后為RAM_data信號；當RAM的讀信號RAM_we為高電平時，RAM_data寫入SRAM地址中，通過時序控制將前面L-1個周期的量化信號存儲在高速SRAM中，待信號在SRAM中存滿后，即RAM_rd為高電平；RAM_we為低電平時，通過時序控制，將存入SRAM中的同一距離單元上的前L-1個信號讀出，并與當前輸入信號在FPGA中進行累加完成窗孔長度為L的小滑窗檢測，從而實現(xiàn)對非相參視頻信號的視頻積累。

4 仿真驗證

為了驗證本文原理以及本系統(tǒng)的實現(xiàn)效果，首先模擬產(chǎn)生雷達信號處理中經(jīng)過求模以后的相參視頻信號，該信號僅含有幅度信息和雜波(根據(jù)參數(shù)設置直接在FPGA芯片中利用軟件編程產(chǎn)生)，對該模擬信號進行視頻積累，經(jīng)D／A變換送給示波器顯示。將編譯綜合后的BIT文件下載到FPGA芯片中進行系統(tǒng)聯(lián)調(diào)，最后在示波器上查看仿真的結果。圖4為經(jīng)過求模后的雷達相參視頻信號在示波器上的截圖，該信號的雜波為近似服從均值為0的均勻分布；圖5為對該模擬信號進行視頻積累后在示波器上的截圖。

從仿真的結果可以看出，利用本系統(tǒng)對經(jīng)過求模后的信號進行視頻積累取得了比較理想的效果。

5 結語

本文著重介紹了利用FPGA芯片實現(xiàn)視頻積累的原理和過程。利用FPGA進行雷達視頻積累，可使系統(tǒng)具有更大的靈活性，減少了系統(tǒng)的體積，提高了系統(tǒng)的可靠性，大大縮短了系統(tǒng)開發(fā)的周期。隨著FPGA芯片以及設計更新軟件的更新與快速發(fā)展，F(xiàn)PGA芯片將具有更高速的重復復雜計算的能力，同時又具有軟件的靈活性，并可以重復利用硬件來降低成本，模糊了硬件與軟件之間的界限，使硬件系統(tǒng)具有更大的靈活性以及通用性。

本文最后利用FPGA軟件編程模擬實現(xiàn)了一個經(jīng)過求模后的雷達相參視頻信號，并利用本系統(tǒng)對該信號進行了視頻積累，取得了較好的效果。