常用EDA設(shè)計與仿真軟件介紹
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(1)VHDL語言 超高速集成電路硬件描述語言(VHSIC Hardware Deseription Languagt，簡稱VHDL)，是IEEE的一項標(biāo)準(zhǔn)設(shè)計語言。它源于美國國防部提出的超高速集成電路(Very High Speed Integrated Circuit，簡稱VHSIC)計劃，是ASIC設(shè)計和PLD設(shè)計的一種主要輸入工具。
(2)Veriolg HDL 是Verilog公司推出的硬件描述語言，在ASIC設(shè)計方面與VHDL語言平分秋色。
(3)其它EDA軟件如專門用于微波電路設(shè)計和電力載波工具、PCB制作和工藝流程控制等領(lǐng)域的工具，在此就不作介紹了。
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