一種基于FPGA的電子穩(wěn)像系統(tǒng)的研究與設計
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2 系統(tǒng)集成
綜上所述，完整的電子穩(wěn)像系統(tǒng)結(jié)構(gòu)如圖8所示。攝像頭輸入的信號采用PAL制式，經(jīng)過視頻處理接口后形成RGB565格式的數(shù)字視頻信號和控制信息;幀存控制器作為整個平臺的核心，在將數(shù)據(jù)寫入幀存儲器的同時，對數(shù)字化的圖像信息進行去隔行處理，再將數(shù)據(jù)讀出送往VGA控制器時進行放大變換。VGA控制器則負責將數(shù)據(jù)按照VGA標準時序送往顯示器上。
在該平臺上實現(xiàn)了文獻中K0等人提出的一種最簡單的基本位平面的電子穩(wěn)像算法，對于8位的灰度圖像，可以表示為：利用第4層進行運算，其依據(jù)是在多幀圖像進行BPM運算后發(fā)現(xiàn)，該層的誤差結(jié)果較平滑。然而，K0的BMP-b4算法在不同的圖像序列和信噪比的情況下，并不能總得到一個最優(yōu)解;在某些情況下，b4、b5或b6會得到更好的結(jié)果。
目前資料顯示電子穩(wěn)像技術(shù)作為近年新興技術(shù)還處于試驗研究階段，因其適用范圍廣闊而展現(xiàn)了樂觀的研發(fā)前景。
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