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EEPW首頁 >> 主題列表 >> 卷積編碼

基于FPGA的高速并行Viterbi譯碼器的設計與實現(xiàn)

  • 針對319卷積編碼，提出一種Viterbi譯碼器的FPGA實現(xiàn)方案。該方案兼顧了資源消耗和譯碼效率，通過有效的時鐘和存儲介質復用，實現(xiàn)了高速并行的譯碼功能，并利用Verilog語言在Xilinx ISE 6．2中進行了建模仿真和綜合實現(xiàn)。
  • 關鍵字： 卷積編碼  Viterbi譯碼器  FPGA  

利用FPGA實現(xiàn)無線分布式采集系統(tǒng)設計

  • 在無線分布式采集系統(tǒng)設計中，采用了基于卷積編碼、Viterbi譯碼的編碼和互為備份的雙通道傳輸方案，利用了FPGA內豐富的邏輯資源以及存儲資源，實現(xiàn)了數(shù)據(jù)的遠距離同步可靠傳輸。
  • 關鍵字： 無線分布  Viterbi  FPGA  采集系統(tǒng)  卷積編碼  

一種突發(fā)OFDM傳輸系統(tǒng)的設計

  • 第四代移動通信系統(tǒng)要求有更高的數(shù)據(jù)傳輸速率、更好的傳輸質量且同時能很好地克服多徑衰落，消除高速數(shù)據(jù)傳輸時嚴重的符號間干擾并大大提高頻譜利用率，正交頻分復用OFDM技術作為一種強有力的數(shù)字調制方式，以其突出的優(yōu)點成為4G移動通信系統(tǒng)的核心技術。在多徑時延、信息速率以及帶寬等特定背景條件確定的情況下，根據(jù)工程經驗設計了一種適應該背景條件的突發(fā)OFDM傳輸系統(tǒng)，并且確定予載波數(shù)量、符號速率、OFDM幀結構等總體參數(shù)。最后給出了該OFDM傳輸系統(tǒng)設計結構示意圖。
  • 關鍵字： OFDM  卷積編碼  多普勒頻移  定時估計  
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卷積編碼介紹

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