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EEPW首頁 >> 主題列表 >> 擴(kuò)頻信號

基于FPGA的跳擴(kuò)頻信號發(fā)送系統(tǒng)設(shè)計

  • 提出一種基于FPGA的跳擴(kuò)頻信號發(fā)送系統(tǒng)設(shè)計方案，系統(tǒng)硬件以FPGA為核心，將基帶處理和中頻調(diào)制完全集成在FPGA芯片內(nèi)部，采用新型的高速DDS(Direct Digital Syntlaesis)AD9951芯片和高速數(shù)模轉(zhuǎn)換器來輔助電路完成信號的產(chǎn)生和發(fā)送。介紹了系統(tǒng)軟件控制流程，以及系統(tǒng)設(shè)計中關(guān)鍵技術(shù)的研究與實現(xiàn)。系統(tǒng)軟件利用QuanusⅡ8．0開發(fā)平臺，使用VHDL語言設(shè)計實現(xiàn)。借助Matlab和Multisire 10．1高頻電路仿真軟件分析和優(yōu)化系統(tǒng)。系統(tǒng)采用數(shù)字化的相對相移鍵控(DQPSK)
  • 關(guān)鍵字： FPGA  擴(kuò)頻信號  發(fā)送  系統(tǒng)設(shè)計    
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擴(kuò)頻信號介紹

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