數(shù)字信號處理(dsp) 文章 進(jìn)入數(shù)字信號處理(dsp)技術(shù)社區(qū)
CEVA發(fā)布針對6Gbps固態(tài)硬盤應(yīng)用的SATA3.0 IP
- 全球領(lǐng)先的硅產(chǎn)品知識產(chǎn)權(quán) (SIP) 平臺解決方案和數(shù)字信號處理器(DSP)內(nèi)核授權(quán)廠商CEVA公司宣布提供CEVA-SATA3.0設(shè)備控制器IP?;谂c固態(tài)硬盤 (SSD) 客戶廣泛的合作經(jīng)驗,CEVA公司已經(jīng)提升其SATA設(shè)備控制器IP性能,提供 6Gbps 線路速率 (line rate) 以實現(xiàn)更快的數(shù)據(jù)傳輸,使得吞吐量較上代產(chǎn)品提高一倍。該IP已經(jīng)授權(quán)予一家領(lǐng)先的閃存半導(dǎo)體制造商,用于其未來的固態(tài)硬盤設(shè)計中。 CEVA-SATA3.0 IP 采用最新的原生指令排序 (Native Co
- 關(guān)鍵字: CEVA 固態(tài)硬盤 DSP
DSP內(nèi)嵌PLL中的CMOS壓控環(huán)形振蕩器設(shè)計
- DSP內(nèi)嵌PLL中的CMOS壓控環(huán)形振蕩器設(shè)計,本文設(shè)計了一種應(yīng)用于DSP內(nèi)嵌鎖相環(huán)的低功耗、高線性CM0S壓控環(huán)形振蕩器。電路采用四級延遲單元能方便的獲得正交輸出時鐘,每級采用RS觸發(fā)結(jié)構(gòu)來產(chǎn)生差分輸出信號,在有效降低靜態(tài)功耗的同時.具有較好的抗噪聲能力。在延遲單元的設(shè)計時。綜合考慮了電壓控制的頻率范圍以及調(diào)節(jié)線性度,選擇了合適的翻轉(zhuǎn)點(diǎn)。 仿真結(jié)果表明.電路叮實現(xiàn)2MHz至90MHz的頻率調(diào)節(jié)范圍,在中心頻率附近具有很高的調(diào)節(jié)線性度,可完全滿足DSP芯片時鐘系統(tǒng)的要求。
- 關(guān)鍵字: 振蕩器 設(shè)計 環(huán)形 CMOS 內(nèi)嵌 PLL DSP
TMS320C6713B DSP的外部FLASH引導(dǎo)
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字: TMS320C6713B DSP Flash
基于FPGA+DSP的雷達(dá)回波發(fā)生器設(shè)計
- 雷達(dá)回波發(fā)生器利用現(xiàn)代仿真技術(shù)生成蘊(yùn)含雷達(dá)目標(biāo)和環(huán)境信息的模擬雷達(dá)信號,用來對雷達(dá)系統(tǒng)進(jìn)行性能測試和評估。根據(jù)通用性、靈活性要求,提出了一種基于DSP+FPGA的雷達(dá)回波發(fā)生器的設(shè)計方法;簡要介紹了設(shè)計思想,詳細(xì)闡述了系統(tǒng)的硬件組成和軟件設(shè)計,并給出了測試結(jié)果并總結(jié)了該雷達(dá)回波發(fā)生器的一些優(yōu)點(diǎn)。
- 關(guān)鍵字: FPGA DSP 雷達(dá)回波 發(fā)生器
數(shù)字信號處理(dsp)介紹
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