相位累加器 文章 進入相位累加器技術社區(qū)
基于Verilog的多路相干DDS信號源設計
- 摘要:傳統(tǒng)的多路同步信號源常采用單片機搭載多片專用DDS芯片配合實現(xiàn)。該技術實現(xiàn)復雜,且在要求各路同步相干可控時難以實現(xiàn)。本文在介紹了DDS原理的基礎上,給出了用Verilog_HDL語言實現(xiàn)相干多路DDS的工作原理、設
- 關鍵字: DDS 現(xiàn)場可編程門陣列(FPGA) 相位累加器 Verilog_HDL
任意波發(fā)生器的研究與設計
- 摘要:在任意波形發(fā)生器設計中,DDS技術具有成本低、功耗小、分辨率高和切換時間快等優(yōu)點,但波形形狀任意可編輯性較差;軟件無線電技術可產(chǎn)生任意復雜波形,但切換時間慢。采用DDS和軟件無線電相結合的技術,正弦波
- 關鍵字: 任意波形發(fā)生器 直接數(shù)字頻率合成 軟件無線電 頻率控制字 相位累加器
實現(xiàn)直接數(shù)字頻率合成器的三種技術方案
- 摘 要:討論了DDS的工作原理及性能特點,介紹了目前實現(xiàn)DDS常用的三種技術方案,并對各方案的特點作了簡單的說明。 關鍵詞:直接數(shù)字頻率合成器 相位累加器 信號源 現(xiàn)場可編程門陣列 1971年,美國學者J.Tierney等人撰寫的"A Digital Frequency Synthesizer"一文首次提出了以全數(shù)字技術,從相位概念出發(fā)直接合成所需波形的一種新的頻率合成原理。限于當時的技術和器件水平,它的性能指
- 關鍵字: 現(xiàn)場可編程門陣列 相位累加器 信號源 直接數(shù)字頻率合成器
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相位累加器介紹
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