硅設計鏈產(chǎn)業(yè)協(xié)作組織 文章 進入硅設計鏈產(chǎn)業(yè)協(xié)作組織技術(shù)社區(qū)
硅設計鏈廠商通力合作降低90納米芯片總功耗
- 硅設計鏈產(chǎn)業(yè)協(xié)作組織（Silicon Design Chain Initiative）的半導體工業(yè)領導廠商宣布，經(jīng)流片驗證的低功耗90納米芯片設計技術(shù)可使芯片的總功耗降低40％。該低功耗設計采用了多個廠商的先進技術(shù)：ARM1136JF-S™測試芯片，ARM® Artisan®標準設計單元庫和存儲單元，Cadence Encounter™設計平臺和TSMC的Reference Flow 5.0。參加硅設計鏈協(xié)作組織的公司有：應用材料Applied Materials,
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硅設計鏈產(chǎn)業(yè)協(xié)作組織介紹
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