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采用FPGA IP實(shí)現(xiàn)DDR的讀寫(xiě)控制的設(shè)計(jì)與驗(yàn)證

• 摘要： 本文采用LatticeXP系列FPGA結(jié)合IP解決DDR RAM的讀寫(xiě)控制。并且在硬件上面進(jìn)行了實(shí)際測(cè)試。關(guān)鍵詞： 嵌入式系統(tǒng)；DDR RAM；FPGA；IP；LattcieXP 前言隨著高速處理器的不斷發(fā)展，嵌入式系統(tǒng)應(yīng)用的領(lǐng)域越來(lái)越廣泛，數(shù)字信號(hào)處理的規(guī)模也越來(lái)越大，系統(tǒng)中RAM規(guī)模不斷增加，比如視頻監(jiān)控、圖像數(shù)據(jù)采集等領(lǐng)域，圖像處理的實(shí)時(shí)性對(duì)RAM帶寬的要求不斷增加，傳統(tǒng)的SDRAM在帶寬上已經(jīng)逐漸無(wú)法滿(mǎn)足應(yīng)用要求，DDR SDRAM(雙倍速率SDRAM)采用在時(shí)鐘CL
• 關(guān)鍵字： 0702_A  DDR  FPGA  IP  LattcieXP  RAM  單片機(jī)  嵌入式系統(tǒng)  雜志_設(shè)計(jì)天地  存儲(chǔ)器