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FPGA/EPLD的自上而下(Top-Down)設(shè)計(jì)方法解析

  • FPGA/EPLD的自上而下(Top-Down)設(shè)計(jì)方法：傳統(tǒng)的設(shè)計(jì)手段是采用原理圖輸入的方式進(jìn)行的，通過調(diào)用FPGA/EPLD廠商所提供的相應(yīng)物理元件庫(kù)，在電路原理圖
  • 關(guān)鍵字： FPGA  EPLD  自上而下  

利用FPGA實(shí)現(xiàn)的一種機(jī)載高清視頻處理模塊

  • 現(xiàn)代飛機(jī)座艙顯示技術(shù)的發(fā)展日新月異，需要顯示各種傳感器信息的數(shù)據(jù)已經(jīng)達(dá)到海量規(guī)模。飛行員在不同飛行時(shí)段獲得的信息也越來越多，為了使飛行員能夠
  • 關(guān)鍵字： 視頻  FPGA  

“FPGA+CPU” 并行處理大行其道

  • 深亞微米時(shí)代，傳統(tǒng)材料、結(jié)構(gòu)乃至工藝都在趨于極限狀態(tài)，摩爾定律也已有些捉襟見肘。而步入深亞納米時(shí)代，晶體管的尺寸就將接近單個(gè)原子，無法再往下
  • 關(guān)鍵字： FPGA  CPU  嵌入式  并行處理  

基于FPGA消除噪聲干擾方法詳解

  • 許多高速數(shù)據(jù)采集應(yīng)用，如激光雷達(dá)或光纖測(cè)試等，都需要從嘈雜的環(huán)境中采集小的重復(fù)信號(hào)，因此對(duì)于數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)來說，最大的挑戰(zhàn)就是如何最大限
  • 關(guān)鍵字： 噪聲  FPGA  信號(hào)平均  

高云半導(dǎo)體公司發(fā)布基于晨熙家族FPGA的RISC-V微處理器 早期使用者計(jì)劃

  • 　　中國(guó)廣州，2018年8月16日，國(guó)內(nèi)領(lǐng)先的可編程邏輯器件供應(yīng)商——廣東高云半導(dǎo)體科技股份有限公司(如下簡(jiǎn)稱“高云半導(dǎo)體”)，今日宣布發(fā)布基于高云半導(dǎo)體FPGA的RISC-V微處理器早期使用者計(jì)劃，該計(jì)劃是基于晨熙家族 GW2A 系列FPGA芯片的包括系統(tǒng)級(jí)參考設(shè)計(jì)的FPGA編程BIT文件、GW2A開發(fā)板等的完整解決方案，其中系統(tǒng)級(jí)參考設(shè)計(jì)包括RISC-V MCU內(nèi)核、AHB & APB總線、存儲(chǔ)器控制單元及若干外設(shè)?！　ISC-V作為指令集體系結(jié)構(gòu)(ISA)的開放規(guī)范，RISC-V ISA設(shè)
  • 關(guān)鍵字： 高云  FPGA  RISC-V  

32位嵌入式處理器與8位處理器應(yīng)用開發(fā)的三大不同點(diǎn)

  • ARM處理器在全球范圍的流行，32位的RISC嵌入式處理器已經(jīng)成為嵌入式應(yīng)用和設(shè)計(jì)的主流。與國(guó)內(nèi)大量應(yīng)用的8位單片機(jī)相比，32位的嵌入式CPU有著非常大的優(yōu)
  • 關(guān)鍵字： 嵌入式  處理器  ARM  CPU  

設(shè)計(jì)出色的可穿戴產(chǎn)品應(yīng)考慮的幾大因素

  • 在當(dāng)今群雄逐鹿、競(jìng)爭(zhēng)激烈的可穿戴市場(chǎng)中，獲得成功的關(guān)鍵在于差異化的產(chǎn)品特性和服務(wù)。制造商和服務(wù)提供商競(jìng)相爭(zhēng)奪同樣的可穿戴ldquo;市場(chǎng)大餅rdq
  • 關(guān)鍵字： 可穿戴產(chǎn)品  ARM  CMOS  

采用ARM的壓電陶瓷驅(qū)動(dòng)電源結(jié)構(gòu)及電路

  • 隨著現(xiàn)如今電源設(shè)計(jì)的多樣化，壓電陶瓷驅(qū)動(dòng)電源開始占據(jù)市場(chǎng)的一席之地，其在一些特殊場(chǎng)合有著傳統(tǒng)電源無法比擬的優(yōu)點(diǎn)。在本文中，小編將為大家介紹一
  • 關(guān)鍵字： ARM  驅(qū)動(dòng)電源  壓電陶瓷  D/A轉(zhuǎn)換  線性放大  

值得一看！高手分享FPGA設(shè)計(jì)中的一些經(jīng)驗(yàn)

  • 這里我談?wù)勎业囊恍┙?jīng)驗(yàn)和大家分享，希望能對(duì) IC 設(shè)計(jì)的新手有一定的幫助，能使得他們能少走一些彎路!在 IC 工業(yè)中有許多不同的領(lǐng)域， IC 設(shè)計(jì)者的特征
  • 關(guān)鍵字： FPGA  IC設(shè)計(jì)  經(jīng)驗(yàn)  

微控制器配對(duì)FPGA來提高系統(tǒng)效率

  • FPGA已經(jīng)變得如此成本效益的，它們?cè)絹碓蕉嗟嘏c微控制器配合使用，以提高整個(gè)系統(tǒng)的效率。使用包括添加額外的功能在電路板空間最小，增加功率高效處理
  • 關(guān)鍵字： FPGA  微控制器  

基于FPGA實(shí)現(xiàn)的音頻接口轉(zhuǎn)換電路

  • I2S總線是一種用于音頻設(shè)備間傳輸數(shù)據(jù)的串行總線標(biāo)準(zhǔn)，該總線采用獨(dú)立的時(shí)鐘線與數(shù)據(jù)線，避免了時(shí)差誘發(fā)的失真。隨著多媒體的廣泛應(yīng)用，該總線已被應(yīng)用
  • 關(guān)鍵字： FPGA  接口轉(zhuǎn)換  PCI  

結(jié)合FPGA與結(jié)構(gòu)化ASIC進(jìn)行設(shè)計(jì)

  • 由于結(jié)構(gòu)化ASIC具有單位成本低、功耗低、性能高和轉(zhuǎn)換快(fast turnaound)等特點(diǎn)，越來越多的先進(jìn)系統(tǒng)設(shè)計(jì)工程師正在考慮予以采用。在結(jié)構(gòu)化ASIC中，像
  • 關(guān)鍵字： FPGA  

【詳解】FPGA：機(jī)器深度學(xué)習(xí)的未來？

  • 最近幾年數(shù)據(jù)量和可訪問性的迅速增長(zhǎng)，使得人工智能的算法設(shè)計(jì)理念發(fā)生了轉(zhuǎn)變。人工建立算法的做法被計(jì)算機(jī)從大量數(shù)據(jù)中自動(dòng)習(xí)得可組合系統(tǒng)的能力所取
  • 關(guān)鍵字： FPGA  

FPGA擊敗GPU和GPP，成為深度學(xué)習(xí)的未來？

  • 最近幾年，深度學(xué)習(xí)成為計(jì)算機(jī)視覺、語(yǔ)音識(shí)別、自然語(yǔ)言處理等關(guān)鍵領(lǐng)域中所最常使用的技術(shù)，被業(yè)界大為關(guān)注。然而，深度學(xué)習(xí)模型需要極為大量的數(shù)據(jù)和
  • 關(guān)鍵字： FPGA  GPU  GPP  深度學(xué)習(xí)  

云中的機(jī)器學(xué)習(xí)：FPGA 上的深度神經(jīng)網(wǎng)絡(luò)

  • 憑借出色的性能和功耗指標(biāo)，賽靈思 FPGA 成為設(shè)計(jì)人員構(gòu)建卷積神經(jīng)網(wǎng)絡(luò)的首選 XE XE XE XE 。新的軟件工具可簡(jiǎn)化實(shí)現(xiàn)工作。人工智能正在經(jīng)
  • 關(guān)鍵字： FPGA  
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