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基于FPGA的SoftSerdes設(shè)計(jì)與實(shí)現(xiàn)
- 引言 在高速源同步應(yīng)用中,時(shí)鐘數(shù)據(jù)恢復(fù)是基本的方法。最普遍的時(shí)鐘恢復(fù)方法是利用數(shù)字時(shí)鐘模塊(DCM、)產(chǎn)生的多相位時(shí)鐘對(duì)輸入的數(shù)據(jù)進(jìn)行過(guò)采樣。但是由于DCM的固有抖動(dòng),在頻率很高時(shí),利用DCM作為一種數(shù)據(jù)恢復(fù)的
- 關(guān)鍵字: SoftSerdes FPGA
FPGA在智能壓力傳感器系統(tǒng)中的應(yīng)用設(shè)計(jì)
- 0引言傳統(tǒng)氣體壓力測(cè)量?jī)x器的傳感器部分與數(shù)據(jù)采集系統(tǒng)是分離的,抗干擾的能力較差,并且通常被測(cè)對(duì)...
- 關(guān)鍵字: FPGA 智能壓力傳感器系統(tǒng)
用FPGA動(dòng)態(tài)探頭與數(shù)字VSA對(duì)DSP設(shè)計(jì)實(shí)時(shí)分析
- 用FPGA動(dòng)態(tài)探頭與數(shù)字VSA對(duì)DSP設(shè)計(jì)實(shí)時(shí)分析, 隨著 FPGA 在數(shù)字通信設(shè)計(jì)領(lǐng)域(蜂窩基站、衛(wèi)星通信和雷達(dá))的高性能信號(hào)處理電路中成為可行的選擇,分析和調(diào)試工具必須包括能幫助您在最短時(shí)間內(nèi)得到電路最佳性能的新技術(shù)。 雖然現(xiàn)在已經(jīng)有多種連接仿真與射頻
- 關(guān)鍵字: 設(shè)計(jì) 實(shí)時(shí) 分析 DSP VSA 動(dòng)態(tài) 探頭 數(shù)字 FPGA
一種出租車計(jì)價(jià)器的FPGA設(shè)計(jì)方案及應(yīng)用
- O引言FPGA(FieldProgrammableGateArray,現(xiàn)場(chǎng)可編程門陣列)是一種高密度可編程邏輯器件,它支持...
- 關(guān)鍵字: FPGA Max+Plus 出租車計(jì)價(jià)器
FPGA的時(shí)鐘頻率同步原理研究與設(shè)計(jì)實(shí)現(xiàn)
- 引言網(wǎng)絡(luò)化運(yùn)動(dòng)控制是未來(lái)運(yùn)動(dòng)控制的發(fā)展趨勢(shì),隨著高速加工技術(shù)的發(fā)展,對(duì)網(wǎng)絡(luò)節(jié)點(diǎn)間的時(shí)間同步精度...
- 關(guān)鍵字: FPGA 時(shí)鐘頻率同步
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