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二代提速硬件仿真 關(guān)注功耗/速度優(yōu)勢(shì)IP公司

  • 　　Cadence CDNLive上海站，廠商聊的最多的，大家最想了解的，自然是剛剛在北京首發(fā)的Palladium XP II驗(yàn)證平臺(tái)和系統(tǒng)開發(fā)增強(qiáng)套件。作為Palladium XP仿真系統(tǒng)的更新產(chǎn)品，二代產(chǎn)品最多可以將驗(yàn)證性能再提高50%，更將其業(yè)界領(lǐng)先的容量擴(kuò)展至23億門。而Cadence也是首次在美國(guó)以外推出新品發(fā)布，其中包含的種種深意，也是值得好好探究一番…… 　　硬件仿真平臺(tái)發(fā)展的深意 　　隨著芯片設(shè)計(jì)的復(fù)雜度越來(lái)越高，驗(yàn)證工程師已經(jīng)不能高效地使用傳統(tǒng)RT
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Cadence宣布提供業(yè)界首款HDMI 2.0驗(yàn)證IP

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(納斯達(dá)克股票代碼：CDNS)日前宣布可提供業(yè)界首款支持全新HDMI 2.0規(guī)范的驗(yàn)證IP(VIP)。這款VIP使設(shè)計(jì)師們可以快速?gòu)氐椎仳?yàn)證其片上系統(tǒng)(SoC)是否符合HDMI 2.0規(guī)范，從而加速批量生產(chǎn)的準(zhǔn)備時(shí)間。
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TSMC和Cadence合作開發(fā)3D-IC參考流程以實(shí)現(xiàn)3D堆疊

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ：CDNS)日前宣布，臺(tái)積電與Cadence合作開發(fā)出了3D-IC參考流程，該流程帶有創(chuàng)新的真正3D堆疊。該流程通過(guò)基于Wide I/O接口的3D堆疊，在邏輯搭載存儲(chǔ)器設(shè)計(jì)上進(jìn)行了驗(yàn)證 ，可實(shí)現(xiàn)多塊模的整合。
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TSMC和Cadence合作開發(fā)3D-IC參考流程以實(shí)現(xiàn)真正的3D堆疊

  • 　　? 新參考流程增強(qiáng)了CoWoSTM (chip-on-wafer-on-substrate)芯片設(shè)計(jì) 　　? 使用帶3D堆疊的邏輯搭載存儲(chǔ)器進(jìn)行過(guò)流程驗(yàn)證 　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ：CDNS)今天宣布，臺(tái)積電與Cadence合作開發(fā)出了3D-IC參考流程，該流程帶有創(chuàng)新的真正3D堆疊。該流程通過(guò)基于Wide I/O接口的3D堆疊，在邏輯搭載存儲(chǔ)器設(shè)計(jì)上進(jìn)行了驗(yàn)證 ，可實(shí)現(xiàn)多塊模的整合。它將臺(tái)積電的3D堆疊技術(shù)和Cadence?3D-IC解決方案相結(jié)合，包
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Cadence混合信號(hào)流程幫助Silicon將新MCU功耗縮減一半

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)日前宣布，Silicon Labs采用完整的Cadence? 混合信號(hào)低功耗設(shè)計(jì)流程，使其最新款節(jié)能型基于ARM? 微控制器單元(MCU)的功耗大幅降低了50%。
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Cadence發(fā)表新一代驗(yàn)證運(yùn)算平臺(tái)

  • 　　為了讓半導(dǎo)體與系統(tǒng)制造廠商加快產(chǎn)品上市速度，益華電腦(Cadence Design Systems)發(fā)表Palladium XP II 驗(yàn)證運(yùn)算平臺(tái)，作為強(qiáng)化系統(tǒng)開發(fā)套裝不可或缺的一環(huán)，大幅加速軟硬體驗(yàn)證。 　　Palladium XP II 平臺(tái)建立在屢獲獎(jiǎng)項(xiàng)肯定的 Palladium XP 仿真技術(shù)基礎(chǔ)之上，提升驗(yàn)證效能達(dá)50%，并擴(kuò)展容量達(dá)23億邏輯閘。由于更低的功耗與更高的閘道密度，現(xiàn)在客戶能夠以更小的面積承載更大的資料量。Cadence益華電腦也擴(kuò)大支援8種全新行動(dòng)與消費(fèi)性通訊協(xié)定，加速模
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Cadence推出Palladium XP II 驗(yàn)證平臺(tái)和系統(tǒng)開發(fā)增強(qiáng)套件

  • 為了進(jìn)一步縮短半導(dǎo)體和系統(tǒng)制造商的產(chǎn)品上市時(shí)間，全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence 設(shè)計(jì)系統(tǒng)公司 (NASDAQ:CDNS) 日前推出 Palladium? XP II 驗(yàn)證計(jì)算平臺(tái)，它作為系統(tǒng)開發(fā)增強(qiáng)套件的一部分，可顯著加快硬件和軟件聯(lián)合驗(yàn)證的時(shí)間。
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ARM收購(gòu)Cadence顯示器IP

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS)與頂尖半導(dǎo)體IP供應(yīng)商ARM聯(lián)合宣布，雙方已經(jīng)簽署最終協(xié)議，Cadence同意出售PANTA顯示控制器內(nèi)核，并將技術(shù)轉(zhuǎn)讓給ARM。這份協(xié)議促進(jìn)了雙方的長(zhǎng)期生態(tài)系統(tǒng)合作，也強(qiáng)化了雙方的技術(shù)聯(lián)盟。
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Mellanox選擇Cadence縮短互聯(lián)產(chǎn)品開發(fā)時(shí)間

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS)日前宣布Mellanox Technologies 選擇Cadence? Palladium? XP Verification Computing Platform 用于其領(lǐng)先的服務(wù)器和存儲(chǔ)產(chǎn)品的開發(fā)，該公司是高性能、端到端互聯(lián)解決方案領(lǐng)先供應(yīng)商，其產(chǎn)品用于數(shù)據(jù)中心服務(wù)器和存儲(chǔ)系統(tǒng)。
  • 關(guān)鍵字： Cadence  Mellanox  Palladium  

Renesas獲得Cadence Tensilica ConnX D2 DSP授權(quán)

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS)日前宣布，Renesas Electronics Corporation已獲得Tensilica ConnX D2 DSP(數(shù)字信號(hào)處理器)的授權(quán)，用于設(shè)計(jì)面向物聯(lián)網(wǎng) (IoT) 應(yīng)用領(lǐng)域的下一代芯片。
  • 關(guān)鍵字： Renesas  Cadence  DSP  

中芯國(guó)際采用Cadence數(shù)字流程新增高級(jí)功能

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS) 與中芯國(guó)際集成電路制造有限公司(“中芯國(guó)際”，紐約證券交易所：SMI ，香港聯(lián)交所：981)，中國(guó)內(nèi)地規(guī)模最大、技術(shù)最先進(jìn)的集成電路晶圓代工企業(yè)，日前共同宣布中芯國(guó)際已采用Cadence? 數(shù)字工具流程，應(yīng)用于其新款SMIC Reference Flow 5.1，一款為低功耗設(shè)計(jì)的完整的RTL-GDSII 數(shù)字流程。
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Cadence布線常見問(wèn)題

  • 1. 怎樣建立自己的元件庫(kù)?建立了一個(gè)新的project后，畫原理圖的第一步就是先建立 自己所需要的庫(kù)，所采用的工具就是part developer. 首先在建立一個(gè)存放元件庫(kù)的目錄(如mylib)，然后用寫字板打開cds.lib，定義： De
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常見硬件設(shè)計(jì)EDA工具之比較

  • 項(xiàng)目中EDA工具是每個(gè)工程師必不可少的好幫手，大大加快了我們的設(shè)計(jì)進(jìn)程。每一位工程師都應(yīng)該掌握并熟練至少一種EDA工具的使用。在論壇里經(jīng)常能看到新手的經(jīng)典提問(wèn)：我應(yīng)該學(xué)習(xí)哪種畫圖工具呀?哪種畫圖工具更強(qiáng)大?哪種畫圖工具更好用?網(wǎng)上關(guān)于各種工具功能介紹的資料多如牛毛，EDA工具本身又包含很多版本和獨(dú)立功能的工具，初學(xué)者難免無(wú)所適從。
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Cadence將分別于9月10、12日在北京和上海舉辦CDNLive 2013用戶大會(huì)

  • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ:CDNS)將分別于9月10日、12日在北京金隅喜來(lái)登酒店和上海浦東嘉里大酒店舉辦“CDNLive用戶大會(huì)”。此會(huì)議集聚中國(guó)產(chǎn)業(yè)鏈高階主管、Cadence的技術(shù)使用者、開發(fā)者與業(yè)界專家，分享重要設(shè)計(jì)與驗(yàn)證問(wèn)題的解決經(jīng)驗(yàn)，并為實(shí)現(xiàn)高階芯片、SoC和系統(tǒng)、IP及工具的新技術(shù)發(fā)現(xiàn)新技術(shù)。
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華力微電子基于Cadence數(shù)字工具開發(fā)55納米參考設(shè)計(jì)流程

  • 　　Cadence設(shè)計(jì)系統(tǒng)公司與上海華力微電子有限公司，今天共同宣布華力微電子基于Cadence Encounter數(shù)字技術(shù)交付出55納米平臺(tái)的參考設(shè)計(jì)流程。從現(xiàn)在起，華力微電子首次在其已建立的55 納米工藝平臺(tái)上實(shí)現(xiàn)了從 RTL到GDSII的完整流程，它也是Cadence與上海華力緊密合作的結(jié)果。 　　在該流程中所使用的Cadence數(shù)字工具包括RTL Compiler、Encounter Digital Implementation 系統(tǒng)、Conformal LEC、QRC Extraction、E
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