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EEPW首頁 >> 主題列表 >> cpld-jtag接口

基于CPLD/FPGA的半整數(shù)分頻器的設計

  • 簡要介紹了CPLD/FPGA器件的特點和應用范圍，并以分頻比為2.5的半整數(shù)分頻器的設計為例，介紹了在MAX+plus II開發(fā)軟件下，利用VHDL硬件描述語言以及原理圖的輸入方式來設計數(shù)字邏輯電路的過程和方法。
  • 關(guān)鍵字： CPLD  FPGA  整數(shù)  分頻器    

零功耗超快速CPLD器件ispMACH4000Z及其應用

  • 介紹了萊迪思半導體公司推出的零功耗超快速復雜中編程邏輯器件ispMACH4000Z的特征、結(jié)構(gòu)和原理。
  • 關(guān)鍵字： ispMACH  4000Z  CPLD  4000    

用CPLD實現(xiàn)單片機讀寫模塊

  • 介紹實現(xiàn)單片機與Xilinx公司XC9500系列可編程邏輯器件的讀寫邏輯功能模塊的接口設計，以及Xilinx公司的XC9500系列可編程邏輯器件的開發(fā)流程。
  • 關(guān)鍵字： CPLD  單片機  讀寫模塊    

用CPLD控制曼徹斯特編解碼器

  • 討論如何使用CPLD實現(xiàn)單片機與曼徹斯特編解碼器的接口。
  • 關(guān)鍵字： CPLD  曼徹斯特  編解碼器    

CPLD器件在時間統(tǒng)一系統(tǒng)中的應用

CPLD在多路高速同步數(shù)據(jù)采集系統(tǒng)中的應用

  • 采用VHDL語言設計，用CPLD控制模/數(shù)轉(zhuǎn)換電路，完成多路模擬輸入的高速同步數(shù)/模轉(zhuǎn)，具有容錯和自檢能力。
  • 關(guān)鍵字： CPLD  多路  同步數(shù)據(jù)采集  系統(tǒng)    

I2C器件接口IP核的CPLD設計

  • 根據(jù)單片機I2C串行擴展的特點，在EDA軟件MaxplusII的環(huán)境下，利用AHDL語言，建立IP核。
  • 關(guān)鍵字： CPLD  I2C  器件  接口    

基于CPLD的高壓電力線FSK MODEM設計

  • 介紹應用CPLD實現(xiàn)非標準的FSK MODEM的設計方法；探討如何優(yōu)化算法和改良電路來減少系統(tǒng)的誤碼率，并給出應用電路。
  • 關(guān)鍵字： MODEM  設計  FSK  力線  CPLD  高壓電  基于  

一種基于CPLD的PWM控制電路設計

  • 介紹了利用硬件描述語言VHDL設計的一種基于CPLD的PWM控制電路。
  • 關(guān)鍵字： 電路設計  控制  PWM  CPLD  基于  

博物館智能防盜保護器系統(tǒng)設計

  • 摘    要：本設計的目的是實現(xiàn)博物館藏品防盜和保護的智能化。以微處理器為核心，利用美國國家半導體的彩色圖像傳感器LM9628和溫度傳感器LM19進行環(huán)境監(jiān)控，并控制報警系統(tǒng)和空調(diào)系統(tǒng)以及進行圖像處理。關(guān)鍵詞：圖像傳感器；溫度傳感器；AVR單片機；CPLD引言博物館內(nèi)的藏品常常受到人為盜竊的威脅，周圍環(huán)境的變化也會對其造成破壞，因此需要極為可靠的防盜系統(tǒng)及完善的空調(diào)系統(tǒng)，本設計的目的就是實現(xiàn)對館藏品的智能化防盜和保護。博物館關(guān)閉時便可將此防盜保護器啟動，通過CMOS傳感器對博
  • 關(guān)鍵字： AVR單片機  CPLD  圖像傳感器  溫度傳感器  

嵌入式同步時鐘系統(tǒng)的設計與實現(xiàn)

  • 摘    要：本文介紹了一種基于嵌入式微控制器MSP430構(gòu)建的嵌入式同步時鐘系統(tǒng)的設計與實現(xiàn)方案，在實現(xiàn)了網(wǎng)絡時鐘同步的基礎上又提供了方便易用的網(wǎng)絡管理接口。關(guān)鍵詞：同步時鐘；MSP430單片機；數(shù)字鎖相環(huán)；CPLD同步時鐘系統(tǒng)是同步設備中實現(xiàn)同步通信的核心，因此，要實現(xiàn)數(shù)字同步網(wǎng)的設備同步就要求同步時鐘系統(tǒng)一方面要能提供精確的定時同步，另一方面還要能方便實現(xiàn)網(wǎng)絡管理中心對同步時鐘的管理。本文詳細介紹了利用嵌入式微控制器MSP430單片機和數(shù)字鎖相環(huán)(DPLL)來實現(xiàn)嵌入式
  • 關(guān)鍵字： CPLD  MSP430單片機  數(shù)字鎖相環(huán)  同步時鐘  

嵌入式同步時鐘系統(tǒng)的設計與實現(xiàn)

  • 摘    要：本文介紹了一種基于嵌入式微控制器MSP430構(gòu)建的嵌入式同步時鐘系統(tǒng)的設計與實現(xiàn)方案，在實現(xiàn)了網(wǎng)絡時鐘同步的基礎上又提供了方便易用的網(wǎng)絡管理接口。關(guān)鍵詞：同步時鐘；MSP430單片機；數(shù)字鎖相環(huán)；CPLD同步時鐘系統(tǒng)是同步設備中實現(xiàn)同步通信的核心，因此，要實現(xiàn)數(shù)字同步網(wǎng)的設備同步就要求同步時鐘系統(tǒng)一方面要能提供精確的定時同步，另一方面還要能方便實現(xiàn)網(wǎng)絡管理中心對同步時鐘的管理。本文詳細介紹了利用嵌入式微控制器MSP430單片機和數(shù)字鎖相環(huán)(DPLL)來實現(xiàn)嵌入式
  • 關(guān)鍵字： CPLD  MSP430單片機  數(shù)字鎖相環(huán)  同步時鐘  

列車車載GPS智能里程表的網(wǎng)絡化設計

  • 摘    要：本文提出了采用基于GPS的行駛里程數(shù)據(jù)采集和通過網(wǎng)絡通信控制器WebChip進行網(wǎng)絡化數(shù)據(jù)管理的智能里程表設計,并給出了具體設計方案。關(guān)鍵詞：車輛管理；GPS；WebChip；CPLD引言在鐵路列車車輛管理過程中，對列車每一節(jié)車廂行駛里程的統(tǒng)計，是對車廂進行管理和維護的一個重要依據(jù)。因此，獲取精確的行駛里程對于鐵路系統(tǒng)的高效、安全運營無疑是非常重要的。計算行駛里程的傳統(tǒng)方法：一種是靠人工估計，費時費力且不夠準確；另一種是通過計算列車車輪行駛的距離，這種方法操作復
  • 關(guān)鍵字： CPLD  GPS  WebChip  車輛管理  

PCI總線至UTOPIA接口控制的CPLD設計實現(xiàn)

  • 摘   要： 本文采用Altera的CPLD實現(xiàn)了PCI總線至UTOPIA接口的邏輯轉(zhuǎn)換控制，為低成本實現(xiàn)ATM終端奠定了基礎。關(guān)鍵詞： CPLD ;   PCI總線 ; UTOPIA2總線引言  EDA技術(shù)憑借其高速、方便等特點而被廣泛應用于通信領域。本文采用Altera的CPLD實現(xiàn)了PCI總線至UTOPIA接口的邏輯轉(zhuǎn)換控制，該設計再配上ATM線路成幀部件即可成為基于個人電腦的ATM終端設備，從而改善因成本較高、市場需求不足等原因
  • 關(guān)鍵字： CPLD  PCI總線  UTOPIA2總線  

用CPLD和外部SRAM構(gòu)成大容量FIFO的設計

  • 摘要：對照一般通用FIFO的外部控制線，以及視頻服務器應用的具體要求，設計完成用CPLD和外部SRAM構(gòu)成的大容量、廉價、高速FIFO，除了可以滿足視頻服務器碼流緩沖的需要外，也可以作為一個通用的大容量FIFO。關(guān)鍵詞：視頻服務器、碼流平滑、FPGA/CPLD、FIFOThe design of FIFO consisted of CPLD and SRAMRen Sanjun Hu WenjieDSP Center of Institute of Acoustics, Chinese Academy
  • 關(guān)鍵字： 視頻服務器、碼流平滑、FPGA/CPLD、FIFO  存儲器  
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