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信號去直流方法

  • 本文介紹一種根據(jù)Xilinx FPGA中DSP48E1資源設(shè)計(jì)的去直流模塊,其基本原理采用一階濾波器,如圖1所示,通過一個一階RC電路,在V0端可等效一個低通濾波器,得到直流分量。
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用于實(shí)現(xiàn)嵌入式安全的開源硬件

  • 想像一下你正在排隊(duì)等待參加一個重要活動。門票是通過網(wǎng)上購買的,存儲在你的智能手機(jī)中。你需要將手機(jī)放到某個指定區(qū)域上,建立起NFC連接,門票隨之得到確認(rèn),大門開啟允許你進(jìn)入。好消息是,所有這一切都是在匿名情況下發(fā)生的。
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SOC設(shè)計(jì)流程及其集成開發(fā)環(huán)境

  • SOC技術(shù)是當(dāng)前大規(guī)模集成電路(VLSI)的發(fā)展趨勢,也是世紀(jì)集成電路技術(shù)的主流,其為集成電路產(chǎn)業(yè)和集成電路應(yīng)用技術(shù)提供了前所未有的廣闊市場和難得的發(fā)展機(jī)遇。SOC為微電子應(yīng)用產(chǎn)品研究、開發(fā)和生產(chǎn)提供了新型的優(yōu)秀的技術(shù)方法和工具,也是解決電子產(chǎn)品開發(fā)中的及時(shí)上市(TTM——Time to Market)的主要技術(shù)與方法。
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FPGA與多核CPU如何改變嵌入式設(shè)計(jì)

  • 隨著嵌入式器件在過去數(shù)十年來的爆炸性成長,使得硬件組件及軟件工具都有顯著的改善。雖然有著這種成長與創(chuàng)新,但傳統(tǒng)嵌入式系統(tǒng)的設(shè)計(jì)方法卻少有進(jìn)步,并逐漸變成一種障礙。有鑒于新標(biāo)準(zhǔn)與協(xié)議的快速發(fā)展,以及對產(chǎn)品上市壓力的日益增加,嵌入式系統(tǒng)設(shè)計(jì)也即將發(fā)生顛覆性的典范改變。隨著硬件技術(shù)及軟件工具的進(jìn)步在加速成長,由整合所帶來的挑戰(zhàn)也
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高速PCI信號采集卡設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之: 產(chǎn)品定型和設(shè)計(jì)文檔備案

  • 產(chǎn)品的定型包括系統(tǒng)的基本組成、基本配置及互聯(lián)方法,運(yùn)行環(huán)境,硬件整體系統(tǒng)及各分系統(tǒng)的基本功能和主要性能指標(biāo),功能模塊的劃分,關(guān)鍵技術(shù)的使用,采購的硬件器件名稱型號、生產(chǎn)單位、主要技術(shù)指標(biāo),主要儀器設(shè)備,電源、工藝結(jié)構(gòu)設(shè)計(jì)等。
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高速PCI信號采集卡設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之:產(chǎn)品穩(wěn)定性和可靠性測試

  • 完成一個產(chǎn)品的設(shè)計(jì)后和初步調(diào)試后,就可以對產(chǎn)品進(jìn)行完整的測試流程。一般來說,對產(chǎn)品需要進(jìn)行下面一些測試,通過測試后才能對產(chǎn)品的穩(wěn)定性和可靠性得出一個結(jié)論。
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高速PCI信號采集卡設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之:樣機(jī)的調(diào)試方法和技巧

  • 不管是復(fù)雜的電子系統(tǒng)還是簡單的電路,樣機(jī)的調(diào)試都是有一些基本步驟的。對于本案例的信號采集設(shè)備同樣如此。最先進(jìn)行的就是電源系統(tǒng)的調(diào)試,包括是否有短路、斷路,是否有虛焊,各電壓系統(tǒng)是否正常,電源模塊輸出電流是否足夠驅(qū)動負(fù)載等。只有電源系統(tǒng)正常工作,才能談得上實(shí)現(xiàn)系統(tǒng)功能。
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高速PCI信號采集卡設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之:硬件系統(tǒng)實(shí)現(xiàn)

  • FPGA作可編程器件,可以根據(jù)用戶的需要進(jìn)行現(xiàn)場可編程。為此,本系統(tǒng)實(shí)現(xiàn)了兩種編程配置方式。一種是直接對FPGA進(jìn)行編程,使用JTAG模式,在QuartusII 工具中輸出SOF文件(SRAM Object File)。其好處是編程速度快,并且由于是對FPGA的SRAM結(jié)構(gòu)進(jìn)行編程,編程次數(shù)要多得多,但是掉電后,SRAM保存的編程信息
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高速PCI信號采集卡設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之: FPGA內(nèi)部結(jié)構(gòu)設(shè)計(jì)

高速PCI信號采集卡設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之:主機(jī)應(yīng)用程序和驅(qū)動程序的接口設(shè)計(jì)

  • 通過調(diào)用PCI設(shè)備驅(qū)動程序的例程,我們可以實(shí)現(xiàn)操作系統(tǒng)對PCI設(shè)備的控制。但是直接調(diào)用例程進(jìn)行編程往往顯得不夠直接,也不具有足夠的針對性。因此在高級語言里面對PCI設(shè)備或者信號采集設(shè)備的控制,往往是調(diào)用已經(jīng)封裝過的例程。
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一種使用USB對ADSP_TS101S進(jìn)行鏈路口加載的方案

  • 在DSP系統(tǒng)上運(yùn)行的程序,系統(tǒng)上電復(fù)位后需要加載程序到DSP的程序存儲器內(nèi)。這是使用外部加載模式時(shí)的系統(tǒng)開發(fā)不可缺少的環(huán)節(jié)。針對實(shí)際需求,提出了一種使用USB對ADSP_TS101S進(jìn)行鏈路口加載的方案,并介紹了設(shè)計(jì)思想和實(shí)現(xiàn)過程。實(shí)際應(yīng)用的試驗(yàn)證明,提出的加載方案有效且簡單易行。
  • 關(guān)鍵字: FIFO  程序固化  FPGA  

高速PCI信號采集卡設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之:PCI卡的驅(qū)動程序設(shè)計(jì)

  • 設(shè)計(jì)完成的信號采集設(shè)備在插入計(jì)算機(jī)后,在對其進(jìn)行控制之前,需要編寫基于操作系統(tǒng)平臺上的驅(qū)動程序。設(shè)備驅(qū)動程序是一個包含了許多操作系統(tǒng)可調(diào)用例程的容器,這些例程可以使硬件設(shè)備執(zhí)行相應(yīng)的動作,它是硬件與上層軟件之間溝通的橋梁。
  • 關(guān)鍵字: 高速PCI信號采集卡  驅(qū)動程序  WDM驅(qū)動程序  過濾驅(qū)動程序  FPGA  

高速PCI信號采集卡設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之:系統(tǒng)工作原理分析

  • 如前所述,一個完整的信號采集系統(tǒng),除了具備信號輸入單元、信號處理單元和信號輸出單元外,還需要緩沖區(qū)、時(shí)鐘以及電源等相關(guān)系統(tǒng)。如圖13.2所示是本案例信號采集系統(tǒng)的結(jié)構(gòu)框圖。
  • 關(guān)鍵字: 高速PCI信號采集卡  數(shù)據(jù)總線  控制總線  地址總線  FPGA  

利用FPGA實(shí)現(xiàn)外設(shè)通信接口之:利用FPGA實(shí)現(xiàn)RS-232C串行接口

  • RS-232C標(biāo)準(zhǔn)最初是為遠(yuǎn)程通信連接數(shù)據(jù)終端設(shè)備DTE(Data Terminal Equipment)與數(shù)據(jù)通信設(shè)備DCE(Data Communication Equipment)而制定的。因此這個標(biāo)準(zhǔn)的制定,并未考慮計(jì)算機(jī)系統(tǒng)的應(yīng)用要求。
  • 關(guān)鍵字: RS-232C串行接口  UART  FPGA  

數(shù)字圖像倍焦系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之:FPGA在其他視頻和圖像處理系統(tǒng)中的應(yīng)用

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