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EEPW首頁 >> 主題列表 >> fpga soc

報告:半導(dǎo)體IP市場價值到2023年將達6.22萬億美元

  •   根據(jù)新的研究報告“IP設(shè)計IP(IP處理器IP,接口IP,內(nèi)存IP)”顯示,半導(dǎo)體知識產(chǎn)權(quán)市場預(yù)計到2023年將達到6.22萬億美元,2017 - 2023年之間的復(fù)合年增長率為4.87% 。驅(qū)動這個市場的主要因素包括消費電子行業(yè)的多核技術(shù)的進步,以及對現(xiàn)代SoC設(shè)計的需求增加,導(dǎo)致市場增長,以及對連接設(shè)備的需求也不斷增長。   消費電子在預(yù)測期間占據(jù)半導(dǎo)體IP市場的最大份額   各地區(qū)消費電子產(chǎn)品的使用量的增加正在推動消費電子行業(yè)半導(dǎo)體IP市場的增長。此外,APAC和Ro
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基于SoC的雙目視覺ADAS解決方案

  • 基于SoC的雙目視覺ADAS解決方案-相比于單目視覺,雙目視覺(Stereo Vision)的關(guān)鍵區(qū)別在于可以利用雙攝像頭從不同角度對同一目標成像,從而獲取視差信息,推算目標距離。
  • 關(guān)鍵字: cpu  soc  恩智浦  

相比GPU和GPP,F(xiàn)PGA是深度學(xué)習的未來?

  • 相比GPU和GPP,F(xiàn)PGA是深度學(xué)習的未來?-相比GPU和GPP,F(xiàn)PGA在滿足深度學(xué)習的硬件需求上提供了具有吸引力的替代方案。憑借流水線并行計算的能力和高效的能耗,F(xiàn)PGA將在一般的深度學(xué)習應(yīng)用中展現(xiàn)GPU和GPP所沒有的獨特優(yōu)勢。同時,算法設(shè)計工具日漸成熟,如今將FPGA集成到常用的深度學(xué)習框架已成為可能。未來,F(xiàn)PGA將有效地適應(yīng)深度學(xué)習的發(fā)展趨勢,從架構(gòu)上確保相關(guān)應(yīng)用和研究能夠自由實現(xiàn)。
  • 關(guān)鍵字: 機器學(xué)習  FPGA  GPU  GPP  

基于FPGA加速機器學(xué)習算法

  • 基于FPGA加速機器學(xué)習算法-AI因為其CNN(卷積神經(jīng)網(wǎng)絡(luò))算法出色的表現(xiàn)在圖像識別領(lǐng)域占有舉足輕重的地位?;镜腃NN算法需要大量的計算和數(shù)據(jù)重用,非常適合使用FPGA來實現(xiàn)。上個月,Ralph Wittig(Xilinx CTO Office的卓越工程師) 在2016年OpenPower峰會上發(fā)表了約20分鐘時長的演講并討論了包括清華大學(xué)在內(nèi)的中國各大學(xué)研究CNN的一些成果。
  • 關(guān)鍵字: 機器學(xué)習  FPGA  

工程師必須要知道的FPGA引腳信號分配原則

  • 工程師必須要知道的FPGA引腳信號分配原則-現(xiàn)在的FPGA向引腳分配信號的任務(wù)曾經(jīng)很簡單,現(xiàn)在也變得相當繁復(fù)。
  • 關(guān)鍵字: FPGA  FPGA引腳  

剖析FPGA在汽車系統(tǒng)設(shè)計中的關(guān)鍵作用

  • 剖析FPGA在汽車系統(tǒng)設(shè)計中的關(guān)鍵作用-選擇不同的微控制器系列時,軟件的兼容性是主要的障礙。大多數(shù)公司在軟件的開發(fā)、測試和驗證方面已經(jīng)進行了大量的投入。因此,將設(shè)計轉(zhuǎn)換到一個新的架構(gòu)時,通常需要復(fù)雜且代價高昂的軟件移植。
  • 關(guān)鍵字: FPGA  汽車電子  微控制器  

如何用單個賽靈思FPGA數(shù)字化數(shù)百個信號

  • 如何用單個賽靈思FPGA數(shù)字化數(shù)百個信號-  在新型賽靈思 FPGA 上使用低電壓差分信號(LVDS),只需一個電阻和一個電容就能夠數(shù)字化輸入信號。由于目前這一代賽靈思器件上提供有數(shù)百個 LVDS 輸入,理論上使用單個 FPGA 就能夠數(shù)字化數(shù)百個模擬信號。
  • 關(guān)鍵字: 賽靈思  FPGA  LVDS  

工程師談FPGA時序約束七步法

  • 工程師談FPGA時序約束七步法-時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但這還不是最完整的時序約束。
  • 關(guān)鍵字: FPGA  PCB  接口電路  

FMC+ 標準將嵌入式設(shè)計推到全新的高度

  • FMC+ 標準將嵌入式設(shè)計推到全新的高度-更新后的 FPGA 夾層卡規(guī)范提供無與倫比的高 I/O 密度、向后兼容性。
  • 關(guān)鍵字: 嵌入式  FPGA  

如何擴展 FPGA 的工作溫度范圍

  • 如何擴展 FPGA 的工作溫度范圍-  任何電子器件的使用壽命均取決于其工作溫度。在較高溫度下器件會加快老化,使用壽命會縮短。但某些應(yīng)用要求電子產(chǎn)品工作在器件最大額定工作結(jié)溫下。以石油天然氣產(chǎn)業(yè)為例來說明這個問題以及解決方案。
  • 關(guān)鍵字: 賽靈思  XA6SLX45  FPGA  

一文讀懂SIP與SOC封裝技術(shù)

  • 一文讀懂SIP與SOC封裝技術(shù)-從集成度而言,一般情況下, SOC 只集成 AP 之類的邏輯系統(tǒng),而 SIP 集成了AP+mobileDDR,某種程度上說 SIP=SOC+DDR,隨著將來集成度越來越高, emmc也很有可能會集成到 SIP 中。從封裝發(fā)展的角度來看,因電子產(chǎn)品在體積、處理速度或電性特性各方面的需求考量下, SOC 曾經(jīng)被確立為未來電子產(chǎn)品設(shè)計的關(guān)鍵與發(fā)展方向。但隨著近年來 SOC生產(chǎn)成本越來越高,頻頻遭遇技術(shù)障礙,造成 SOC 的發(fā)展面臨瓶頸,進而使 SIP 的發(fā)展越來越被業(yè)界重視。
  • 關(guān)鍵字: SIP  SOC  applewatch  摩爾定律  

如何使用FPGA加速機器學(xué)習算法

  • 如何使用FPGA加速機器學(xué)習算法-  當前,AI因為其CNN(卷積神經(jīng)網(wǎng)絡(luò))算法出色的表現(xiàn)在圖像識別領(lǐng)域占有舉足輕重的地位?;镜腃NN算法需要大量的計算和數(shù)據(jù)重用,非常適合使用FPGA來實現(xiàn)。上個月,Ralph Wittig(Xilinx CTO Office的卓越工程師)在2016年OpenPower峰會上發(fā)表了約20分鐘時長的演講并討論了包括清華大學(xué)在內(nèi)的中國各大學(xué)研究CNN的一些成果。
  • 關(guān)鍵字: FPGA  GPU  AuvizDNN  

基于ARM和FPGA的多路電機控制方案

  • 基于ARM和FPGA的多路電機控制方案-專用控制器由ARM(LPC2214)、FPGA(EP2C5T144C8)、驅(qū)動器接口電路、編碼器接口電路、限位檢測電路和電源電路等組成,ARM通過串口實現(xiàn)與上位機之間的通信,解析從上位機獲得的控制指令,并通過FPGA產(chǎn)生相應(yīng)輸出信號給驅(qū)動器接口,驅(qū)動器接口外接驅(qū)動器。
  • 關(guān)鍵字: arm  fpga  電機控制  

詳解FPGA開發(fā)流程中每一環(huán)節(jié)的物理含義和實現(xiàn)目標

  • 詳解FPGA開發(fā)流程中每一環(huán)節(jié)的物理含義和實現(xiàn)目標-FPGA的開發(fā)流程是遵循著ASIC的開發(fā)流程發(fā)展的,發(fā)展到目前為止,F(xiàn)PGA的開發(fā)流程總體按照圖1進行,有些步驟可能由于其在當前項目中的條件的寬度的允許,可以免去,比如靜態(tài)仿真過程,這樣來達到項目時間上的優(yōu)勢。
  • 關(guān)鍵字: FPGA  

FinFET存儲器的設(shè)計挑戰(zhàn)以及測試和修復(fù)方法

  • FinFET存儲器的設(shè)計挑戰(zhàn)以及測試和修復(fù)方法-現(xiàn)在,隨著FinFET存儲器的出現(xiàn),需要克服更多的挑戰(zhàn)。這份白皮書涵蓋:FinFET存儲器帶來的新的設(shè)計復(fù)雜性、缺陷覆蓋和良率挑戰(zhàn);怎樣綜合測試算法以檢測和診斷FinFET存儲器具體缺陷;如何通過內(nèi)建自測試(BIST)基礎(chǔ)架構(gòu)與高效測試和維修能力的結(jié)合來幫助保證FinFET存儲器的高良率。
  • 關(guān)鍵字: FinFET存儲器  SoC  STAR存儲器  
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