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FPGA效能大躍進的秘密

  • 效能提升，功耗降低，面積變小，幾者能否兼得。
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ARM吳雄昂：物聯(lián)網(wǎng)需要開放的生態(tài)系統(tǒng)

  • 　　在物聯(lián)網(wǎng)、智能硬件、可穿戴設(shè)備概念盛行的當下，產(chǎn)業(yè)鏈上游的半導體界也在風口挺進新技術(shù)的生態(tài)布局。 　　6月初，Intel宣布以167億美元重金收購可編輯邏輯芯片公司Altera，增強其數(shù)據(jù)中心和物聯(lián)網(wǎng)業(yè)務; 5月28日，Avago Technologies以370億美元收購wifi芯片供應商Broadcom，亦有意進軍物聯(lián)網(wǎng)和可穿戴設(shè)備。 　　不難發(fā)現(xiàn)，在物聯(lián)網(wǎng)和服務器領(lǐng)域，各種布局正拉開序幕。去年，ARM宣布推出mbed物聯(lián)網(wǎng)設(shè)備平臺，同年，英特爾也推出了英特爾物聯(lián)網(wǎng)平臺，兩者的目的都是為用戶提
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工業(yè)馬達引動芯片架構(gòu)之爭，ARM陣營漸成市場主流

  • 工業(yè)馬達需求甚廣，間接帶動馬達控制芯片大發(fā)展，控制芯片三劍客：FPGA，MCU，DSP。。。
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混合信號IC──復雜電源管理組件的設(shè)計挑戰(zhàn)及解決方案

  • 　　隨著系統(tǒng)內(nèi)電源數(shù)量的增多，為了確保其安全、經(jīng)濟、持續(xù)和正常的工作，對電源軌進行監(jiān)測和控制變得非常重要，特別是在使用微處理器時。確定電壓軌是否處于工作范圍內(nèi)，以及該電壓相對于其它電壓軌是否按照正確的時序上電或斷電，這些對于系統(tǒng)執(zhí)行的可靠性和安全性來說都是至關(guān)重要的。例如FPGA，在向組件提供5V I/O(輸入/輸出)電壓之前，必須先施加3.3V的核心電壓，并持續(xù)至少20ms，以避免組件上電時受到損壞。對于系統(tǒng)的可靠性來說，滿足這樣的時序要求就像要保證組件在規(guī)定的電源電壓和溫度范圍內(nèi)工作一樣至關(guān)重要。
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混合信號FPGA實現(xiàn)真正單芯片SOC

  • 　　要實現(xiàn)能夠?qū)⑺兄匾δ芗稍趩我黄骷脑O(shè)計理由很簡單，因為這樣就能將材料成本、部件庫存及電路板面積減至最低。另外，相較于多芯片解決方案，單芯片方案的功耗也較低，同時也有助于提高對知識產(chǎn)權(quán)的保護。如果一項設(shè)計功能的精髓能夠深植于單一芯片上，將會大大增加第三方取得這項設(shè)計的困難度。 　　單芯片系統(tǒng)對嵌入式系統(tǒng)設(shè)計師來說，往往會隨著其面對的不同的系統(tǒng)設(shè)計而各有不同。例如，在龐大的娛樂或通信消費產(chǎn)品市場中，SoC意味著一顆具有數(shù)百萬邏輯門的集成電路(IC)，其中包含許多大型定制邏輯模塊，并有將芯片的數(shù)字處
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Mentor Graphics 宣布推出旨在提升測試平臺效率的 EZ-VIP 包

  • 　　Mentor Graphics公司今天宣布即時推出 EZ-VIP 效率包。該效率包面向使用 Questa® Verification IP (QVIP) 的 ASIC 和 FPGA 驗證團隊，可將創(chuàng)建、實例化、配置和連接 QVIP 測試平臺的時間縮短 5 倍以上，從而顯著提高效率。這就意味著，驗證團隊可以將更多的時間花在 QVIP 上，以驗證他們的設(shè)計在功能上是否正確。 　　EZ-VIP 包由 QVIP 配置軟件、一個 VIP 調(diào)通服務包和一個全新的 EZ-VIP API 組成。其中，QVI
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超低功耗STM32L4 MCU詮釋性價比新極限

  • 　　32位MCU已經(jīng)成為市場的主流，特別是部分32位MCU的功耗已經(jīng)降到和8位MCU接近的地步，更加速了對8位MCU的替代步伐。不過，鑒于市場上絕大多數(shù)低功耗32位MCU都是基于ARM Cortex-M0(+)內(nèi)核，所以功耗是降下來了了，但性能上還達不到主流32位的性能。為此意法半導體近日發(fā)布了基于ARM® Cortex®-M4內(nèi)核的低功耗STM32L4系列微控制器，以接近STM32L0系列的功耗水平，提供M4內(nèi)核的高性能，非常適合節(jié)能型消費電子產(chǎn)品、工業(yè)、醫(yī)學和計量產(chǎn)品的需求。 　　兩
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【從零開始走進FPGA】 玩轉(zhuǎn)VGA

  • 　　一、VGA的誘惑 　　首先，VGA的驅(qū)動，這事，一般的單片機是辦不到的;由于FPGA的速度，以及并行的優(yōu)勢，加上可現(xiàn)場配置的優(yōu)勢，VGA的配置，只有俺們FPGA可以勝任，也只有FPGA可以隨心所欲地配置(當然ARM也可以，應用比較高吧)。 　　初學者就是喜歡看炫的效果，往往會忍不住想玩。尤其玩FPGA的，沒玩VGA就感到跟單片機沒啥提升，因此VGA的驅(qū)動也不得不講。Bingo當年也是如此。擋不住VGA的誘惑，初學者問Bingo VGA問題的人也是灰常的多，也許一般教科書理論太強，實際應用不是很身后
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英特爾收購阿爾特拉，發(fā)布向GPU的宣戰(zhàn)宣言——新FPGA

  • 看起來效率提升了兩倍，很強大的樣子。
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Altera宣布Stratix 10的創(chuàng)新全面刷新高端FPGA和SoC業(yè)界性能指標記錄

  • 　　Altera公司今天發(fā)布其Stratix® 10 FPGA和SoC體系結(jié)構(gòu)和產(chǎn)品細節(jié)，這一下一代高端可編程邏輯器件在性能、集成度、密度和安全特性方面實現(xiàn)全面突破，勢必將云時代的網(wǎng)絡(luò)通信技術(shù)推向又一個巔峰。 　　Stratix 10 FPGA和SoC采用了Altera革命性的HyperFlex™ FPGA架構(gòu)，由Intel® 14 nm三柵極工藝技術(shù)制造，內(nèi)核性能是前一代FPGA的2倍。業(yè)界性能最好、密度最高、具有先進的嵌入式處理功能的FPGA與GPU級別浮點計算性能和異構(gòu)
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FPGA開發(fā)外設(shè)子板模塊電路設(shè)計詳解

  • 　　FPGA(Field-Programmable Gate Array)，即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。FPGA的開發(fā)相對于傳統(tǒng)PC、單片機的開發(fā)有很大不同。FPGA以并行運算為主，以硬件描述語言來實現(xiàn);相比于PC或單片機(無論是馮諾依曼結(jié)構(gòu)還是哈佛結(jié)構(gòu))的順序操作有很大區(qū)別，也造成了FPGA開發(fā)入門較難。目前國內(nèi)有專
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三星和ARM簽署長期合作協(xié)議 授權(quán)使用下一代Mali圖形技術(shù)

  • 　　ARM和三星今日簽署了長期圖形圖像技術(shù)合作協(xié)議，意味著三星已經(jīng)獲得了ARM最新和最強悍的圖形技術(shù)來驅(qū)動未來設(shè)備發(fā)展，甚至承諾將會帶來更令人印象深刻和身臨其境的視覺體驗。協(xié)議認證涵蓋ARM最新Mali圖形處理單元，包括Mali-T820/T830/T860/旗艦T880和未來的Mali GPU。 　　   　　三星長期使用ARM公司GPU技術(shù)和認證CPU設(shè)計來幫助創(chuàng)建量產(chǎn)一系列移動處理器。公司最近推出的Exynos 7420芯片就搭載了高端的ARM Mali-T760 MP8 GPU
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基于FPGA的915MHz射頻讀卡器設(shè)計

  • 　　射頻識別(RFID)技術(shù)是一種非接觸式的自動識別技術(shù)，通過射頻信號自動識別目標對象并獲取相關(guān)信息。通常RFID系統(tǒng)主要由應用軟件、射頻卡以及讀卡器三部分構(gòu)成[1]。相對于低頻段的RFID系統(tǒng)，工作在860 MHz～960 MHz的超高頻段(UHF)RFID系統(tǒng)有著讀取距離遠、閱讀速度快等優(yōu)點，是目前國際上RFID技術(shù)發(fā)展的熱點[2]。讀卡器的設(shè)計是RFID系統(tǒng)設(shè)計中的關(guān)鍵部分，設(shè)計方案有很多種。FPGA[3]具有開發(fā)簡單、靜態(tài)可重復編程和動態(tài)在線編程的特點，已經(jīng)成為當今應用最廣泛的可編程專用集成電路。
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FPGA的系統(tǒng)架構(gòu)組成和器件互聯(lián)問題

  • 　　通常來講，“一個好漢三個幫”，一個完整的嵌入式系統(tǒng)中由單獨一個FPGA使用的情況較少。通常由多個器件組合完成，例如由一個FPGA+CPU來構(gòu)成。通常為一個FPGA+ARM，ARM負責軟件配置管理，界面輸入外設(shè)操作等操作，F(xiàn)PGA負責大數(shù)據(jù)量運算，可以看做CPU的專用協(xié)處理器來使用，也常會用于擴展外部接口。常用的有ARM+FPGA，DSP+FPGA，或者網(wǎng)絡(luò)處理器+FPGA等種種架構(gòu)形式，這些架構(gòu)形式構(gòu)成整個高速嵌入式設(shè)備的處理形態(tài)。 　　不得不說的是，隨著技術(shù)的進步，現(xiàn)在CP
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從數(shù)字PWM信號獲得準確、快速穩(wěn)定的模擬電壓

  • 　　引言 　　脈寬調(diào)制(PWM)是從微控制器或FPGA等數(shù)字器件產(chǎn)生模擬電壓的一種常用方法。大多數(shù)微控制器都具有內(nèi)置的專用PWM產(chǎn)生外設(shè)，而且其僅需幾行RTL代碼即可從FPGA產(chǎn)生一個PWM信號。如果模擬信號的性能要求不是太嚴格，那么這就是一種簡單和實用的方法，因為它只需要一個輸出引腳，而且與具有一個SPI或I2C接口的數(shù)模轉(zhuǎn)換器(DAC)相比，其代碼開銷是非常低。圖1示出了一款典型應用，其采用一個經(jīng)濾波的數(shù)字輸出引腳來產(chǎn)生一個模擬電壓。 　　該方案的諸多不足之處您不必深究就能發(fā)現(xiàn)。理想情況下，一個1
  • 關(guān)鍵字： PWM  FPGA  
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