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零基礎(chǔ)學(xué)FPGA （二十三） SDR SDRAM（架構(gòu)篇）

　　今天我們來講的是SDRAM的架構(gòu)以及設(shè)計(jì)，這也是小墨第一次接觸架構(gòu)，也談不上給大家講，就是把我理解的當(dāng)做一個(gè)筆記分享給大家，有什么錯(cuò)誤也請(qǐng)積極指正，畢竟我也是沒有老師教，也是自己摸索的，難免有些不合理的地方。　　一、SDRAM 工作部分　　1、上電初始化　　　　我們先來看第一部分，上電初始化。上電初始化我們知道，上電之后我們需要等待200us的穩(wěn)定期，這段時(shí)間我們可以用一個(gè)定時(shí)器來計(jì)數(shù)，這沒什么問題，然后進(jìn)入的是預(yù)充電部分，這個(gè)時(shí)候，預(yù)充電的時(shí)候，sdram_cmd
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讓機(jī)器人眼明腦快的奧秘：嵌入式視覺系統(tǒng)

新一代工業(yè)機(jī)器人的核心特征是智能化，實(shí)現(xiàn)工業(yè)機(jī)器人智能化，就必須讓機(jī)器人擁有明亮的“雙眸”和靈活的“大腦”。
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英特爾的下一步：整合處理器核心與FPGA

　　自今年六月一號(hào)，英特爾宣布并購(gòu)Altera后，雙方對(duì)于并購(gòu)訊息就未再透露更多的訊息。不過，針對(duì)此點(diǎn)，Altera亞太區(qū)副總裁暨董事總經(jīng)理莊秉翰引述英特爾所發(fā)布的公開訊息，也約略點(diǎn)出了英特爾并購(gòu)Altera后的未來發(fā)展方向。　　莊秉翰談到，眾所皆知，摩爾定律是由英特爾創(chuàng)辦人所創(chuàng)，截至目前為止，英特爾仍然認(rèn)為摩爾定律仍然適用于半導(dǎo)體產(chǎn)業(yè)，同樣的，Altera也有相同的看法。此外，英特爾也認(rèn)為，并購(gòu)Altera再整合自身旗下的IP等技術(shù)方案，可以創(chuàng)造出新一代的產(chǎn)品陣容，以滿足資料中心與物聯(lián)網(wǎng)的客戶群。
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零基礎(chǔ)學(xué)FPGA （二十二） SDR SDRAM（理論篇）

　　其實(shí)說實(shí)話這一個(gè)月來也沒怎么看新知識(shí)，大體梳理了一下以前學(xué)過的知識(shí)，回顧了一下SOPC的學(xué)習(xí)。對(duì)于SOPC的學(xué)習(xí)我打算暫時(shí)先放一放，因?yàn)榍懊孢€有一個(gè)要寫的沒有完成，也是一直以來無法寫起的一個(gè)題目，就是今天我們要寫的SDRAM的操作。等寫完這個(gè)，我們?cè)倩氐絊OPC，帶領(lǐng)大家調(diào)USB2.0! 　　由于SDRAM本身就是一個(gè)比較復(fù)雜的東西，之前小墨在學(xué)這方面東西的時(shí)候感覺很是吃力，于是那時(shí)候便暫時(shí)放下了，知道年后這段時(shí)間，小墨又重新拾起這個(gè)知識(shí)點(diǎn)，想要一口氣把它調(diào)通了，再往下看其他的東西。學(xué)SDRAM，理
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小梅哥和你一起深入學(xué)習(xí)FPGA之DAC驅(qū)動(dòng)

　　本實(shí)驗(yàn)中，我們使用FPGA來驅(qū)動(dòng)了一片DAC芯片TLC5620，該芯片的特性如下所示：　　TLC5620特性：　　4路8位電壓輸出; 　　單電源5V供電; 　　串行接口; 　　參考電壓輸入高阻; 　　可編程的1次或2次輸出范圍; 　　同時(shí)更新的能力; 　　內(nèi)部自帶上電復(fù)位功能; 　　低功耗; 　　半緩沖輸出。　　小梅哥設(shè)計(jì)的該芯片的驅(qū)動(dòng)模塊的接口如下所示：　　　　各個(gè)端口定義如下：　　以下是代碼片段：　　input Clk; 　　inp
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Altera FPGA為RICOH SP 3600DN系列新打印機(jī)提供支持

　　Altera公司今天宣布，總部位于東京，專注于提供圖像設(shè)備和制片打印解決方案、文檔管理系統(tǒng)以及IT服務(wù)的全球技術(shù)公司Ricoh集團(tuán)選擇了Altera Cyclone® IV FPGA來支持其最新推出的打印機(jī)產(chǎn)品線——RICOH SP 3600DN系列。Altera的Cyclone IV FPGA為RICOH SP 3600系列打印機(jī)的圖像處理功能提供支持，實(shí)現(xiàn)了1200 dpi圖像質(zhì)量、串行打印速度和高速打印速度等新特性。此外，Cyclone IV FPGA還幫助Ric
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兩種基于FPGA的軟件濾波方法

　　基于FPGA的軟件濾波算法設(shè)計(jì)及實(shí)現(xiàn) 　　隨著數(shù)字電子技術(shù)的發(fā)展，數(shù)字電路已由早期的分立元件逐漸發(fā)展成集成電路，對(duì)電路設(shè)計(jì)的要求越來越高。尤其是可編程邏輯器件的出現(xiàn)，使得以硬件為載體、以計(jì)算機(jī)軟件為開發(fā)環(huán)境的現(xiàn)代數(shù)字系統(tǒng)的設(shè)計(jì)方法日趨成熟?？删幊踢壿嬈骷O(shè)計(jì)靈活、功能強(qiáng)大、可在線修改、效率高等優(yōu)點(diǎn)深受廣大電子設(shè)計(jì)人員青睞。目前，大多數(shù)現(xiàn)場(chǎng)可編程邏輯陣列( FPGA)芯片是電壓敏感型芯片，基于可重構(gòu)CMOS-SRAM單元結(jié)構(gòu)，數(shù)據(jù)具有易失性，工作在低電壓狀態(tài)，易受干擾，尤其在工控、軍用場(chǎng)合，外界電磁環(huán)
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如何用賽靈思FPGA實(shí)現(xiàn)4G無線球形檢測(cè)器

　　MIMO無線系統(tǒng)最佳硬判決檢測(cè)方式是最大似然(ML)檢測(cè)器。ML檢測(cè)因?yàn)楸忍卣`碼率 (BER)性能出眾，非常受歡迎。不過，直接實(shí)施的復(fù)雜性會(huì)隨著天線和調(diào)制方案的增加呈指數(shù)級(jí)增強(qiáng)，使ASIC或FPGA僅能用于使用少數(shù)天線的低密度調(diào)制方案。　　WiMAX對(duì)寬帶互聯(lián)網(wǎng)接入如同手機(jī)對(duì)語(yǔ)音通信一樣意義非凡。它可以取代DSL和有線服務(wù)，隨時(shí)隨地提供互聯(lián)網(wǎng)接入。只需要打開計(jì)算機(jī)，連接到最近的WiMAX天線，就可以暢游全世界的網(wǎng)絡(luò)了。　　寬帶互聯(lián)網(wǎng)接入遇到的最大挑戰(zhàn)之一就是移動(dòng)性，而這正是最新的WiMAX標(biāo)準(zhǔn)
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美高森美推出汽車等級(jí)SoC FPGA和FPGA器件

　　致力于在電源、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation) 宣布提供全新汽車等級(jí)現(xiàn)場(chǎng)可編程門陣列(FPGA)和系統(tǒng)級(jí)芯片(SoC) FPGA器件?；陂W存的下一代低功率 FPGA和ARM® Cortex®-M3使能SoC FPGA器件已經(jīng)獲得AEC-Q100等級(jí)2認(rèn)證，這是概述電子元器件標(biāo)準(zhǔn)以期確保最終系統(tǒng)可滿足汽車可靠性水平要求的行業(yè)標(biāo)準(zhǔn)規(guī)范。新的汽車等級(jí)合格 SmartFusion®2和 IGLOO&re
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FPGA+CPU：并行處理大行其道

　　深亞微米時(shí)代，傳統(tǒng)材料、結(jié)構(gòu)乃至工藝都在趨于極限狀態(tài)，摩爾定律也已有些捉襟見肘。而步入深亞納米時(shí)代，晶體管的尺寸就將接近單個(gè)原子，無法再往下縮減。傳統(tǒng)ASIC和ASSP設(shè)計(jì)不可避免地遭遇了諸如設(shè)計(jì)流程復(fù)雜、生產(chǎn)良率降低、設(shè)計(jì)周期過長(zhǎng)，研發(fā)制造費(fèi)用劇增等難題，從某種程度上大大放緩了摩爾定律的延續(xù)。　　顯而易見的是，在巨額的流片成本面前，很多中小規(guī)模公司不得不改變策略，更多的轉(zhuǎn)向FPGA的開發(fā)和設(shè)計(jì)。反觀FPGA市場(chǎng)，即便是5年前，其相對(duì)于ASIC的市場(chǎng)增速還是相當(dāng)遲緩的，但在近些年，尤其是邁進(jìn)90n
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Altera將舉辦技術(shù)大會(huì)分享最新解決方案

　　Altera宣布將主辦2015年Altera技術(shù)大會(huì)(Altera Technology Day，ATD)活動(dòng)，這是橫跨亞太地區(qū)八個(gè)地點(diǎn)的一系列以技術(shù)為導(dǎo)向的研討會(huì)，包括臺(tái)灣、印度、新加坡、馬來西亞、韓國(guó)與中國(guó)，時(shí)間將從2015年8月6日至9月23日。　　Altera技術(shù)及市場(chǎng)專家將會(huì)分享在電子系統(tǒng)設(shè)計(jì)上的最新趨勢(shì)， Terasic、MathWorks與Tektronix等合作夥伴也將展示在電子設(shè)計(jì)與產(chǎn)品上使用Altera的FPGA、SoC、IP與電源解決方案，以提供加速產(chǎn)品上市的價(jià)值。關(guān)于研討會(huì)
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設(shè)計(jì)成本低、可重復(fù)使用的配電架構(gòu)

　　最近，航天子系統(tǒng)采用的先進(jìn)半導(dǎo)體最底限是需有多個(gè)低電壓、具高電流軌條件，例如核心電壓小于1伏特(V)/30安培(A)的現(xiàn)場(chǎng)可編程門陣列(FPGA)。此外，各個(gè)負(fù)載也須具有獨(dú)特的排序、暫瞬、線路與負(fù)載調(diào)節(jié)的要求，這樣會(huì)讓配電網(wǎng)絡(luò)的設(shè)計(jì)變得更復(fù)雜。　　目前航天總線提供28和100伏特不穩(wěn)定的電源軌，可用于為最新的航天級(jí)半導(dǎo)體生成隔離的、有效率的穩(wěn)壓電源。為滿足未來航天子系統(tǒng)的需求，開發(fā)一個(gè)低成本、可擴(kuò)展的配電架構(gòu)，且可重復(fù)的設(shè)計(jì)是尋求從28或100伏特兩種輸入中，可有效地生成多個(gè)較小的電軌，并同時(shí)限制
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FPGA實(shí)戰(zhàn)演練邏輯篇：FPGA與CPLD

　　盡管很多人聽說過FPGA和CPLD，但是關(guān)于FPGA與CPLD之間的區(qū)別，了解的人可能不是很多。雖然FPGA與CPLD都是“可反復(fù)編程的邏輯器件”，但是在技術(shù)上卻有一些差異。簡(jiǎn)單地說，F(xiàn)PGA就是將CPLD的電路規(guī)模、功能、性能等方面強(qiáng)化之后的產(chǎn)物。(特權(quán)同學(xué)版權(quán)所有) 　　一般而言， FPGA與CPLD之間的區(qū)別如表1.1所示。(特權(quán)同學(xué)版權(quán)所有) 　　表1.1 FPGA和CPLD的比較　　 ? 　　總而言之，F(xiàn)PGA和CPLD最大的區(qū)別是他們的存儲(chǔ)
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基于FPGA與PCI總線的并行計(jì)算平臺(tái)設(shè)計(jì)實(shí)現(xiàn)

　　當(dāng)前對(duì)于各種加密算法。除了有針對(duì)性的破解算法，最基本的思想就是窮舉密鑰進(jìn)行匹配，通常稱為暴力破解算法。由于暴力破解算法包含密鑰個(gè)數(shù)較多，遍歷的時(shí)間超過實(shí)際可接受的范圍。如果計(jì)算速度提高到足夠快。這種遍歷的算法因結(jié)構(gòu)設(shè)計(jì)簡(jiǎn)便而具有實(shí)際應(yīng)用的前景。　　PCI總線(外設(shè)互聯(lián)總線)與傳統(tǒng)的總線標(biāo)準(zhǔn)——ISA總線(工業(yè)標(biāo)準(zhǔn)結(jié)構(gòu)總線)相比，具有更高的傳輸率(132MBps)、支持32位處理器及DMA和即插即用等優(yōu)點(diǎn)，用于取代ISA總線而成為目前臺(tái)式計(jì)算機(jī)的事實(shí)I/O總線標(biāo)準(zhǔn)，在普通PC
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