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LOGi FPGA 開(kāi)發(fā)板：可在樹(shù)莓派和Beaglebone上開(kāi)發(fā)FPGA

  • 最近在Kickstarter網(wǎng)站上，Valent F(x)團(tuán)隊(duì)正在為L(zhǎng)OGi FPGA開(kāi)發(fā)板的生產(chǎn)籌備資金。LOGi 是fpga開(kāi)發(fā)與arm平臺(tái)的結(jié)合。Valent F(x)團(tuán)隊(duì)開(kāi)發(fā)了可以支持樹(shù)莓派和Beaglebone上開(kāi)發(fā)的FPGA開(kāi)發(fā)板，LOGi系列。它讓FPGA開(kāi)發(fā)
  • 關(guān)鍵字： FPGA  樹(shù)莓派  Beaglebone    FPGA  IP  

從業(yè)績(jī)來(lái)看，賽靈思已經(jīng)遠(yuǎn)遠(yuǎn)領(lǐng)先于Altera

  • Altera和賽靈思20年來(lái)都在FPGA這個(gè)窄眾市場(chǎng)激烈的競(jìng)爭(zhēng)者，然而Peter Larson基于對(duì)兩個(gè)公司現(xiàn)金流折現(xiàn)法的研究表明，賽靈思是目前FPGA市場(chǎng)的絕對(duì)領(lǐng)先者。(http://seekingalpha.com/article/2008621-xilinx-appears-
  • 關(guān)鍵字： 賽靈思  Altera    FPGA  IP  嵌入式  PLD  CPLD  SoC  數(shù)字信號(hào)處理  消費(fèi)電子  FPGA  

FPGA：縱向創(chuàng)新與橫向整合引領(lǐng)變革

  • FPGA在先進(jìn)工藝路上的狂飚猛進(jìn)帶來(lái)了如影隨形的挑戰(zhàn)：一方面，進(jìn)入20nm和14nm階段后，不光是FPGA復(fù)雜度提升，對(duì)其外圍的電源管理等芯片也提出了“與時(shí)俱進(jìn)”的要求。另一方面，隨著SoC FPGA和3D IC技術(shù)
  • 關(guān)鍵字： FPGA  創(chuàng)新    FPGA  IP  嵌入式  PLD  CPLD  SoC  數(shù)字信號(hào)處理  消費(fèi)電子  FPGA  

基于FPGA的多通道高速采樣系統(tǒng)設(shè)計(jì)

  • 摘要：旋轉(zhuǎn)機(jī)械的振動(dòng)監(jiān)測(cè)，對(duì)于機(jī)械的安全運(yùn)行和提高設(shè)備利用率有重大意義。利用FPGA的并行處理能力，采用高速可編程FPGA模塊和嵌入式開(kāi)發(fā)的結(jié)合方式，提出了一種基于FPGA的高速、多通道、同步采樣實(shí)現(xiàn)方法。闡述了
  • 關(guān)鍵字： FPGA  高速采樣  并行處理  自定義指令  

基于FPGA的視頻圖像畫面分割器設(shè)計(jì)

  • 摘要：為了解決在一個(gè)屏幕上收看多個(gè)信號(hào)源的問(wèn)題，對(duì)基于FPGA技術(shù)的視頻圖像畫面分割器進(jìn)行了研究。研究的主要特色在于構(gòu)建了以FPGA為核心器件的視頻畫面分割的硬件平臺(tái)，首先，將DVI視頻信號(hào)，經(jīng)視頻解碼芯片轉(zhuǎn)換為
  • 關(guān)鍵字： FPGA  DDR2 SDRAM  視頻提取  圖像合成  

基于FPGA和ARM的視頻采集處理系統(tǒng)

  • 摘要：設(shè)計(jì)了一種可進(jìn)行實(shí)時(shí)視頻采集、壓縮和傳輸?shù)囊曨l采集處理系統(tǒng)。該系統(tǒng)充分結(jié)合FPGA和ARM的硬件優(yōu)勢(shì)，實(shí)現(xiàn)了設(shè)備接口和視頻信號(hào)處理的全數(shù)字化，易與信號(hào)處理新技術(shù)相結(jié)合，系統(tǒng)結(jié)構(gòu)緊湊，體積小巧、響應(yīng)快速;
  • 關(guān)鍵字： FPGA  ARM  視頻采集處理  

采用FPGA設(shè)計(jì)智能能源系統(tǒng)

  • 智能電網(wǎng)的目標(biāo)是更高效的管理電力傳送，以滿足我們?nèi)找嬖鲩L(zhǎng)的能源需求。但是在實(shí)現(xiàn)的道路上會(huì)遇到一些困難。不斷發(fā)展的標(biāo)準(zhǔn)。高可靠性要求。低成本實(shí)現(xiàn)。雙向通信以支持實(shí)時(shí)傳輸。復(fù)雜的電能監(jiān)視和控制。通用性要求
  • 關(guān)鍵字： FPGA  智能能源  系統(tǒng)  

FPGA開(kāi)發(fā)靜態(tài)無(wú)功補(bǔ)償控制器

  • “我們?cè)贜I CompactRIO平臺(tái)上開(kāi)發(fā)的SVC全數(shù)字控制系統(tǒng)，大大縮短了產(chǎn)品上市的時(shí)間又保證了系統(tǒng)的穩(wěn)定性。”
    挑戰(zhàn)：電弧爐、軋鋼機(jī)等大型工業(yè)設(shè)備在為企業(yè)創(chuàng)造產(chǎn)值的同時(shí)也帶來(lái)了無(wú)功分量和高次諧波等危害
  • 關(guān)鍵字： FPGA  靜態(tài)  控制器  

電子設(shè)計(jì)發(fā)展趨勢(shì) ― 開(kāi)源PCB設(shè)計(jì)

  • 電子設(shè)計(jì)領(lǐng)域的一大趨勢(shì)是開(kāi)源硬件及其配套的開(kāi)源原理圖和PCB布局圖的使用。使用開(kāi)源硬件及其配套資源意味著工程師可以方便地使用現(xiàn)有設(shè)計(jì)方案，從而提高效率并縮短產(chǎn)品上市時(shí)間。隨著工程師更加深入地了解傳統(tǒng)PCB與
  • 關(guān)鍵字： 開(kāi)源  PCB  FPGA  

基于FPGA多波束成像的聲納系統(tǒng)設(shè)計(jì)

  • 摘要：給出了一種基于FPGA的多波束成像聲納整機(jī)的硬件電路設(shè)計(jì)方案，介紹了該方案中各分系統(tǒng)的具體電路實(shí)現(xiàn)，以Xilinx公司的FPGA芯片作為核心器件，根據(jù)干端PC下發(fā)的控制指令實(shí)現(xiàn)對(duì)180個(gè)基元的發(fā)射接收電路的控制，完
  • 關(guān)鍵字： 多波束成像聲納  發(fā)射接收電路  波束形成器  千兆網(wǎng)傳輸  控制指令  FPGA  

基于CPLD/FPGA的出租車計(jì)費(fèi)器系統(tǒng)的設(shè)計(jì)實(shí)現(xiàn)

  • 1 引言隨著EDA技術(shù)的發(fā)展及大規(guī)模可編程邏輯器件CPLD/FPGA的出現(xiàn)，電子系統(tǒng)的設(shè)計(jì)技術(shù)和工具發(fā)生了巨大的變化，通過(guò)EDA技術(shù)對(duì)CPLD/FP-GA編程開(kāi)發(fā)產(chǎn)品，不僅成本低、周期短、可靠性高，而且可隨時(shí)在系統(tǒng)中修改其邏輯功
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低功耗FPGA設(shè)計(jì)技術(shù)

  • 一、前言隨著系統(tǒng)功率預(yù)算的不斷緊縮，迫切需要新型低功率元器件。對(duì)通信基礎(chǔ)設(shè)施而言，電路板冷卻、機(jī)箱體積小型化以及系統(tǒng)可靠性在系統(tǒng)設(shè)計(jì)中都起著重要的作用。對(duì)e-應(yīng)用，電池壽命、熱耗散和小體積尺寸是主要的設(shè)
  • 關(guān)鍵字： FPGA  低功耗  

基于DM648+FPGA的圖像處理模塊設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：介紹了一種基于DM648和FPGA構(gòu)架的圖像處理方案，闡述了圖像處理模塊的組成原理和結(jié)構(gòu)，并對(duì)模塊內(nèi)部電路設(shè)計(jì)和FPGA內(nèi)部圖像處理邏輯進(jìn)行了重點(diǎn)介紹。木文設(shè)計(jì)的圖像處理模塊能夠支持對(duì)高清視頻圖像的切割、縮放
  • 關(guān)鍵字： DM648  FPGA  視頻圖像處理  

基于FPGA的北斗QPSK調(diào)制實(shí)現(xiàn)與解調(diào)驗(yàn)證

  • 摘要 為研制北斗衛(wèi)星導(dǎo)航模擬信號(hào)源，設(shè)計(jì)實(shí)現(xiàn)了北斗QPSK信號(hào)調(diào)制器。文中在分析了北斗衛(wèi)星導(dǎo)航系統(tǒng)B1頻段信號(hào)的正交相移鍵控調(diào)制信號(hào)的基礎(chǔ)上，基于軟件無(wú)線電的思想，在FPGA硬件平臺(tái)上實(shí)現(xiàn)了QPSK信號(hào)調(diào)制器，通過(guò)
  • 關(guān)鍵字： 北斗  QPSK  調(diào)制解調(diào)  FPGA  StratixⅡ  

基于FPGA的大圍數(shù)QC_LDPC碼的譯碼器

  • 摘要 針對(duì)QC_LDPC碼的短環(huán)對(duì)碼性能的重要影響，采用了1種圍數(shù)為8的QC_LDPC碼設(shè)計(jì)。算法首先分別對(duì)3個(gè)不同的子矩陣進(jìn)行移位運(yùn)算，每個(gè)子矩陣分別與它們移位后生成的子矩陣共同組合形成1個(gè)新的子矩陣，然后再將新生成
  • 關(guān)鍵字： QC_LDPC碼  校驗(yàn)矩陣  分層迭代譯碼算法  FPGA  
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