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基于FPGA的設(shè)計(jì)解決物聯(lián)網(wǎng)實(shí)現(xiàn)的核心挑戰(zhàn)

  • 當(dāng)前，物聯(lián)網(wǎng)(IoT)已成為一個(gè)廣受歡迎的名詞，幾乎每一個(gè)電子設(shè)備相互連接到互聯(lián)網(wǎng)上加以使用，都被大家稱為物聯(lián)網(wǎng)。它包含了一個(gè)從智能家電、汽車到可
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FPGA和CPLD內(nèi)部自復(fù)位電路設(shè)計(jì)方案

  • 本文描述了復(fù)位的定義，分類及不同復(fù)位設(shè)計(jì)的影響，并討論了針對(duì)FPGA和CPLD的內(nèi)部自復(fù)位方案。1、定義復(fù)位信號(hào)是一個(gè)脈沖信號(hào)，它會(huì)使設(shè)計(jì)的電路進(jìn)入設(shè)
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十年FPGA開發(fā)經(jīng)驗(yàn)工程師談設(shè)計(jì)技巧

  • 從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間，至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺(tái)上完成數(shù)字秒表、搶答器、密碼鎖等實(shí)驗(yàn)時(shí)那個(gè)興奮勁。當(dāng)時(shí)由于沒有接
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如何基于EMIF接口的DSP控制系統(tǒng)設(shè)計(jì)？

  • 摘要：提出一種DSP 通過EMIF 接口控制復(fù)雜系統(tǒng)的方案。通過將DSP 芯片連接多片F(xiàn)PGA，并利用FPGA 與各種外部芯片連接，使得DSP 通過EMIF 接口就能控制
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適用于 FPGA、GPU 和 ASIC 系統(tǒng)的電源管理

  • 在 FPGA、GPU 或 ASIC 控制的系統(tǒng)板上，僅有為數(shù)不多的幾種電源管理相關(guān)的設(shè)計(jì)挑戰(zhàn)，但是由于需要反復(fù)調(diào)試，所以這類挑戰(zhàn)可能使系統(tǒng)的推出時(shí)間嚴(yán)重滯后
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FPGA開發(fā)之IP核：軟核、硬核以及固核概念

  • IP(Intelligent Property)核是具有知識(shí)產(chǎn)權(quán)核的集成電路芯核總稱，是經(jīng)過反復(fù)驗(yàn)證過的、具有特定功能的宏模塊，與芯片制造工藝無關(guān)，可以移植到不同的
  • 關(guān)鍵字： FPGA  IP核  固核概念  

如何基于蜜罐技術(shù)的FPGA實(shí)現(xiàn)技術(shù)？

  • 1. 項(xiàng)目背景蜜罐技術(shù)由來已久，蜜罐(Honeypot)是一種在互聯(lián)網(wǎng)上運(yùn)行的計(jì)算機(jī)系統(tǒng)。它是專門為吸引并誘騙那些試圖非法闖入他人計(jì)算機(jī)系統(tǒng)的人(如電腦黑
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如何基于FPGA的短波通信接收機(jī)？

  • 短波通信又稱高頻通信，是利用HF波段(3-30MHz)電磁波進(jìn)行的無線電通信。短波通信主要靠天波傳播，可經(jīng)電離層一次或數(shù)次反射，最遠(yuǎn)可傳至上萬里，如按氣
  • 關(guān)鍵字： FPGA  短波通信  接收機(jī)  

十年FPGA開發(fā)經(jīng)驗(yàn)工程師教你的絕密設(shè)計(jì)技巧

  • 從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間，至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺(tái)上完成數(shù)字秒表、搶答器、密碼鎖等實(shí)驗(yàn)時(shí)那個(gè)興奮勁。當(dāng)時(shí)由于沒有接
  • 關(guān)鍵字： CPLD  電子工程師  FPGA  

如何為基于FPGA的嵌入式系統(tǒng)進(jìn)行安全升級(jí)？

  • 如何防止器件ldquo;磚頭化rdquo;，只發(fā)出警告就夠了嗎?ldquo;系統(tǒng)正在更新，請(qǐng)勿關(guān)閉電源。rdquo;我們都看到過這個(gè)警告，它通常在電子器件要在閃存
  • 關(guān)鍵字： 嵌入式  FPGA  

經(jīng)驗(yàn)總結(jié)：電路設(shè)計(jì)的8個(gè)誤區(qū)

  • 關(guān)于電路設(shè)計(jì)8個(gè)誤區(qū)的經(jīng)驗(yàn)總結(jié)
  • 關(guān)鍵字： PCB  FPGA  CPU  

怎么采用FPGA原型系統(tǒng)加速物聯(lián)網(wǎng)設(shè)計(jì)？

  • 當(dāng)我們談?wù)撐锫?lián)網(wǎng) (IoT) 的時(shí)候，不夸張地說，它可以將我們所使用的智能設(shè)備互相連接，彼此分享大量的數(shù)據(jù)，從而使我們的生活更高效。這不僅僅是消費(fèi)者
  • 關(guān)鍵字： FPGA  物聯(lián)網(wǎng)  

用C 語(yǔ)言描述AES256 加密算法

  • 作者：Adam Taylor 首席工程師 e2v 公司 aptaylor@theiet.org 用C 語(yǔ)言描述AES256 加密算法，然后在硬件中加速性能。 高級(jí)加密標(biāo)準(zhǔn) (AES) 已經(jīng)成為很多
  • 關(guān)鍵字： FPGA  ASIC  

使用SDNet開發(fā)創(chuàng)新型可編程網(wǎng)絡(luò)

  • 日本電報(bào)電話公司 (NTT) 是一家全球電信集團(tuán)控股公司，負(fù)責(zé)制定管理策略和推動(dòng)研發(fā)工作發(fā)展。 我們是 NTT 研發(fā)部的研究人員，正領(lǐng)導(dǎo)兩個(gè)針對(duì)軟件定義網(wǎng)
  • 關(guān)鍵字： FPGA  ASIC  

引起的較高時(shí)鐘頻率仿真失敗原因

  • 通常如果你的設(shè)計(jì)在較低時(shí)鐘頻率時(shí)通過了仿真，但是在較高時(shí)鐘頻率時(shí)卻失敗了，你的第一個(gè)問題應(yīng)該是你的設(shè)計(jì)在某個(gè)較高時(shí)鐘頻率時(shí)是否達(dá)到了時(shí)序約束
  • 關(guān)鍵字： FPGA  時(shí)鐘頻率  賽靈思  
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