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為何圖像和FPGA更配？揭秘背后的技術(shù)要素

　　背景　　“No PP，No WAY”這是個(gè)眼見為實(shí)的世界，這是個(gè)視覺構(gòu)成的信息洪流的世界。大腦處理視覺內(nèi)容的速度比文字內(nèi)容快6萬倍，而隨著智能手機(jī)的普及，圖片、視頻的產(chǎn)生和分享已經(jīng)是人們?cè)谏缃黄脚_(tái)上的基本交流方式。用戶通過手機(jī)、平板、電腦上傳和分享自己的圖片，而且這個(gè)趨勢(shì)是每年都在增長(參見圖1)。　　圖1. 2016年KPCB統(tǒng)計(jì)報(bào)告[1] 　　每天QQ相冊(cè)、微信朋友圈上，用戶上傳的圖片數(shù)量有上億張，這些圖片被后臺(tái)服務(wù)器存儲(chǔ)下來，再通過網(wǎng)絡(luò)分發(fā)出去。如果每張圖片
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基于verilog實(shí)現(xiàn)哈夫曼編碼的新方法

傳統(tǒng)的硬件實(shí)現(xiàn)哈夫曼編碼的方法主要有：預(yù)先構(gòu)造哈夫曼編碼表，編碼器通過查表的方法輸出哈夫曼編碼[1];編碼器動(dòng)態(tài)生成哈夫曼樹，通過遍歷節(jié)點(diǎn)方式獲取哈夫曼編碼[2-3]。第一種方法從平均碼長角度看，在很多情況下非最優(yōu);第二種方法需要生成完整的哈夫曼樹，會(huì)產(chǎn)生大量的節(jié)點(diǎn)，且需遍歷哈夫曼樹獲取哈夫曼編碼，資源占用多，實(shí)現(xiàn)較為麻煩。本文基于軟件實(shí)現(xiàn)[4]時(shí)，使用哈夫曼樹，會(huì)提出一種適用于硬件并行實(shí)現(xiàn)的新數(shù)據(jù)結(jié)構(gòu)——字符池，通過對(duì)字符池的頻數(shù)屬性比較和排序來決定各個(gè)字符節(jié)點(diǎn)在字符池中的歸屬。配置字符池的同時(shí)逐步生成
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讓FPGA替代GPU，你會(huì)有怎樣的顧慮？

最近FPGA又頻頻被各AI領(lǐng)域的巨頭看好，比如微軟、百度、科大訊飛都對(duì)FPGA應(yīng)用前景有所期待。那么如果讓你選擇FPGA作為AI計(jì)算系統(tǒng)的主力軍，你會(huì)有什么樣的顧慮?
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FPGA與云端需求“不謀而合” 國產(chǎn)先從“中低端”發(fā)力

在FPGA的傳統(tǒng)市場，一直被經(jīng)營了30多年的FPGA的美國四大家壟斷著，國產(chǎn)FPGA廠商雖然舉步維艱但近幾年在產(chǎn)品布局、發(fā)展策略方面發(fā)力已經(jīng)初見成效。
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ASIC嶄露頭角 FPGA如何不淪為“過渡”品？

AI芯片不會(huì)是一兩顆芯片打遍天下，而一定是針對(duì)不同的應(yīng)用類型處理，由不同的芯片來支持，是很多款芯片的融合。FPGA、GPU、ASIC三大主要AI芯片將在很長一段時(shí)間內(nèi)同時(shí)存在。
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Lattice：聚焦網(wǎng)絡(luò)邊緣計(jì)算的差異化市場

　　延宕了一年之久的萊迪思(Lattice)收購案近期終于落下帷幕。由于受到特朗普的否決，Canyon Bridge對(duì)Lattice的收購要約可能告吹。雖然買賣不成，但lattice發(fā)展的腳步還是要繼續(xù)邁進(jìn)。根據(jù)其最新的動(dòng)態(tài)來看，lattice瞄準(zhǔn)了網(wǎng)絡(luò)邊緣這一逐漸興起的領(lǐng)域。　　目前的網(wǎng)絡(luò)中已經(jīng)有64億臺(tái)設(shè)備連接，此外還新增了550萬臺(tái)新設(shè)備，因此物聯(lián)網(wǎng)的興起需要采用新的處理和分析需求的方法。充分利用物聯(lián)網(wǎng)需要在設(shè)備和云之間實(shí)現(xiàn)強(qiáng)大的無縫連接，同時(shí)消除計(jì)算問題和隱私問題。云計(jì)算結(jié)合IoT技術(shù)的能力意
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讓FPGA更好地定制化，Achronix祭出custom blocks(定制單元塊)

　　讓FPGA定制進(jìn)ASIC/SoC　　顧名思義，F(xiàn)PGA就是“可編程”邏輯陣列，特點(diǎn)是通用性，利用編程實(shí)現(xiàn)各種功能。但是Achronix讓它定制化了?？纯碅chronix怎么說?！　】v觀FPGA的技術(shù)創(chuàng)新史，傳統(tǒng)FPGA制造商所關(guān)注的提供通用的可編程功能，例如上世紀(jì)80年代提供基于SRAM?LUT的功能，90年代推出嵌入式RAM存儲(chǔ)器，2000年代推出加強(qiáng)數(shù)學(xué)運(yùn)算的DSP，2010年代加入SerDes和硬化的I/O協(xié)議。他們的共同特點(diǎn)是通用性強(qiáng)，因此一塊FPGA可以賣給不同的客戶，但是缺少定制
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萊迪思推出全新的低功耗MachXO3控制PLD器件，增強(qiáng)嵌入式I/O擴(kuò)展和電路板級(jí)管理功能

　　萊迪思半導(dǎo)體公司,客制化智能互連解決方案市場的領(lǐng)先供應(yīng)商，今日宣布廣受市場歡迎的MachXO3?控制PLD系列迎來新成員，可滿足通信和工業(yè)市場上不斷變化的設(shè)計(jì)需求。全新的MachXO3-9400器件提供低功耗1.2 V內(nèi)核封裝選擇，適用于對(duì)散熱要求嚴(yán)苛的環(huán)境，為電機(jī)控制和電路板管理功能提供更多FPGA邏輯資源，為服務(wù)器和存儲(chǔ)應(yīng)用提供更多I/O。為了幫助采用MachXO3器件進(jìn)行設(shè)計(jì)開發(fā)的客戶，萊迪思同時(shí)推出了性能強(qiáng)大且提供更多靈活性的評(píng)估板，支持各類系統(tǒng)架構(gòu)，包括電路板管理、嵌入式微控制器I
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高云半導(dǎo)體發(fā)布新品，國產(chǎn)FPGA 產(chǎn)業(yè)劍露鋒芒

2017年10月26日，高云半導(dǎo)體在上海召開2017年度新品發(fā)布會(huì)，推出的GW1NS-2 SoC、GW3AT高性能FPGA和RISC-V平臺(tái)化產(chǎn)品。產(chǎn)品延續(xù)高云半導(dǎo)體創(chuàng)新血統(tǒng)，憑借精準(zhǔn)的市場定位與完整的FPGA解決方案，旨在打造國產(chǎn)FPGA的民族品牌。
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電路設(shè)計(jì)常見的八個(gè)誤區(qū)

　　現(xiàn)象一：這板子的PCB設(shè)計(jì)要求不高，就用細(xì)一點(diǎn)的線，自動(dòng)布吧　　點(diǎn)評(píng)：自動(dòng)布線必然要占用更大的PCB面積，同時(shí)產(chǎn)生比手動(dòng)布線多好多倍的過孔，在批量很大的產(chǎn)品中，PCB廠家降價(jià)所考慮的因素除了商務(wù)因素外，就是線寬和過孔數(shù)量，它們分別影響到PCB的成品率和鉆頭的消耗數(shù)量，節(jié)約了供應(yīng)商的成本，也就給降價(jià)找到了理由?！　‖F(xiàn)象二：這些總線信號(hào)都用電阻拉一下，感覺放心些?！　↑c(diǎn)評(píng)：信號(hào)需要上下拉的原因很多，但也不是個(gè)個(gè)都要拉。上下拉電阻拉一個(gè)單純的輸入信號(hào)，電流也就幾十微安以下，但拉一個(gè)被驅(qū)動(dòng)了的信號(hào)，其電流將達(dá)
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市場被國際大廠壟斷，高云半導(dǎo)體靠啥為國產(chǎn)FPGA正名？

　　廣東高云半導(dǎo)體科技股份有限公司(以下簡稱“高云半導(dǎo)體”)于10月26日在上海東錦江希爾頓逸林酒店隆重召開2017年度新產(chǎn)品發(fā)布會(huì)，發(fā)布了小而專的GW1NS-2 SoC、高精尖的GW3AT高性能FPGA和RISC-V平臺(tái)化產(chǎn)品。　　　　縱觀高云半導(dǎo)體發(fā)展史，這是一家成立(2014年1月)到現(xiàn)在僅三年多的一家初創(chuàng)企業(yè)，據(jù)官網(wǎng)資料顯示：“其首期投資5億元人民幣，旨在成為中國擁有自主知識(shí)產(chǎn)權(quán)，以55納米工藝級(jí)別以上的FPGA芯片為主導(dǎo)產(chǎn)品的集成電
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資深工程師FPGA設(shè)計(jì)經(jīng)驗(yàn)精華匯總

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FPGA電子電路設(shè)計(jì)圖集錦TOP12 —電路圖天天讀（105）

FPGA電子電路設(shè)計(jì)圖集錦TOP12 —電路圖天天讀（105）-作為專業(yè)集成電路領(lǐng)域中的半定制電路而出現(xiàn)的FPGA，不但解決了定制電路的不足，而且克服了原有可編程器件因門電路數(shù)有限的而產(chǎn)生的缺點(diǎn)。
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產(chǎn)生FPGA所需低電壓電路設(shè)計(jì)

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基于FPGA水磁無刷直流電機(jī)控制電路

基于FPGA水磁無刷直流電機(jī)控制電路-主要介紹基于現(xiàn)場可編程門陣列及EDA方法學(xué)的永磁無刷直流電機(jī)控制系統(tǒng)的電子電路設(shè)計(jì)。
關(guān)鍵字：智能硬件 FPGA 控制電路 BLDC

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fpga介紹

FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個(gè)新概念，內(nèi)部包括可 [ 查看詳細(xì) ]