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VHDL
高云半導(dǎo)體自主研發(fā)的邏輯綜合工具Gowin Synthesis支持VHDL硬件描述語(yǔ)言
嵌入式系統(tǒng)
半導(dǎo)體
VHDL
|
2020-04-01
一文看懂VHDL和Verilog有何不同
嵌入式系統(tǒng)
VHDL
Verilog
|
2018-11-08
VHDL語(yǔ)言實(shí)現(xiàn)的幀同步算法
手機(jī)與無線通信
VHDL
幀同步
算法
|
2018-09-11
基于CPLD的測(cè)試系統(tǒng)接口設(shè)計(jì)
EDA/PCB
EDA
CPLD
測(cè)試系統(tǒng)接口
VHDL
|
2018-07-27
基于VHDL邏輯電路設(shè)計(jì)與應(yīng)用
EDA/PCB
EDA
VHDL
串行加法器
|
2018-07-27
基于FPGA的Petri網(wǎng)的硬件實(shí)現(xiàn)
EDA/PCB
EDA技術(shù)
FPGA
VHDL
Petri網(wǎng)
|
2018-07-27
基于FPGA的數(shù)字密碼鎖
嵌入式系統(tǒng)
VHDL
FPGA
液晶顯示驅(qū)動(dòng)
QuartusII
|
2017-10-20
引入EDA技術(shù)進(jìn)行數(shù)字電路設(shè)計(jì)的方案
EDA/PCB
EDA技術(shù)
PCB
SOC芯片
VHDL
|
2017-06-13
基于VHDL語(yǔ)言為核心的EDA技術(shù)在醫(yī)學(xué)中的應(yīng)用
醫(yī)療電子
VHDL
Max+PlusⅡ
EDA
|
2017-06-07
EDA中的車載DVD位控主要VHDL源程序
嵌入式系統(tǒng)
車載DVD
VHDL
EDA
源程序
|
2017-06-06
FPGA系列相關(guān)圖書介紹
嵌入式系統(tǒng)
VHDL
FPGA
CPLD
AltiumDesign
XilinxISE
|
2017-06-06
基于FPGA的數(shù)字式心率計(jì)的設(shè)計(jì)實(shí)現(xiàn)
嵌入式系統(tǒng)
VHDL
數(shù)字式
FPGA
心率計(jì)
設(shè)計(jì)
|
2017-06-06
VHDL結(jié)構(gòu)體的行為描述法
嵌入式系統(tǒng)
VHDL
結(jié)構(gòu)體
行為描述法
|
2017-06-06
異步FIFO的VHDL設(shè)計(jì)
嵌入式系統(tǒng)
異步
FIFO
VHDL
設(shè)計(jì)
|
2017-06-06
VHDL結(jié)構(gòu)體的結(jié)構(gòu)化描述法
嵌入式系統(tǒng)
VHDL
結(jié)構(gòu)體
結(jié)構(gòu)化
描述法
|
2017-06-06
VHDL結(jié)構(gòu)體的數(shù)據(jù)流描述法
嵌入式系統(tǒng)
VHDL
結(jié)構(gòu)體
數(shù)據(jù)流
描述法
|
2017-06-06
用VHDL設(shè)計(jì)實(shí)現(xiàn)的有線頂盒信源發(fā)生方案
嵌入式系統(tǒng)
VHDL
有線頂盒
信源發(fā)生
方案
|
2017-06-06
Verilog語(yǔ)言要素
嵌入式系統(tǒng)
Verilog
語(yǔ)言要素
VHDL
|
2017-06-06
Verilog HDL的歷史及設(shè)計(jì)流程
嵌入式系統(tǒng)
VerilogHDL
VHDL
設(shè)計(jì)流程
|
2017-06-06
SystemVerilog語(yǔ)言簡(jiǎn)介
嵌入式系統(tǒng)
SystemVerilog
語(yǔ)言
VHDL
|
2017-06-06
HDL語(yǔ)言種類
嵌入式系統(tǒng)
HDL
VHDL
種類
|
2017-06-06
Verilog HDL和VHDL的比較
嵌入式系統(tǒng)
Verilog
VHDL
HDL
|
2017-06-06
什么是VHDL?
嵌入式系統(tǒng)
VHDL
|
2017-06-06
VHDL設(shè)計(jì)的串口通信程序
嵌入式系統(tǒng)
VHDL
串口通信
PC機(jī)
|
2017-06-06
基于CPLD的字符疊加器的設(shè)計(jì)
嵌入式系統(tǒng)
字符疊加器
RAM
CPLD
VHDL
|
2017-06-06
VHDL編碼中面積優(yōu)化探討
嵌入式系統(tǒng)
VHDL
編碼
面積優(yōu)化
|
2017-06-06
IC設(shè)計(jì)工程師需要這樣牛X的知識(shí)架構(gòu)
嵌入式系統(tǒng)
IC設(shè)計(jì)
VHDL
|
2017-06-05
基于FPGA的串行通信控制系統(tǒng)的設(shè)計(jì)
嵌入式系統(tǒng)
模塊化設(shè)計(jì)
串行通信控制系統(tǒng)
VHDL
|
2017-06-05
TPC碼譯碼器硬件仿真的優(yōu)化設(shè)計(jì)
嵌入式系統(tǒng)
TPC碼迭代譯碼器
VHDL
軟判決譯碼規(guī)則
|
2017-06-05
VHDL設(shè)計(jì)中電路優(yōu)化問題
嵌入式系統(tǒng)
行為級(jí)設(shè)計(jì)
VHDL
邏輯資源
|
2017-06-05
基于VHDL的旋轉(zhuǎn)編碼器接口電路的實(shí)現(xiàn)
嵌入式系統(tǒng)
旋轉(zhuǎn)編碼器
VHDL
時(shí)序仿真
|
2017-06-05
同步數(shù)字復(fù)接的設(shè)計(jì)及其FPGA技術(shù)實(shí)現(xiàn)
嵌入式系統(tǒng)
同步數(shù)字復(fù)接
VHDL
FPGA
|
2017-06-05
VHDL語(yǔ)言為核心的EDA技術(shù)在醫(yī)學(xué)中的應(yīng)用方案
嵌入式系統(tǒng)
EDA技術(shù)
VHDL
系統(tǒng)級(jí)描述
|
2017-06-05
基于FPGA的全數(shù)字交流伺服系統(tǒng)信號(hào)處理
嵌入式系統(tǒng)
交流伺服系統(tǒng)
VHDL
FPGA
光柵尺信號(hào)處理
|
2017-06-05
基于FPGA的全數(shù)字鎖相環(huán)路的設(shè)計(jì)
嵌入式系統(tǒng)
VHDL
數(shù)字鎖相環(huán)
FPGA
|
2017-06-05
步進(jìn)電機(jī)定位控制系統(tǒng)的VHDL程序設(shè)計(jì)
嵌入式系統(tǒng)
步進(jìn)電機(jī)
VHDL
步進(jìn)角
|
2017-06-05
基于VHDL的HDB3編碼器設(shè)計(jì)
嵌入式系統(tǒng)
VHDL
HDB3編碼器
結(jié)構(gòu)化設(shè)計(jì)
|
2017-06-05
SDRAM控制器的設(shè)計(jì)與VHDL實(shí)現(xiàn)
嵌入式系統(tǒng)
VHDL
狀態(tài)機(jī)
SDRAM
|
2017-06-05
數(shù)字變頻的FPGA實(shí)現(xiàn)
嵌入式系統(tǒng)
數(shù)字變頻
VHDL
FPGA
|
2017-06-05
基于FPGA的數(shù)據(jù)并轉(zhuǎn)串SPI發(fā)送模塊的設(shè)計(jì)
嵌入式系統(tǒng)
SPI
VHDL
FPGA
|
2017-06-05
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2025-03-05
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