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基于FPGA的二次群數(shù)字信號(hào)分接部分功能實(shí)現(xiàn)

作者： 時(shí)間：2011-08-25 來(lái)源：網(wǎng)絡(luò) 收藏
VHDL語(yǔ)言代碼實(shí)現(xiàn)如下程序段：一根據(jù)div的值動(dòng)態(tài)調(diào)整clk2048的頻率，實(shí)現(xiàn)負(fù)碼速調(diào)整

本文引用地址：http://butianyuan.cn/article/150291.htm

　　

　　

　　6.結(jié)論

　　本文對(duì)二次群的分接處理，提出了一種基于FPGA的方案，介紹了二次群的幀結(jié)構(gòu)，給出了幀頭捕獲、幀丟失告警、負(fù)碼速調(diào)整等VHDL語(yǔ)言的關(guān)鍵程序。在QUART

　　UART即為Universal Asynchronous Receiver/Transmitter，譯為通用異步收發(fā)器。UART是設(shè)備間進(jìn)行異步通信的關(guān)鍵模塊，用于控制計(jì)算機(jī)與串行設(shè)備的芯片。它提供了RS-232C數(shù)據(jù)終端設(shè)備接口，這樣計(jì)算機(jī)就可以和調(diào)制解調(diào)器或其它使用RS-232C接口的串行設(shè)備通信了。

　　USII軟件中編譯完成，資源僅占用三十多個(gè)LE，給二次群設(shè)備的設(shè)計(jì)提供了一種參考，具有很高的應(yīng)用價(jià)值。
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