采樣率變換器的多相表示結構FPGA實現(xiàn)
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圖11給出了一個D=3、I=4、N為12時的分數(shù)采樣率變換的部分仿真結果(Modelsim 6.1)。其中，濾波器系數(shù)定點化為12位補碼，輸入、輸出數(shù)據(jù)為12位補碼整數(shù), 測試輸入序列為20kHz的正弦波波形序列，采樣率為600kHz,輸出為800kHz采樣的正弦波序列。通過把輸入輸出序列保存并做FFT變換，可以得到兩者的實際頻率相同的結論。
利用FIR濾波器的多相分解及多采樣率網(wǎng)絡變換技術，本文介紹了一種有理數(shù)采樣率變換器的高效多相結構，并結合FPGA芯片的結構進行了實現(xiàn)與優(yōu)化。文中的一些方法也適用于其他多采速率系統(tǒng)的設計。
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