基于單片機及CPLD的多間隔脈沖產(chǎn)生電路
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2．2 CPLD電路設計
晶振是為處理器提供頻率基準的元器件，屬于系統(tǒng)不可或缺的一部分。通常分為有源晶振和無源晶振兩個大類，無源晶振要求芯片內(nèi)部有震蕩器，并且其信號電壓根據(jù)起振電路而定，允許不同的電壓，但無源晶振通常信號質(zhì)量和精度較差，需要精確的匹配外圍電路，如需更換晶振要同時更換外圍電路。有源晶振不需要芯片的內(nèi)部振蕩器，可以提供高精度的頻率基準，信號質(zhì)量也較無源晶振要好。
EPM7128SLC84需要提供外部時鐘信號，由于CPLD對時鐘精度要求甚高，通過前面的分析可知有源晶振的通信質(zhì)量和精度較無源晶振高，所以采用1．000 MHz的有源晶體振蕩器，電路的輸出端口與處理器EPM7128SLC84的GCKL1連接，其具體電路設計如圖3所示。本文引用地址：http://butianyuan.cn/article/171352.htm
3 系統(tǒng)軟件設計
單片機采用AT89S52芯片，通過軟件編程產(chǎn)生所要求的控制信號。主要的控制參數(shù)包括：信號周期、脈寬、分頻電路的開始信號、地址發(fā)生器的復位信號。在MAX+PLUSⅡ開發(fā)環(huán)境中完成分頻電路設計，可以省去大部分的中小規(guī)模集成電路和分離元件；使得電路具有集成度高、工作速度快、編程方便、價格低廉的顯著優(yōu)點。通過CPLD和數(shù)據(jù)預生成的信號實現(xiàn)方法，無需改變硬件電路，即可實現(xiàn)信號參數(shù)的任意調(diào)整；同時外圍電路十分簡單，為工程調(diào)試和應用帶來了方便。其中波形仿真圖如圖4所示。
4 結(jié)論
所設計的脈沖信號發(fā)生器，充分利用了單片機及CPLD二者的優(yōu)點，通過軟件和硬件的結(jié)合，能夠產(chǎn)生脈寬固定1μs，周期可調(diào)的單頭、雙頭、三頭脈沖，達到了設計要求，既可以作為普通脈沖信號源使用，也可以在一些特殊信號的條件下使用。
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