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3GSps超高速ADC系統(tǒng)設(shè)計解決方案

  •   包含千兆采樣率ADC的系統(tǒng)設(shè)計會遇到許多復(fù)雜情況。面臨的主要挑戰(zhàn)包括時鐘驅(qū)動、模擬輸入級和高速數(shù)字接口。本文探討了如何才能克服這些挑戰(zhàn),并給出了在千兆赫茲的速度下進(jìn)行系統(tǒng)優(yōu)化的方法。在討論中,時鐘設(shè)計、差分輸入驅(qū)動器的設(shè)計、數(shù)字接口和布局考慮都是十分復(fù)雜的問題。本文中的參考設(shè)計將采用ADC083000/B3000。   時鐘源是高速數(shù)據(jù)轉(zhuǎn)換系統(tǒng)中最重要的子電路之一。這是因為時鐘信號的定時精度會直接影響ADC的動態(tài)性能。為了將這種影響最小化,ADC的時鐘源必須 具有很低的定時抖動或相位噪聲。如果在選擇
  • 關(guān)鍵字: ADC  ADC083000  

如何挑選一個高速ADC

  •   高速ADC的性能特性對整個信號處理鏈路的設(shè)計影響巨大。系統(tǒng)設(shè)計師在考慮ADC對基帶影響的同時,還必須考慮對射頻(RF)和數(shù)字電路系統(tǒng)的影響。由于ADC位于模擬和數(shù)字區(qū)域之間,評價和選擇的責(zé)任常常落在系統(tǒng)設(shè)計師身上,而系統(tǒng)設(shè)計師并不都是ADC專家。   還有一些重要因素用戶在最初選擇高性能ADC時常常忽視。他們可能要等到最初設(shè)計樣機(jī)將要完成時才能知道所有系統(tǒng)級結(jié)果,而此時已不太可能再選擇另外的ADC。   影響很多無線通信系統(tǒng)的重要因素之一就是低輸入信號電平時的失真度。大多數(shù)無線傳輸?shù)竭_(dá)ADC的信號
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一種用于高速ADC的采樣保持電源電路的設(shè)計

  •   近年來,隨著數(shù)字信號處理技術(shù)的迅猛發(fā)展,數(shù)字信號處理技術(shù)廣泛地應(yīng)用于各個領(lǐng)域。因此對作為模擬和數(shù)字系統(tǒng)之間橋梁的模數(shù)轉(zhuǎn)換器(ADC)的性能也提出了越來越高的要求。低電壓高速ADC在許多的電子器件的應(yīng)用中是一個關(guān)鍵部分。由于其他結(jié)構(gòu)諸如兩步快閃結(jié)構(gòu)或內(nèi)插式結(jié)構(gòu)都很難在高輸入頻率下提供低諧波失真,因此流水線結(jié)構(gòu)在高速低功耗的ADC應(yīng)用中也成為一個比較常用的結(jié)構(gòu)。   作為流水線ADC前端的采樣保持電路是整個系統(tǒng)的關(guān)鍵模塊電路之一。設(shè)計一個性能優(yōu)異的采樣保持電路是避免采樣歪斜(timing skew)最直
  • 關(guān)鍵字: ADC  采樣保持  

PCB層級中時序交錯式超高速ADC解決方案

  •   運用時序交錯式類比數(shù)位轉(zhuǎn)換器(timeinterleavedADC)在每秒高達(dá)數(shù)十億次的同步取樣類比訊號是一個技術(shù)上的挑戰(zhàn),除此之外,對於混合訊號電路的設(shè)計也需要非常謹(jǐn)慎小心?;旧?,時序交錯的目標(biāo)是利用轉(zhuǎn)換器數(shù)目與取樣頻率相乘而不影響解析度以及動態(tài)的效能。   本文將探討運用時序交錯式類比數(shù)位轉(zhuǎn)換器時所出現(xiàn)的技術(shù)挑戰(zhàn),并對此提供實用的系統(tǒng)設(shè)計解決方案。本文也將說明可以解決目前已知問題的創(chuàng)新元件的特色及設(shè)計技術(shù)。同時利用快速傅立葉轉(zhuǎn)換(FFT)計算法算出7GSPS速率及兩個轉(zhuǎn)換器晶片在「交錯解決方案
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多片高速ADC和DAC在閉環(huán)系統(tǒng)中的關(guān)鍵作用

  •   引言   在當(dāng)今工業(yè)自動化應(yīng)用中,復(fù)雜的控制系統(tǒng)代替人工來操作不同的機(jī)器和過程。術(shù)語“自動化”指其智能化足以制定正確的過程決策從而實現(xiàn)目標(biāo)結(jié)果的系統(tǒng)。我們這里所說的“系統(tǒng)”是指閉環(huán)控制系統(tǒng)。這些系統(tǒng)依賴于輸入至控制器的傳感器數(shù)據(jù),提供反饋,控制器據(jù)此采取措施。這些措施就是控制器輸出的變化。通過確保高性能、高可靠性工業(yè)操作,閉環(huán)控制系統(tǒng)對于現(xiàn)代化工業(yè)4.0工廠的工業(yè)自動化和效率至關(guān)重要。   本文討論閉環(huán)系統(tǒng)的關(guān)鍵要素,重點關(guān)注模/數(shù)轉(zhuǎn)換器(ADC)和
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ADI:增益規(guī)格為何如此不對稱?

  •   一些工程師在設(shè)計過程中經(jīng)常會發(fā)出疑問“為什么ADC的額定最小和最大增益誤差相差如此之大?”在此將針對該問題進(jìn)行深入探討并給予解答。   為特定應(yīng)用選擇高速ADC時,增益一般不是關(guān)鍵規(guī)格。在設(shè)計階段會更重視噪聲、失真、功耗和價格。但這些年來,我們了解到,一旦ADC和信號鏈中的所有其他器件得以明確,某些幸運的工程師會計算復(fù)合信號鏈的增益,判斷它會如何影響系統(tǒng)。ADC通常不是總偏差的主要貢獻(xiàn)者,但某些器件要比其他器件更糟糕。   增益誤差指實測滿量程與理想滿量程之差,通常用滿量程
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千兆采樣ADC確保直接RF變頻

  •   隨著模數(shù)轉(zhuǎn)換器(ADC)的設(shè)計與架構(gòu)繼續(xù)采用尺寸更小的過程節(jié)點,一種新的千兆赫ADC產(chǎn)品應(yīng)運而生。能以千兆赫速率或更高速率進(jìn)行直接RF采樣且不產(chǎn)生交織偽像的ADC為通信系統(tǒng)、儀器儀表和雷達(dá)應(yīng)用的直接RF數(shù)字化帶來了全新的系統(tǒng)解決方案。   最先進(jìn)的寬帶ADC技術(shù)可以實現(xiàn)直接RF采樣。就在不久前,唯一可運行在GSPS (Gsample/s)下的單芯片ADC架構(gòu)是分辨率為6位或8位的Flash轉(zhuǎn)換器。這些器件能耗極高,且通常無法提供超過7位的有效位數(shù)(ENOB),這是由于Flash架構(gòu)的幾何尺寸與功耗限
  • 關(guān)鍵字: ADC  RF  轉(zhuǎn)換器  LVDS  FPGA  

雙通道時間交替模數(shù)轉(zhuǎn)換器增益和時序誤差的實時校準(zhǔn)

  •   1 雙通道TIADC中的失配誤差   一種使ADC速度加倍的有效方法是將兩個ADC并行設(shè)置,采樣時鐘反相操作。子ADC系統(tǒng)傳遞函數(shù)之間不可避免的微小失配會導(dǎo)致雜散諧波(tones),能夠顯著降低可實現(xiàn)的動態(tài)范圍。在這種ADC中有四種類型的誤差:   1. DC 偏置誤差;   2. 靜態(tài)增益誤差;   3. 時序誤差;   4. 帶寬誤差。   在實際應(yīng)用中,DC偏置誤差很簡單,可通過數(shù)字校準(zhǔn)來處理。帶寬誤差最難應(yīng)對,通常是通過精心的設(shè)計和布局來使誤差減小。在本文中,我們將重點討論增益和時
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三相高速數(shù)據(jù)收集方案支持智能化更高的電網(wǎng)管理

  •   1 三相電功率測量基礎(chǔ)知識   三相電力系統(tǒng)承載頻率相同的三相交流電(AC),各相之間彼此相位差120°。圖1所示為三相電壓波形,圖2所示為配置為4線Y型或星型連接的三個單相。3線Y型連接與沒有零線的4線連接完全相同。零線(圖2中黑色線)連接至Y型配置系統(tǒng)的中心點,供不平衡負(fù)載使用。如果負(fù)載恰好平衡,意味著各相電流相同,相電流彼此抵消,零線中沒有電流。所以,3線連接常用于平衡負(fù)載。顯而易見,線越少、消耗的銅纜就越少,系統(tǒng)成本越低、也更經(jīng)濟(jì)。   功率是負(fù)載上電壓和電流的乘積。功率計包括
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軟件定義無線電應(yīng)用中,雙通道時間交替ADC增益和時序誤差的實時校準(zhǔn)

  •   引言   這些下一代軟件定義無線電系統(tǒng)是基于高功率效率的射頻A/D轉(zhuǎn)換器(RF-ADC),它們能夠在天線側(cè)采樣,同時可提供高動態(tài)范圍。這些ADC采用時間交替(TIADC)架構(gòu)和CMOS技術(shù)設(shè)計,能夠?qū)崿F(xiàn)很高的采樣率。但該架構(gòu)也受時變失配誤差(mismatch errors)影響,有必要進(jìn)行實時校準(zhǔn)。本文介紹了一種全新的采用低復(fù)雜度數(shù)字信號處理算法來進(jìn)行增益和時序失配誤差背景校準(zhǔn)的方法。   1 雙通道TIADC中的失配誤差   一種使ADC速度加倍的有效方法是將兩個ADC并行設(shè)置,采樣時鐘反相操
  • 關(guān)鍵字: ADC  TIADC  校準(zhǔn)信號  濾波器  轉(zhuǎn)換器  

汽車電子設(shè)計中的Worst Case理論計算及應(yīng)用實例

  •   1 什么是Worst Case   在汽車電子的應(yīng)用中,為了保證我們的設(shè)計能滿足汽車的環(huán)境要求和可靠性要求,需要在設(shè)計階段充分考慮實際應(yīng)用中的極端情況,即電路模型的Worst Case。從PCB外部來講,主要考慮環(huán)境影響及信號的動態(tài)輸入,一般涉及以下因素:   • 環(huán)境溫度的高低極值;   • 輸入信號的電平范圍;   • 電源的極端情況等。   從PCB內(nèi)部來講,主要考慮元器件的誤差、壽命以及安全工作范圍等,一般涉及以下因素:   • 電源模塊(L
  • 關(guān)鍵字: 單片機(jī)  S12ZVM  蓄電池  MCU  ADC  

ADC是什么?不懂得看這里哦~~~

  •   導(dǎo)讀:正我們處在一個數(shù)字時代,而我們的視覺、聽覺、感覺、嗅覺等所感知的卻是一個模擬世界。如何將數(shù)字世界與模擬世界聯(lián)系在一起,正是模擬數(shù)字轉(zhuǎn)換器(ADC)和數(shù)字模擬轉(zhuǎn)換器(DAC)大顯身手之處。下面我們一起學(xué)習(xí)一下ADC是什么東東吧~~~ 1.ADC是什么--簡介   ADC是Analog-to-digital converter的簡稱,中文名稱為模擬數(shù)字轉(zhuǎn)換器,簡稱“模數(shù)轉(zhuǎn)換器”,是一種用于將模擬形式的連續(xù)信號轉(zhuǎn)換為數(shù)字形式的離散信號的設(shè)備。一個模擬數(shù)字轉(zhuǎn)換器可以提供信號用
  • 關(guān)鍵字: ADC  模數(shù)轉(zhuǎn)換器  ADC是什么  

基于AD9854和FPGA的頻率特性測試儀

  •   摘要:基于零中頻正交解調(diào)原理的頻率特性測試儀,用于檢測被測網(wǎng)絡(luò)的幅頻特性和相頻特性。系統(tǒng)采用集成數(shù)字直接頻率合成器AD9854產(chǎn)生雙路恒幅正交余弦信號,作為掃頻信號源,以FPGA為控制核心和運算平臺,結(jié)合濾波器、放大器、混頻器及ADC電路,實現(xiàn)對雙端口網(wǎng)絡(luò)在1-40MHz頻率范圍內(nèi)頻率特性的點頻和掃頻測量,并在LCD屏上實時顯示相頻特性曲線和幅頻特性曲線。   引言   AD9854數(shù)字合成器是高度集成的器件,它采用先進(jìn)的DDS技術(shù),片內(nèi)整合了兩路高速、高性能正交D/A轉(zhuǎn)換器,在高穩(wěn)定度時鐘的驅(qū)動
  • 關(guān)鍵字: AD9854  FPGA  濾波器  DDS  ADC  201504  

TI發(fā)布兼具專業(yè)性能與便攜式集成化的音頻ADC系列產(chǎn)品

  •   近日,德州儀器推出了6款高性能音頻模數(shù)轉(zhuǎn)換器 (ADC) 系列產(chǎn)品。該系列產(chǎn)品以高達(dá)110dB的動態(tài)范圍為特色,PCM1865系列產(chǎn)品中的這些器件集成了那些常見于便攜式音頻編解碼器的特性,而同時也為設(shè)計人員提供了之前只見于單一功能、專業(yè)音頻ADC中的性能等級。要獲得與全新音頻ADC相關(guān)的更多信息,敬請訪問:www.ti.com/PCM1865-pr-cn。   PCM1865音頻ADC由單個3.3V電源供電,免除了對于專用模擬5V電源軌的傳統(tǒng)需求,從而使得這些產(chǎn)品盡可能的小巧又高效。全新系列中的每個
  • 關(guān)鍵字: 德州儀器  ADC  

詳述ADC精度和分辨率的概念差異

  •   在與使用模數(shù)轉(zhuǎn)換器(ADC)的系統(tǒng)設(shè)計人員進(jìn)行交談時,我最常聽到的一個問題就是:   “你的16位ADC的精度也是16位的嗎?”   這個問題的答案取決于對分辨率和精度概念的基本理解。盡管是兩個完全不同的概念,這兩個數(shù)據(jù)項經(jīng)常被搞混和交換使用。   該文詳述了這兩個概念間的差異,并將深入研究造成ADC不準(zhǔn)確的主要原因。   ADC的分辨率被定義為輸入信號值的最小變化,這個最小數(shù)值變化會改變數(shù)字輸出值的一個數(shù)值。對于一個理想ADC來說,傳遞函數(shù)是一個步寬等于分辨率的階梯。
  • 關(guān)鍵字: ADC  精度  分辨率  
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Δ-∑adc介紹

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