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EEPW首頁 >> 主題列表 >> 數(shù)字接收機(jī)

基于Simulink的數(shù)字下變頻器設(shè)計(jì)及其FPGA實(shí)現(xiàn)

  • 數(shù)字下變頻是數(shù)字接收機(jī)中一個重要組成部分,實(shí)現(xiàn)將高速ADC轉(zhuǎn)換后的數(shù)字信號進(jìn)行抽取和濾波,得到低速的數(shù)字基帶信號。針對傳統(tǒng)模擬接收機(jī)系統(tǒng)帶寬較窄,系統(tǒng)體積大,同時缺少靈活性的缺點(diǎn),本文利用MATLAB的Simulink工具箱結(jié)合Altera公司的DspBuilder軟件,仿真和設(shè)計(jì)了一體積較小(只需要一片F(xiàn)PGA)、可靈活配置的中頻數(shù)字寬帶接收機(jī),并進(jìn)行了FPGA的硬件實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明:設(shè)計(jì)的數(shù)字中頻接收機(jī)具有系統(tǒng)帶寬較寬,體積較小,可以進(jìn)行靈活的配置,能滿足不同的性能要求等優(yōu)點(diǎn)。
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數(shù)字接收機(jī)中位同步器的研制 

  • 位同步器在通信系統(tǒng)中有重要的作用,直接影響接收機(jī)的性能?;鶐С尚螢V波器對信號頻譜進(jìn)行壓縮時,利用個位同步器消除碼間干擾和提高系統(tǒng)頻帶利用率。本文為升余弦成形濾波器的數(shù)字接收機(jī)設(shè)計(jì)出一種簡單可行的位同步器,并通過仿真驗(yàn)證了其簡單性和可行性。
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AD9230在中頻數(shù)字接收機(jī)中的應(yīng)用

  • 摘要:中頻數(shù)字接收機(jī)對ADC有很高的要求,ADC的精度和轉(zhuǎn)換速率必須足夠高,以實(shí)現(xiàn)對中頻信號的采樣。AD9230是1 2位精度、最高速率達(dá)250 MSPS的ADC芯片,可為一般中頻處理系統(tǒng)提供足夠的動態(tài)性能。對AD9230的主要原理
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數(shù)字接收機(jī)中ADC和射頻器件的動態(tài)性能要求

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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多通道數(shù)字接收機(jī)的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要:為了解決傳統(tǒng)模擬中頻接收機(jī)相位分辨率低等缺點(diǎn),提出一種基于軟件無線電的中頻數(shù)字接收機(jī)技術(shù)。針對雷達(dá)信號的特點(diǎn)提出了脈寬匹配濾波器的設(shè)計(jì)方法。采用基于多相濾波的正交變換理論,以及基于脈寬匹配的數(shù)字
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基于多相濾波的數(shù)字接收機(jī)的FPGA實(shí)現(xiàn)

  • 摘要:給出了一種基于多相濾波的數(shù)字信道化接收機(jī)的實(shí)現(xiàn)方法,系統(tǒng)的處理帶寬為875 MHz,解決了高速ADC與FPGA處理速度之間的矛盾。為了克服信道化接收機(jī)的接收盲區(qū),采用信道重疊的方法,連續(xù)覆蓋瞬時帶寬。在信道化
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數(shù)字接收機(jī)I/Q支路不平衡的時域補(bǔ)償

寬帶中頻數(shù)字接收機(jī)的FPGA實(shí)現(xiàn)

  • 2004年5月A版 摘  要:本文提出了一種基于FPGA的寬帶中頻數(shù)字接收機(jī)的實(shí)現(xiàn)方法。 關(guān)鍵詞: QPSK;帶通采樣;載波恢復(fù);FPGA 引言   在現(xiàn)代通信系統(tǒng)中,人們提出了各種各樣的全數(shù)字調(diào)制解調(diào)方案,全數(shù)字接收機(jī)的研究則是其中的關(guān)鍵,其中正交解調(diào)技術(shù)由于可以實(shí)現(xiàn)信號相位和幅度信息的提取,因而越來越受到廣泛的應(yīng)用。   與其它幾種解調(diào)方式相比QPSK調(diào)制方式抗噪聲性能好,功率頻譜段占用少,數(shù)據(jù)傳輸率高,是一種較好的調(diào)制方式。對于寬帶、高載頻的QPSK調(diào)制信號,如果用信號最高頻率兩
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數(shù)字接收機(jī)介紹

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