- 高速模數轉換器(ADC)存在一些固有限制，使其偶爾會在其正常功能以外產生罕見的轉換錯誤。但是，很多實際采樣系統(tǒng)不容許存在高ADC轉換誤差率。因此，量化高速模數轉換誤差率(CER)的頻率和幅度非常重要。 高速或GSPS ADC(每秒千兆采樣ADC)相對稀疏出現的轉換錯誤不僅造成其難以檢測，而且還使測量過程非常耗時。該持續(xù)時間通常超出毫秒范圍，達到幾小時、幾天、幾周甚至是幾個月。為了幫助消減這一耗時測試負擔，可以在一定“置信度”的確定性情況下估算誤差率，而仍然保持結果的質量?！ ≌`碼率(BER
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ADC CER
- 我們繼續(xù)講解與逐次逼近寄存器 (SAR) 數模轉換器 (ADC) 輸入類型有關的內容。在之前的部分中，我研究了輸入注意事項和SAR ADC之間的性能比較。在這篇帖子中，我們將看一看造成SAR ADC內總諧波失真 (THD) 的源頭，以及他在不同的輸入類型間有什么不一樣的地方 THD影響 讓我們首先看看諧波失真是如何被引入的。本質上來說，轉換器是一個非線性系統(tǒng)。如果系統(tǒng)完全線性，輸入“x”將在輸出上以線性的形式表現為“m
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SAR ADC
- 在選擇一個SAR ADC時所考慮的某些關鍵技術規(guī)格包括分辨率、通道數量、采樣率、電源范圍、功耗、數字接口和時鐘速度。但是諸如信噪比 (SNR) 和總諧波失真 (THD) 的噪聲和AC參數是怎樣的呢?這些參數會影響總體系統(tǒng)性能，并因此影響到SAR輸入類型的選擇。 噪聲影響 單端輸入：這些SAR只需要一條導線/電纜和一個單輸入驅動器，如果有的話，連接至電源。需要注意的是，這些ADC測量相對于SAR自身接地的輸入信號。雖然這是最簡單的配置，信號接地和SA
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SAR ADC
- 筆者曾聽人把電源形容成“電路的鞋帶?！毕耠娐芬粯?，人們常為鞋子的設計和款式做大量艱苦的工作，卻直到最后才會想起鞋帶。雖然電源往往是后添加的東西，但它們的設計可能正如信號鏈本身一樣重要。 在本系列的第一部分，筆者將介紹電源抑制(PSR)的概念，并說明電源如何能影響Δ-Σ型模數轉換器(ADC)的性能?！ 」P者的直流(DC)電源“固如磐石”，對嗎? 您的電源也許并不如您想象的那樣堅固耐用，信不信由您。從DC的角度來看，組件容差和溫度漂移都可能導致您的電源輸出因電路板不同和溫度變化而發(fā)生變化。輕微的變化似
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模數轉換器 PSR
- 本文主要介紹了ADC和DAC常用的56個技術術語，如“采集時間”、“混疊”、“孔徑延遲”等，幫助初學者更好的理解專業(yè)術語。 采集時間 采集時間是從釋放保持狀態(tài)(由采樣-保持輸入電路執(zhí)行)到采樣電容電壓穩(wěn)定至新輸入值的1 LSB范圍之內所需要的時間。采集時間(Tacq)的公式如下：
混疊 根據采樣定理，超過奈奎斯特頻率的輸入信號頻率為“混疊”頻率。也就是說，這些頻率被“折疊”或復制到奈奎斯特頻率附近的其它頻譜位置。為防止混疊，必須對所有有害信
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ADC DAC
- 數據轉換器現已蛻變?yōu)楦叨燃傻膯涡酒琁C。從第一款商用數據轉換器誕生以來，對更快數據速率的無止境需求驅動著數據轉換器不斷向前發(fā)展。目前ADC的最新產品是采樣速率達到GHz的RF采樣ADC。更高帶寬的需求伴隨著更高容量的需求，這就給FPGA I/O帶來了更大的壓力，而RF采樣ADC可以利用內部DDC予以化解。
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ADC RF采樣 GHz 201603
- 諸如物聯網(IoT)這樣的功耗敏感型應用要求在系統(tǒng)級芯片(SoC)內部有一套全面的低功耗策略。單純依賴傳統(tǒng)關閉電源模式和低電源電壓的技術可能不足以實現功耗目標。模擬模塊通常被認為是過于敏感，并且與激進的電源管理技術不兼容。 然而，對于模擬模塊特性的全面了解可以使低功耗SoC設計成為可能。在本文中，我們對通用的物聯網SoC設計中與外部傳感器連接的模數轉換器(ADC)知識產權(IP)進行了近距離的觀察，并描述了其相關特性，以及在系統(tǒng)層面上如何利用這些特性來實現低功耗?！ 鹘y(tǒng)低功耗技術的挑戰(zhàn) 那些有可
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模數轉換器 物聯網
- 和一個產品的任何其他方面一樣，產品說明書也可以得到不斷的改進，廠商正努力地詳細闡明產品說明書1。然而，市場上已經遺留了許多產品/產品說明書版本，對新版本或者更早的版本來說，不同標準的采用也取決于不同的因素。即使有一些特定的標準已經公開發(fā)表(如參考書目 2 所提到的)，標準的統(tǒng)一仍然是遙遙無期?！ ”疚牡哪康木驮谟谕怀霾煌瑥S商或同一廠商在為不同的高速模數轉換器 (ADC) 撰寫產品說明書時所采用的標準之間的差異。表 1 是選擇正確器件時可以使用
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TI ADC
- 最近幾年，高速、高精度的模數轉換器變得疾速。在 2006 年，一款業(yè)界一流的 12-位轉換器才達到 250 兆采樣/秒 (MSPS)。而今天，這一速度已經翻了一番，達到了 500 MSPS。14-位和 16-位精度的類似發(fā)展趨勢也日益明顯。這表明，在比特精度不變的條件下，ADC 速度正以幾乎每年翻一番的速度發(fā)展。采樣速率增長的結果是，收斂數字時序來確保您終端系統(tǒng)的數據完整性正變得越來越重要。 要收斂時
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ADC
- 在您開始設計以前，首先要看一下您想要數字化的信號類型。例如，如果您知道系統(tǒng)所有通道的最高、最低頻率以及精度要求，那么您可能會需要數個 ADC。 另一種情況下，這些通道可能具有互不相同的時間關系，這就要求一種能夠保護相位信息的同時采樣方法。您可以利用采樣保持電路和一個 ADC 來達到這一目的，而使用獨立的 ADC 可能會更容易一些。 圖 1 顯示了一個 Δ-Σ 轉換器多路復用電路，在該多路復用器的信號端上有一些
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轉換器 ADC
- 本文給大家分享了ADC學習知識。
過采樣頻率:增加一位分辨率或每減小6dB 的噪聲，需要以4 倍的采樣頻率fs 進行過采樣.
假設一個系統(tǒng)使用12 位的ADC，每秒輸出一個溫度值(1Hz)，為了將測量分辨率增加到16 位，按下式計算過采樣頻率： fos=4^4*1(Hz)=256(Hz)。
1. AD轉換器的分類下面簡要介紹常用的幾種類型的基本原理及特點：積分型、逐次逼近型、并行比較型/串并行型、Σ-Δ調制型、電容陣列逐次比較型及壓頻變換型?！ ?
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ADC 基準源
- 系統(tǒng)設計人員正面臨越來越多的挑戰(zhàn)，他們需要在不降低系統(tǒng)組件(例如：高速 數據轉換器)性能的情況下讓其設計最大程度地節(jié)能。設計人員們可能會轉而采 用許多電池供電的應用(例如：某種手持終端、軟件無線設備或便攜式超聲波掃 描儀)，也可能會縮小產品的外形尺寸，從而需要尋求減少發(fā)熱的諸多方法。 極大降低系統(tǒng)功耗的一種方法是對高速數據轉換器的電源進行優(yōu)化。數據轉換器設計和工藝技術的一些最新進展，讓許多新型ADC可以直接由開關電源來驅 動，從而達到最大化功效的目的?！ ∠到y(tǒng)
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ADC LDO
- 行業(yè)分析師們一致認為未來系統(tǒng)的發(fā)展趨勢是移動便攜、"綠色"節(jié)能，以及在終端設備中集成更多的傳感器。這種發(fā)展趨勢，要求模數 (ADC) 轉換器和數模 (DAC) 轉換器具有更多的通道數、更高的速度和性能，同時還要求更低的功耗預算、更小的尺寸以及更低的成本?！ 「鞔髷祿D換器廠商通過制造更多集成了其他電路組件的數據轉換器對這些需求做出了積極的響應。盡管在許多微處理器內核周圍有大量的外圍設備，一些性能需求正推動許多特殊模擬前端或者其他模擬"
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TI ADC
- 本文根據一個實用的電路設計闡述了如何設置高速ADC MAX1196的共模輸入范圍?！ ≥斎牍材ｋ妷悍秶?Vcm)對于包含了基帶采樣和高速ADC的通信接收機設計非常重要，尤其是采用直流耦合輸入、單電源供電的低壓電路。對于單電源供電電路，饋送到放大器和ADC的輸入信號應該偏置在Vcm范圍以內的直流電平，能夠消除放大器和ADC設計的一大屏障，因為不必在0V保持低失真和高線性度?！ ≈苯酉伦冾l結構的無線通信接收機通常采用差分、直流耦合方式與ADC連接。這種電路包含一個零中頻(ZIF)結構，具有一個R
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ADC MAX1196
- “聰明的人解決問題，智慧的人避免問題?！薄?阿爾伯特·愛因斯坦 愛因斯坦也許也會愛上模擬設計，因為其中總會涉及一些相對論。例如在數據采集系統(tǒng)中，精確度是相對于數據轉換器參考電壓的?！ ‘斈缔D換器 (ADC) 不含內部參考時，數據采集系統(tǒng)就需要外部電壓參考電路。讓電路板及系統(tǒng)級設計人員非常苦惱的是, 這通常是精確數據采集系統(tǒng)性能不佳的源頭。ADC的轉換精度基于這些電路為ADC提供的精確電壓?！ 『孟⑹怯腥齻€重要組件可幫助優(yōu)化外部參考電路，提高 ADC 性能。它們分別是：電壓參考、參考驅動器放大器和
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數據采集 ADC
模數轉換器（adc）介紹
您好，目前還沒有人創(chuàng)建詞條模數轉換器（adc）!
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