現(xiàn)場(chǎng)可編程門(mén)陣列（fpga）文章進(jìn)入現(xiàn)場(chǎng)可編程門(mén)陣列（fpga）技術(shù)社區(qū)

【從零開(kāi)始走進(jìn)FPGA】美好開(kāi)始——我流啊流啊流

　　按照基于Windows的語(yǔ)言(C、C++、C#)等編程語(yǔ)言的初學(xué)入門(mén)教程，第一個(gè)歷程應(yīng)該是“Hello World!”的例程。但由于硬件上的驅(qū)動(dòng)難易程度，此例程將在在后續(xù)章程中推出。硬件工程師學(xué)習(xí)開(kāi)發(fā)板的第一個(gè)例程：流水燈，一切美好的開(kāi)始。　　本章將會(huì)在設(shè)計(jì)代碼的同時(shí)，講解Quartus II 軟件的使用，后續(xù)章節(jié)中只講軟件的思想，以及解決方案，不再做過(guò)多的累贅描述。　　一、Step By Step 建立第一個(gè)工程　　(1)建立第一個(gè)工程，F(xiàn)ile-New-New
關(guān)鍵字： FPGA Quartus II

基于FPGA的跨時(shí)鐘域信號(hào)處理——MCU

　　說(shuō)到異步時(shí)鐘域的信號(hào)處理，想必是一個(gè)FPGA設(shè)計(jì)中很關(guān)鍵的技術(shù)，也是令很多工程師對(duì)FPGA望而卻步的原因。但是異步信號(hào)的處理真的有那么神秘嗎?那么就讓特權(quán)同學(xué)和你一起慢慢解開(kāi)這些所謂的難點(diǎn)問(wèn)題，不過(guò)請(qǐng)注意，今后的這些關(guān)于異步信號(hào)處理的文章里將會(huì)重點(diǎn)從工程實(shí)踐的角度出發(fā)，以一些特權(quán)同學(xué)遇到過(guò)的典型案例的設(shè)計(jì)為依托，從代碼的角度來(lái)剖析一些特權(quán)同學(xué)認(rèn)為經(jīng)典的跨時(shí)鐘域信號(hào)處理的方式。這些文章都是即興而寫(xiě)，可能不會(huì)做太多的分類(lèi)或者歸納，也有一些特例，希望網(wǎng)友自己把握。　　另外，關(guān)于異步時(shí)鐘域的話(huà)題，推薦大家
關(guān)鍵字： FPGA MCU

跨越鴻溝：同步世界中的異步信號(hào)

　　只有最初級(jí)的邏輯電路才使用單一的時(shí)鐘。大多數(shù)與數(shù)據(jù)傳輸相關(guān)的應(yīng)用都有與生俱來(lái)的挑戰(zhàn)，即跨越多個(gè)時(shí)鐘域的數(shù)據(jù)移動(dòng)，例如磁盤(pán)控制器、CDROM/DVD 控制器、調(diào)制解調(diào)器、網(wǎng)卡以及網(wǎng)絡(luò)處理器等。當(dāng)信號(hào)從一個(gè)時(shí)鐘域傳送到另一個(gè)時(shí)鐘域時(shí)，出現(xiàn)在新時(shí)鐘域的信號(hào)是異步信號(hào)。　　在現(xiàn)代 IC、ASIC 以及 FPGA 設(shè)計(jì)中，許多軟件程序可以幫助工程師建立幾百萬(wàn)門(mén)的電路，但這些程序都無(wú)法解決信號(hào)同步問(wèn)題。設(shè)計(jì)者需要了解可靠的設(shè)計(jì)技巧，以減少電路在跨時(shí)鐘域通信時(shí)的故障風(fēng)險(xiǎn)。　　基礎(chǔ) 　　從事多時(shí)鐘設(shè)計(jì)的第一
關(guān)鍵字： FPGA 異步信號(hào) FIFO

零基礎(chǔ)學(xué)FPGA（十）初入江湖之i2c通信

　　相信學(xué)過(guò)單片機(jī)的同學(xué)對(duì)I2C總線(xiàn)都不陌生吧，今天我們來(lái)學(xué)習(xí)怎么用verilog語(yǔ)言來(lái)實(shí)現(xiàn)它，并在FPGA學(xué)習(xí)版上顯示。　　i2c總線(xiàn)在近年來(lái)微電子通信控制領(lǐng)域廣泛采用的一種新型的總線(xiàn)標(biāo)準(zhǔn)，他是同步通信的一種特殊方式，具有接口少，控制簡(jiǎn)單，器件封裝形式小，通信速率高等優(yōu)點(diǎn)。在主從通信中，可以有多個(gè)i2c總線(xiàn)器件同時(shí)接到i2c總線(xiàn)上，所有與i2c兼容的器件都有標(biāo)準(zhǔn)的接口，通過(guò)地址來(lái)識(shí)別通信對(duì)象，使他們可以經(jīng)由i2c總線(xiàn)互相直接通信。　　i2c總線(xiàn)由兩條線(xiàn)控制，一條時(shí)鐘線(xiàn)SCL，一條數(shù)據(jù)線(xiàn)SDA，這
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智能醫(yī)療成風(fēng)口 IC設(shè)計(jì)企業(yè)如何站位？

　　市場(chǎng)研究機(jī)構(gòu)ICInsights最新報(bào)告稱(chēng)，中國(guó)IC設(shè)計(jì)企業(yè)在2014年全球前五十無(wú)晶圓廠(chǎng)IC供應(yīng)商排行榜上占據(jù)9個(gè)席位。這9家廠(chǎng)商包括海思、展訊、大唐微、南瑞智芯、華大、中興、瑞芯微、銳迪科、全志。而2009年只有1家企業(yè)入圍，這表明中國(guó)無(wú)晶圓廠(chǎng)IC產(chǎn)業(yè)確實(shí)成長(zhǎng)顯著。　　然而，上述9家入圍企業(yè)中，有5家都聚焦于目前最熱門(mén)的智能手機(jī)市場(chǎng)。當(dāng)然，這些年智能手機(jī)終端產(chǎn)業(yè)確實(shí)增長(zhǎng)迅速，也為中國(guó)IC設(shè)計(jì)提供了發(fā)展空間和機(jī)遇。但我國(guó)擁有的是全球最大的信息消費(fèi)市場(chǎng)，每年進(jìn)口集成電路產(chǎn)品超過(guò)2000億美元，對(duì)I
關(guān)鍵字：海思展訊 FPGA

FPGA時(shí)序約束的6種方法

　　對(duì)自己的設(shè)計(jì)的實(shí)現(xiàn)方式越了解，對(duì)自己的設(shè)計(jì)的時(shí)序要求越了解，對(duì)目標(biāo)器件的資源分布和結(jié)構(gòu)越了解，對(duì)EDA工具執(zhí)行約束的效果越了解，那么對(duì)設(shè)計(jì)的時(shí)序約束目標(biāo)就會(huì)越清晰，相應(yīng)地，設(shè)計(jì)的時(shí)序收斂過(guò)程就會(huì)更可控。　　下文總結(jié)了幾種進(jìn)行時(shí)序約束的方法。按照從易到難的順序排列如下：　　0.核心頻率約束　　這是最基本的，所以標(biāo)號(hào)為0. 　　1.核心頻率約束+時(shí)序例外約束　　時(shí)序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay.但這還不是最完整的時(shí)序約束
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零基礎(chǔ)學(xué)FPGA（九）牛刀小試——串行口通信電路設(shè)計(jì)

　　以前在學(xué)單片機(jī)的時(shí)候，覺(jué)得串口通信其實(shí)很簡(jiǎn)單，只要一個(gè)指令數(shù)據(jù)就能輕易的接收或者發(fā)送。前幾天試著用FPGA實(shí)現(xiàn)，發(fā)現(xiàn)里面的學(xué)問(wèn)還不少，并沒(méi)有想象的那么簡(jiǎn)單。當(dāng)然代碼肯定是參考別人的，不過(guò)我還是認(rèn)真研究了整段代碼的，下面的程序就是我在看懂了別人代碼后自己敲的，花了也不少時(shí)間，理解的也差不多，下面我就在這里給那些和我一樣的初學(xué)者介紹一下吧，解釋的不對(duì)的地方還望各位大神指正，大家好一起學(xué)習(xí)~ 　　1、頂層模塊　　寫(xiě)程序都一樣，不能多有的程序都寫(xiě)在一個(gè)模塊里，那樣看起來(lái)很麻煩，出了錯(cuò)誤也不好維護(hù)，對(duì)于一
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【從零開(kāi)始走進(jìn)FPGA】路在何方——Verilog快速入門(mén)

　　一、關(guān)于HDL 　　1. HDL簡(jiǎn)介　　HDL ： Hardware Discription Language 硬件描述語(yǔ)言，即描述FPGA/CPLD內(nèi)部邏輯門(mén)的工作狀態(tài)，來(lái)實(shí)現(xiàn)一定電路。　　隨著EDA技術(shù)的發(fā)展，使用硬件語(yǔ)言設(shè)計(jì)PLD/FPGA成為一種趨勢(shì)。目前硬件描述語(yǔ)言有VHDL、Verilog、Superlog、System C、Cynlib C++、C Level等。各種語(yǔ)言有各種優(yōu)勢(shì)，根據(jù)業(yè)界應(yīng)用而定。　　2. VHDL和Verilog區(qū)別　　在業(yè)界，VHDL和Veri
關(guān)鍵字： FPGA Verilog

不同的verilog代碼風(fēng)格看RTL視圖之一

　　剛開(kāi)始玩CPLD/FPGA開(kāi)發(fā)板的時(shí)候使用的一塊基于EPM240T100的板子，alter的這塊芯片雖說(shuō)功耗小體積小，但是資源還是很小的，你寫(xiě)點(diǎn)稍微復(fù)雜的程序，如果不注意coding style，很容易就溢出了。當(dāng)時(shí)做一個(gè)三位數(shù)的解碼基本就讓我苦死了，對(duì)coding style的重要性也算是有一個(gè)比較深刻的認(rèn)識(shí)了。　　后來(lái)因?yàn)橐恢痹谕鎥ilinx的spartan3 xc3s400，這塊芯片資源相當(dāng)豐富，甚至于我在它里面緩存了一幀640*480*3/8BYTE的數(shù)據(jù)都沒(méi)有問(wèn)題(VGA顯示用)。而最近
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解讀verilog代碼的一點(diǎn)經(jīng)驗(yàn)

　　學(xué)習(xí)FPGA其實(shí)也不算久，開(kāi)始的時(shí)候參考別人的代碼并不多，大多是自己寫(xiě)的，那時(shí)候做時(shí)序邏輯多一些。參加了中嵌的培訓(xùn)班，一個(gè)多月的時(shí)間在熟悉ISE軟件的使用以及verilog語(yǔ)法方面下了苦功，也參考了不少書(shū)，算是為自己打下了比較好的基礎(chǔ)。因?yàn)槟菚r(shí)候培訓(xùn)的方向是軟件無(wú)線(xiàn)電方面的，所以做了很多有關(guān)的模塊程序，之前的日志里也發(fā)表了很多，關(guān)鍵是一個(gè)興趣，感覺(jué)仿真后看到自己的一個(gè)個(gè)算法思想得到實(shí)現(xiàn)真有成就感。后來(lái)停了一段時(shí)間，因?yàn)閷?shí)在沒(méi)有比較有意思的活干了。　　直到前段時(shí)間開(kāi)始使用SP306的開(kāi)發(fā)板，然后會(huì)參
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CPLD對(duì)FPGA從并快速加載的解決方案

　　現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)作為專(zhuān)用集成電路(ASIC)領(lǐng)域的一種半定制電路，可以根據(jù)設(shè)計(jì)的需要靈活實(shí)現(xiàn)各種接口或者總線(xiàn)的輸出，在設(shè)備端的通信產(chǎn)品中已得到越來(lái)越廣泛的使用。FPGA是基于靜態(tài)隨機(jī)存儲(chǔ)器(SRAM)結(jié)構(gòu)的，斷電后程序丟失后的每次上電都需要重新加載程序。且隨著FPGA規(guī)模的升級(jí)，加載程序的容量也越來(lái)越大，如Xilinx公司的Spartan - 6系列中的6SLX150T，其加載容量最大可以達(dá)到4.125 MB. 　　1 FPGA常用配置方式　　FPGA的配置數(shù)據(jù)通常存放在系統(tǒng)中的存儲(chǔ)
關(guān)鍵字： CPLD FPGA modelsim

FPGA電源設(shè)計(jì)適合并行工程嗎？

　　如果設(shè)計(jì)師可以在開(kāi)發(fā)過(guò)程早期就滿(mǎn)足基于FPGA的設(shè)計(jì)，提出的功耗要求和約束條件，那么在系統(tǒng)的最終實(shí)現(xiàn)階段就能形成極具競(jìng)爭(zhēng)力的優(yōu)勢(shì)。然而，根據(jù)整個(gè)技術(shù)文獻(xiàn)中這種自我暗示式的反復(fù)禱告，今天基于FPGA的系統(tǒng)中還有什么會(huì)使得完全遵循這個(gè)建議變得不切實(shí)際或過(guò)于困難呢?盡管能夠使用各種開(kāi)發(fā)工具，如專(zhuān)門(mén)針對(duì)FPGA項(xiàng)目開(kāi)發(fā)的早期功耗預(yù)估器和功耗分析器，但對(duì)電源設(shè)計(jì)師來(lái)說(shuō)，在設(shè)計(jì)過(guò)程早期就考慮最壞情況而不是最佳情況的電源系統(tǒng)是有好處的，因?yàn)樵谠S多方面仍有太多的不確定性，比如在硬件設(shè)計(jì)完成和功耗可以測(cè)量之前，靜態(tài)小電
關(guān)鍵字： FPGA 電源設(shè)計(jì)

基于單片機(jī)和FPGA設(shè)計(jì)的程控濾波器

　　以單片機(jī)和可編程邏輯器件(FPGA)為控制核心，設(shè)計(jì)了一個(gè)程控濾波器，實(shí)現(xiàn)了小信號(hào)程控放大、程控調(diào)整濾波器截止頻率和幅頻特性測(cè)試的功能。其中放大模塊由可變?cè)鲆娣糯笃鰽D603實(shí)現(xiàn)，最大增益60dB，10dB步進(jìn)可調(diào)，增益誤差小于1%.程控濾波模塊由MAX297低通濾波、TLC1068高通濾波及橢圓低通濾波器構(gòu)成，濾波模式用模擬開(kāi)關(guān)選擇。本系統(tǒng)程控調(diào)整有源濾波的-3dB截止頻率，使其在1~30kHz范圍內(nèi)可調(diào)，誤差小于1.5%.此外，采用有效值采樣芯片AD637及12位并行A/D轉(zhuǎn)換器MAX120實(shí)現(xiàn)了
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AMD嵌入式Radeon GPU加速醫(yī)療成像效能

　　AMD宣布其嵌入式 Radeon HD 7850 GPU 協(xié)助Analogic公司旗下 BK Ultrasound 醫(yī)用超音波產(chǎn)品的超音波系統(tǒng) bk3000 發(fā)揮卓越應(yīng)用效能。新款 BK Ultrasound 醫(yī)用超音波 bk3000 搭載AMD嵌入式 Radeon 繪圖技術(shù)，可望使成像及系統(tǒng)效能到全新境界。　　AMD嵌入式 Radeon HD 7850 GPU 采用AMD屢屢獲獎(jiǎng)的次世代繪圖核心(GCN)架構(gòu)為基礎(chǔ)，帶動(dòng)各種嵌入式應(yīng)用在視覺(jué)與平行處理功能提升。除了超音波外， GPGPU 的其他應(yīng)
關(guān)鍵字： AMD嵌 Radeon GPU FPGA

美高森美宣布成功完成9項(xiàng)NIST加密算法驗(yàn)證程序認(rèn)證

　　致力于在電源、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation) 宣布完成9項(xiàng)全新的美國(guó)國(guó)家標(biāo)準(zhǔn)與技術(shù)研究所(National Institute of Standards and Technology, NIST)加密算法驗(yàn)證程序(CAVP)認(rèn)證。　　美高森美SmartFusion®2 SoC FPGA和 IGLOO®2 FPGA通過(guò)的認(rèn)證項(xiàng)目包括NIST “Suite B”中的AES加密/解
關(guān)鍵字：美高森美 NIST FPGA

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現(xiàn)場(chǎng)可編程門(mén)陣列（fpga）介紹

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