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EEPW首頁 >> 主題列表 >> 現(xiàn)場可編程門陣列（fpga）

現(xiàn)場可編程門陣列（fpga） 文章 進(jìn)入現(xiàn)場可編程門陣列（fpga）技術(shù)社區(qū)

Altera SoC FPGA：體系結(jié)構(gòu)的重要性

  • SoC FPGA器件在一個器件中同時集成了處理器和FPGA體系結(jié)構(gòu)。將兩種技術(shù)合并起來具有很多優(yōu)點(diǎn)，包括更高的集成度、更低的功耗、更小的電路板面積，以及處理器和FPGA之間帶寬更大的通信等等。這一同類最佳的器件發(fā)揮了
  • 關(guān)鍵字： Altera  SoC  FPGA  

PCB設(shè)計(jì)關(guān)于“過孔蓋油”和“過孔開窗”區(qū)分

  • 關(guān)于“過孔蓋油”和“過孔開窗”此點(diǎn)(VIA和PAD的用法區(qū)分)，許多客戶和設(shè)計(jì)工程師在系統(tǒng)上下單時經(jīng)常會問這是什么意思，我的文件該選哪一個選項(xiàng)?現(xiàn)就此問題點(diǎn)說明如下：經(jīng)常碰到這樣的問題，設(shè)
  • 關(guān)鍵字： 過孔蓋油  FPGA  PCB  

FPGA自動加載系統(tǒng)設(shè)計(jì)實(shí)現(xiàn)

  • 摘要：針對FPGA可以在每次上電時自動獲取配置文件的需求，提出了一種由USB芯片和FLASH芯片、CPLD組成的可對FPGA上電后自動加載的系統(tǒng)。該系統(tǒng)可以通過USB芯片和CPLD將PC中的FPGA配置文件寫入FLASH芯片，并且在CPLD的
  • 關(guān)鍵字： PS模式加載  FPGA  FLASH芯片  自動加載系統(tǒng)  

GPS C／A碼發(fā)生器的仿真研究與FPGA設(shè)計(jì)

  • 摘要：全球定位系統(tǒng)(Global Positioning System，GPS)能夠向全球范圍內(nèi)的用戶提供全天候的高精度導(dǎo)航、定位和授時服務(wù)，在軍用和民用領(lǐng)域得到了廣泛的應(yīng)用。以GPS系統(tǒng)的測距碼粗碼C/A碼為研究對象，在深入研究C/A碼
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LOGi FPGA 開發(fā)板：可在樹莓派和Beaglebone上開發(fā)FPGA

  • 最近在Kickstarter網(wǎng)站上，Valent F(x)團(tuán)隊(duì)正在為LOGi FPGA開發(fā)板的生產(chǎn)籌備資金。LOGi 是fpga開發(fā)與arm平臺的結(jié)合。Valent F(x)團(tuán)隊(duì)開發(fā)了可以支持樹莓派和Beaglebone上開發(fā)的FPGA開發(fā)板，LOGi系列。它讓FPGA開發(fā)
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從業(yè)績來看，賽靈思已經(jīng)遠(yuǎn)遠(yuǎn)領(lǐng)先于Altera

  • Altera和賽靈思20年來都在FPGA這個窄眾市場激烈的競爭者，然而Peter Larson基于對兩個公司現(xiàn)金流折現(xiàn)法的研究表明，賽靈思是目前FPGA市場的絕對領(lǐng)先者。(http://seekingalpha.com/article/2008621-xilinx-appears-
  • 關(guān)鍵字： 賽靈思  Altera    FPGA  IP  嵌入式  PLD  CPLD  SoC  數(shù)字信號處理  消費(fèi)電子  FPGA  

FPGA：縱向創(chuàng)新與橫向整合引領(lǐng)變革

  • FPGA在先進(jìn)工藝路上的狂飚猛進(jìn)帶來了如影隨形的挑戰(zhàn)：一方面，進(jìn)入20nm和14nm階段后，不光是FPGA復(fù)雜度提升，對其外圍的電源管理等芯片也提出了“與時俱進(jìn)”的要求。另一方面，隨著SoC FPGA和3D IC技術(shù)
  • 關(guān)鍵字： FPGA  創(chuàng)新    FPGA  IP  嵌入式  PLD  CPLD  SoC  數(shù)字信號處理  消費(fèi)電子  FPGA  

基于FPGA的多通道高速采樣系統(tǒng)設(shè)計(jì)

  • 摘要：旋轉(zhuǎn)機(jī)械的振動監(jiān)測，對于機(jī)械的安全運(yùn)行和提高設(shè)備利用率有重大意義。利用FPGA的并行處理能力，采用高速可編程FPGA模塊和嵌入式開發(fā)的結(jié)合方式，提出了一種基于FPGA的高速、多通道、同步采樣實(shí)現(xiàn)方法。闡述了
  • 關(guān)鍵字： FPGA  高速采樣  并行處理  自定義指令  

基于FPGA的視頻圖像畫面分割器設(shè)計(jì)

  • 摘要：為了解決在一個屏幕上收看多個信號源的問題，對基于FPGA技術(shù)的視頻圖像畫面分割器進(jìn)行了研究。研究的主要特色在于構(gòu)建了以FPGA為核心器件的視頻畫面分割的硬件平臺，首先，將DVI視頻信號，經(jīng)視頻解碼芯片轉(zhuǎn)換為
  • 關(guān)鍵字： FPGA  DDR2 SDRAM  視頻提取  圖像合成  

基于FPGA和ARM的視頻采集處理系統(tǒng)

  • 摘要：設(shè)計(jì)了一種可進(jìn)行實(shí)時視頻采集、壓縮和傳輸?shù)囊曨l采集處理系統(tǒng)。該系統(tǒng)充分結(jié)合FPGA和ARM的硬件優(yōu)勢，實(shí)現(xiàn)了設(shè)備接口和視頻信號處理的全數(shù)字化，易與信號處理新技術(shù)相結(jié)合，系統(tǒng)結(jié)構(gòu)緊湊，體積小巧、響應(yīng)快速;
  • 關(guān)鍵字： FPGA  ARM  視頻采集處理  

采用FPGA設(shè)計(jì)智能能源系統(tǒng)

  • 智能電網(wǎng)的目標(biāo)是更高效的管理電力傳送，以滿足我們?nèi)找嬖鲩L的能源需求。但是在實(shí)現(xiàn)的道路上會遇到一些困難。不斷發(fā)展的標(biāo)準(zhǔn)。高可靠性要求。低成本實(shí)現(xiàn)。雙向通信以支持實(shí)時傳輸。復(fù)雜的電能監(jiān)視和控制。通用性要求
  • 關(guān)鍵字： FPGA  智能能源  系統(tǒng)  

FPGA開發(fā)靜態(tài)無功補(bǔ)償控制器

  • “我們在NI CompactRIO平臺上開發(fā)的SVC全數(shù)字控制系統(tǒng)，大大縮短了產(chǎn)品上市的時間又保證了系統(tǒng)的穩(wěn)定性。”
    挑戰(zhàn)：電弧爐、軋鋼機(jī)等大型工業(yè)設(shè)備在為企業(yè)創(chuàng)造產(chǎn)值的同時也帶來了無功分量和高次諧波等危害
  • 關(guān)鍵字： FPGA  靜態(tài)  控制器  

電子設(shè)計(jì)發(fā)展趨勢 ― 開源PCB設(shè)計(jì)

  • 電子設(shè)計(jì)領(lǐng)域的一大趨勢是開源硬件及其配套的開源原理圖和PCB布局圖的使用。使用開源硬件及其配套資源意味著工程師可以方便地使用現(xiàn)有設(shè)計(jì)方案，從而提高效率并縮短產(chǎn)品上市時間。隨著工程師更加深入地了解傳統(tǒng)PCB與
  • 關(guān)鍵字： 開源  PCB  FPGA  

基于FPGA多波束成像的聲納系統(tǒng)設(shè)計(jì)

  • 摘要：給出了一種基于FPGA的多波束成像聲納整機(jī)的硬件電路設(shè)計(jì)方案，介紹了該方案中各分系統(tǒng)的具體電路實(shí)現(xiàn)，以Xilinx公司的FPGA芯片作為核心器件，根據(jù)干端PC下發(fā)的控制指令實(shí)現(xiàn)對180個基元的發(fā)射接收電路的控制，完
  • 關(guān)鍵字： 多波束成像聲納  發(fā)射接收電路  波束形成器  千兆網(wǎng)傳輸  控制指令  FPGA  

基于CPLD/FPGA的出租車計(jì)費(fèi)器系統(tǒng)的設(shè)計(jì)實(shí)現(xiàn)

  • 1 引言隨著EDA技術(shù)的發(fā)展及大規(guī)?？删幊踢壿嬈骷﨏PLD/FPGA的出現(xiàn)，電子系統(tǒng)的設(shè)計(jì)技術(shù)和工具發(fā)生了巨大的變化，通過EDA技術(shù)對CPLD/FP-GA編程開發(fā)產(chǎn)品，不僅成本低、周期短、可靠性高，而且可隨時在系統(tǒng)中修改其邏輯功
  • 關(guān)鍵字： CPLD  FPGA  出租車  計(jì)費(fèi)器  
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現(xiàn)場可編程門陣列（fpga）介紹

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