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基于FPGA的交通燈系統(tǒng)控制設(shè)計(jì)

  • 摘要：為了對(duì)交通燈系統(tǒng)進(jìn)行精確控制，采用FPGA實(shí)驗(yàn)板，在QuartusⅡ軟件環(huán)境下，分別實(shí)現(xiàn)脈沖發(fā)生模塊、狀態(tài)定時(shí)模塊、交通燈顯示模塊、時(shí)間顯示模塊，進(jìn)行仿真實(shí)驗(yàn)和硬件下載，獲得的測(cè)試結(jié)果滿(mǎn)足設(shè)計(jì)要求。由于采用
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基于FPGA的遠(yuǎn)距離測(cè)溫器數(shù)控系統(tǒng)設(shè)計(jì)

  • 摘要：介紹了遠(yuǎn)距離測(cè)溫器的結(jié)構(gòu)組成和工作原理，設(shè)計(jì)了基于FPGA的遠(yuǎn)距離測(cè)溫器數(shù)控系統(tǒng)的數(shù)據(jù)采集與控制系統(tǒng)，使用Altera公司的Cyclonell系列的FPGA實(shí)現(xiàn)了包括數(shù)據(jù)采集、數(shù)據(jù)通信等控制功能，著重?cái)⑹隽擞布c軟件的
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基于FPGA的DDS+DPLL跳頻信號(hào)源設(shè)計(jì)

  • 摘要：針對(duì)跳頻通信系統(tǒng)有固有噪聲的特點(diǎn)，結(jié)合DDS+DPLL高分辨率、高頻率捷變速度的優(yōu)點(diǎn)，并采用Altera公司的Quartus-Ⅱ_10．1軟件進(jìn)行設(shè)計(jì)綜合，提出了一種新型的跳頻信號(hào)源。結(jié)果表明，該設(shè)計(jì)中DPLL時(shí)鐘可達(dá)到12
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FPGA實(shí)現(xiàn)復(fù)接與分接系統(tǒng)

  • FPGA實(shí)現(xiàn)復(fù)接與分接系統(tǒng),引言　　近年來(lái)可編程器件的應(yīng)用日益廣泛，使用較多的是現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)和復(fù)雜可編程邏輯器件(CPLD)。FPGA器件性能優(yōu)越，使用方便，成本低廉，投資風(fēng)險(xiǎn)小，使用FPGA設(shè)計(jì)可以完全根據(jù)設(shè)計(jì)者需要開(kāi)發(fā)ASIC芯片，
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以FPGA為基礎(chǔ)的SoC驗(yàn)證平臺(tái) 自動(dòng)化電路仿真?zhèn)慑e(cuò)功

  • 隨著系統(tǒng)芯片(SoC)設(shè)計(jì)的體積與復(fù)雜度持續(xù)升高，驗(yàn)證作業(yè)變成了瓶頸：占了整個(gè)SoC研發(fā)過(guò)程中70% 的時(shí)間。因此，任何能夠降低驗(yàn)證成本并能更早實(shí)現(xiàn)驗(yàn)證sign-off的方法都是眾人的注目焦點(diǎn)。臺(tái)灣工業(yè)技術(shù)研究院 (工研院
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基于FPGA軟核的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

  • 為解決不同性能指標(biāo)數(shù)據(jù)采集系統(tǒng)開(kāi)發(fā)時(shí)間較長(zhǎng)的問(wèn)題，提出了一種將FPGA軟核技術(shù)應(yīng)用于高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)的方法。系統(tǒng)以Xilinx公司的FPGA為例設(shè)計(jì)軟核，使用VHDL語(yǔ)言對(duì)軟核進(jìn)行模塊化設(shè)計(jì)。介紹了數(shù)據(jù)采集系統(tǒng)的硬件電路、USB固件程序、USB驅(qū)動(dòng)程序以及LabVIEW上位機(jī)的設(shè)計(jì)。該數(shù)據(jù)采集系統(tǒng)結(jié)構(gòu)可移植性強(qiáng)，有利于縮短同類(lèi)型系統(tǒng)設(shè)計(jì)研發(fā)周期。
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基于FPGA的高清視頻采集與顯示系統(tǒng)設(shè)計(jì)

  • 高清視頻采集與顯示系統(tǒng)設(shè)計(jì)近年來(lái)，高清網(wǎng)絡(luò)攝像機(jī)席卷視頻監(jiān)控市場(chǎng)，傳統(tǒng)的模擬攝像機(jī)也在尋找新的出路提升圖像質(zhì)量，采用非壓縮方案的高清模擬攝像機(jī)成為首選。一般來(lái)說(shuō)，非壓縮方案的硬件平臺(tái)有DSP或ASIC或FPGA。
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如何在FPGA中實(shí)現(xiàn)圖像格式轉(zhuǎn)換

  • 　首先由同步視頻輸入MegaCore 功能來(lái)處理SDI 視頻數(shù)據(jù)。該功能將同步視頻格式數(shù)據(jù)（ 例如， BT656 或者DVI） 轉(zhuǎn)換為流控制Avalon 流（Avalon-ST） 視頻協(xié)議，實(shí)現(xiàn)與數(shù)據(jù)通路后面其他視頻處理功能的鏈接?！　〔捎?/li>
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基于89C55和FPGA的頻率特性測(cè)試儀

  • 摘要：為了能夠直接顯示待測(cè)網(wǎng)絡(luò)的幅頻相頻特性，設(shè)計(jì)了一個(gè)以89C55和FPGA構(gòu)成的最小系統(tǒng)為控制核心的頻率特性測(cè)試儀。系統(tǒng)基于DDS(直接數(shù)字頻率合成)原理和多周期同步計(jì)數(shù)相位測(cè)量法，由信號(hào)發(fā)生器，被測(cè)雙T網(wǎng)絡(luò)，真
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應(yīng)對(duì)功耗挑戰(zhàn)：晶體管技術(shù)方案面臨瓶頸

  • 在電費(fèi)占運(yùn)營(yíng)成本 (OPEX) 很大一部分，而運(yùn)營(yíng)成本則占總成本約 70% 的情況下，降低功耗對(duì)運(yùn)營(yíng)商來(lái)說(shuō)已刻不容緩。以前，芯片提供商想辦法通過(guò)晶體管和工藝技術(shù)來(lái)降低功耗。雖然晶體管是產(chǎn)生功耗的主要原因，但并非唯一因素，而且通過(guò)晶體管來(lái)降低功耗作用是有限的。
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基于FPGA的外部存儲(chǔ)器設(shè)計(jì)

  • 摘要：為了提高雷達(dá)海量數(shù)據(jù)的處理速度，采用FPGA設(shè)計(jì)了一種高速外部存儲(chǔ)器，通過(guò)多次實(shí)驗(yàn)，驗(yàn)證了設(shè)計(jì)方法的可行性。高速外部存儲(chǔ)器可以有效地提高數(shù)據(jù)存儲(chǔ)速度，節(jié)約讀／寫(xiě)時(shí)間，從而滿(mǎn)足信號(hào)處理的高速實(shí)時(shí)的要求
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FPGA為核心的多功能輸液系統(tǒng)的設(shè)計(jì)

  • FPGA為核心的多功能輸液系統(tǒng)的設(shè)計(jì),今朝醫(yī)護(hù)人員一般不能全程陪護(hù)，會(huì)給病人和醫(yī)務(wù)人員帶來(lái)良多平安隱患和未便。本文設(shè)計(jì)了一種集輸液節(jié)制、顯示、報(bào)警、語(yǔ)音通信等多種 功能的輸液節(jié)制系統(tǒng)?！　? 系統(tǒng)總體設(shè)計(jì)　　輸液監(jiān)控系統(tǒng)原理如圖1所示，包括FP
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在FPGA中實(shí)現(xiàn)圖像格式轉(zhuǎn)換的參考設(shè)計(jì)

  • 引言服務(wù)器、交換機(jī)、前端編碼器以及專(zhuān)用演播顯示器等廣播基礎(chǔ)設(shè)備系統(tǒng)支持各種輸入圖像格式，在存儲(chǔ)、...
  • 關(guān)鍵字： FPGA  圖像格式轉(zhuǎn)換  ASSP  

基于DVI和FPGA的視頻疊加器設(shè)計(jì)

  • 摘要：利用FPGA作為主控單元，以數(shù)字視頻接口DVI為視頻接口、TI公司的TFP401和TFP410為視頻信號(hào)的編解碼芯片...
  • 關(guān)鍵字： FPGA  最小化傳輸差分信號(hào)  

基于FPGA控制VGA顯示的多通道數(shù)字示波器的設(shè)計(jì)

  • 摘要：為了實(shí)現(xiàn)對(duì)0～1 MHz的信號(hào)進(jìn)行測(cè)量以及顯示的目的，制作了基于SOPC技術(shù)的VGA顯示數(shù)字存儲(chǔ)示波器。采用硬件與軟件相配合的設(shè)計(jì)方法，主要模塊有基于FPGA的最小系統(tǒng)模塊、信號(hào)調(diào)理電路模塊、AD采樣模塊、觸發(fā)電路
  • 關(guān)鍵字： FPGA  VGA  多通道  數(shù)字示波器    
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