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云中的機(jī)器學(xué)習(xí)：FPGA 上的深度神經(jīng)網(wǎng)絡(luò)

  • 憑借出色的性能和功耗指標(biāo)，賽靈思 FPGA 成為設(shè)計(jì)人員構(gòu)建卷積神經(jīng)網(wǎng)絡(luò)的首選 XE XE XE XE 。新的軟件工具可簡化實(shí)現(xiàn)工作。人工智能正在經(jīng)
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FPGA時(shí)序約束方法匯總，從易到難的都有

  • 　　從最近一段時(shí)間工作和學(xué)習(xí)的成果中，我總結(jié)了如下幾種進(jìn)行時(shí)序約束的方法。按照從易到難的順序排列如下：　　1. 核心頻率約束　　這是最基本的，所以標(biāo)號為0?！　?. 核心頻率約束+時(shí)序例外約束　　時(shí)序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但這還不是最完整的時(shí)序約束。如果僅有這些約束的話，說明設(shè)計(jì)者的思路還局限在FPGA芯片內(nèi)部。　　3. 核心頻率約束+時(shí)序例外約束+I/O約束　　I/O約束包括引腳分配位置、空閑引腳驅(qū)動(dòng)方式、外部走線延時(shí)(Inpu
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中美貿(mào)易酣戰(zhàn) 國產(chǎn)FPGA遇“天時(shí)”尚需“人和”

  • 國產(chǎn)FPGA起步較國外廠商晚30年，技術(shù)和專利基礎(chǔ)薄弱。中興事件爆發(fā)和中美貿(mào)易戰(zhàn)升級，為本土FPGA國產(chǎn)化發(fā)展帶來新的契機(jī)。
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單片機(jī)學(xué)習(xí)應(yīng)用六大重要部分

  • 一、總線：我們知道，一個(gè)電路總是由元器件通過電線連接而成的，在模擬電路中，連線并不成為一個(gè)問題，因?yàn)楦髌骷g一般是串行關(guān)系，各器件之間的連線
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一鍵看圖快速學(xué)習(xí)變頻器！

  • 在嵌入式開發(fā)中，經(jīng)常會(huì)涉及到對電機(jī)的控制，目前交流電動(dòng)機(jī)的變頻控制應(yīng)用非常廣泛，所以我們來簡單看圖介紹下變頻器 (variable-frequency drive V
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基于DSP的SoC芯片的FPGA驗(yàn)證方法

  • 引 言DSP 技術(shù)廣泛地應(yīng)用于數(shù)字信號處理領(lǐng)域, 它或者以獨(dú)立的器件形式在系統(tǒng)中出現(xiàn), 或者以IP 核的形式嵌入SoC系統(tǒng)中。而隨著集成電路技術(shù)的發(fā)展以及E
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FPGA學(xué)習(xí)及設(shè)計(jì)中的注意事項(xiàng)

  • FPGA的基礎(chǔ)就是數(shù)字電路和HDL語言，想學(xué)好FPGA的人，建議床頭都有一本數(shù)字電路的書，不管是哪個(gè)版本的，這個(gè)是基礎(chǔ)，多了解也有助于形成硬件設(shè)計(jì)的思想
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給MCU工程師詳解FPGA硬件屬性

  • 我的許多朋友都是經(jīng)驗(yàn)豐富的嵌入式設(shè)計(jì)工程師，但他們都是微控制器(MCU)背景，因此對于FPGA是什么以及FPGA能做什么只有一個(gè)模糊的概念。如果問急了，他
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FPGA牛人的經(jīng)驗(yàn)談

  • 這里我談?wù)勎业囊恍┙?jīng)驗(yàn)和大家分享，希望能對IC設(shè)計(jì)的新手有一定的幫助，能使得他們能少走一些彎路，歡迎討論!我相信ldquo;如果有夢想，就會(huì)實(shí)現(xiàn)!rd
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CRC循環(huán)冗余校驗(yàn)的原理與算法及FPGA實(shí)現(xiàn)

  • CRC基本原理在串行數(shù)據(jù)流的最有效的檢錯(cuò)方案是CRC(Cyclic Redundancy check)循環(huán)冗余檢驗(yàn)，CRC循環(huán)冗余校驗(yàn)最根本的原理就是將原始數(shù)據(jù)除以某個(gè)固定的
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不用處理器控制FPGA總線的方法

  • 許多FPGA設(shè)計(jì)使用嵌入式處理器實(shí)現(xiàn)控制。典型的解決方案是使用Nios這樣的軟處理器，雖然內(nèi)置硬處理器的FPGASoC也變得很流行了。圖1顯示的是一個(gè)典型的
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基于FPGA的設(shè)計(jì)解決物聯(lián)網(wǎng)實(shí)現(xiàn)的核心挑戰(zhàn)

  • 當(dāng)前，物聯(lián)網(wǎng)(IoT)已成為一個(gè)廣受歡迎的名詞，幾乎每一個(gè)電子設(shè)備相互連接到互聯(lián)網(wǎng)上加以使用，都被大家稱為物聯(lián)網(wǎng)。它包含了一個(gè)從智能家電、汽車到可
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FPGA和CPLD內(nèi)部自復(fù)位電路設(shè)計(jì)方案

  • 本文描述了復(fù)位的定義，分類及不同復(fù)位設(shè)計(jì)的影響，并討論了針對FPGA和CPLD的內(nèi)部自復(fù)位方案。1、定義復(fù)位信號是一個(gè)脈沖信號，它會(huì)使設(shè)計(jì)的電路進(jìn)入設(shè)
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十年FPGA開發(fā)經(jīng)驗(yàn)工程師談設(shè)計(jì)技巧

  • 從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間，至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺(tái)上完成數(shù)字秒表、搶答器、密碼鎖等實(shí)驗(yàn)時(shí)那個(gè)興奮勁。當(dāng)時(shí)由于沒有接
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如何基于EMIF接口的DSP控制系統(tǒng)設(shè)計(jì)？

  • 摘要：提出一種DSP 通過EMIF 接口控制復(fù)雜系統(tǒng)的方案。通過將DSP 芯片連接多片F(xiàn)PGA，并利用FPGA 與各種外部芯片連接，使得DSP 通過EMIF 接口就能控制
  • 關(guān)鍵字： EMIF接口  FPGA  DSP  
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