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一種基于Spartan3E的DDS優(yōu)化設(shè)計

一種基于CPLD的超聲波測厚系統(tǒng)的設(shè)計

  • 摘要:介紹了超聲波測犀以及用CPLD來實現(xiàn)測量控制與數(shù)據(jù)處理的原理,并著重介紹了一些具體的處理方法。通過溫度補償?shù)姆椒▽鞑ニ俣扔枰孕U?,系統(tǒng)能實時地測量數(shù)據(jù),具有硬件結(jié)構(gòu)簡單、工作可靠、測量誤差小等特
  • 關(guān)鍵字: CPLD  超聲波測厚  系統(tǒng)    

基于AVR和CPLD編程的高速數(shù)據(jù)采集存儲系統(tǒng)設(shè)計

從特殊應(yīng)用領(lǐng)域入手滿足FPGA客戶需求

  • FPGA未來的發(fā)展必然是以客戶需求為牽引,目前FPGA產(chǎn)品已經(jīng)進入了“應(yīng)用為王”的時代,構(gòu)建不同應(yīng)用領(lǐng)域的平臺...
  • 關(guān)鍵字: FPGA  IP  嵌入式  PLD  CPLD  SoC  數(shù)字信號處理  消費電子  FPGA  

利用CoolRunner-II CPLD設(shè)計GPS系統(tǒng)

  • GPS已在汽車、移動電話、PDA甚至手表等越來越多的產(chǎn)品中出現(xiàn)。每家GPS供應(yīng)商都推出了數(shù)十種GPS產(chǎn)品,令消費者...
  • 關(guān)鍵字: CoolRunner-II  CPLD  GPS  

基于CPLD和ARM的異步LED顯示屏控制系統(tǒng)設(shè)計

  • 基于LED技術(shù)的大屏幕顯示屏已經(jīng)廣泛用于廣場、機場、體育場館和車站等公共場所,在大屏幕上顯示文字、動畫、...
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DM642和CPLD外部中斷的寄存器式鍵盤設(shè)計

  • 摘要:介紹了一種采用DM642和CPLD相配合的擴展鍵盤方法。CPLD管理鍵盤電路中的芯片邏輯,DM642的外部中斷監(jiān)控按鍵的狀態(tài)。簡單闡述了鍵盤的分類,給出系統(tǒng)的硬件電路原理圖,在CCS軟件中調(diào)試程序方法。仿真結(jié)果表明,
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基于CoolRunner CPLD的MP3應(yīng)用開發(fā)板的設(shè)計

  • 便攜式MP3播放器作為一種集音頻播放、數(shù)據(jù)存儲為一身的數(shù)碼產(chǎn)品,其功能結(jié)構(gòu)為電子設(shè)計人員所津津樂道。新功...
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基于ARM和CPLD的嵌入式視覺系統(tǒng)設(shè)計

  • 目前,關(guān)于視覺系統(tǒng)的研究已經(jīng)成為熱點,也有開發(fā)出的系統(tǒng)可供參考。但這些系統(tǒng)大多是基于PC機的,由于算法和硬件結(jié)構(gòu)的復(fù)雜性而使其在小型嵌入式系統(tǒng)中的應(yīng)用受到了限制。上述系統(tǒng)將圖像數(shù)據(jù)采集后,視覺處理算法是
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一款基于CPLD的LED顯示屏控制電路解決方案

基于CoolRunner CPLD的MP3應(yīng)用開發(fā)板的設(shè)計與實現(xiàn)

  • 本文介紹了基于CoolRunner CPLD的MP3應(yīng)用開發(fā)板的設(shè)計流程,驗證了利用現(xiàn)有IP Core設(shè)計的可行性和高效性。在設(shè)計過程中,硬件(實驗評估板)的設(shè)計和基于IP Core的算法設(shè)計可同步進行,避免了兩者因異步帶來的設(shè)計周期的延長。實踐證明本文的設(shè)計思路和實現(xiàn)方法是一種靈活、快速、可靠地開發(fā)數(shù)字系統(tǒng)平臺的設(shè)計方案。
  • 關(guān)鍵字: CoolRunner  CPLD  MP3  應(yīng)用開發(fā)    

基于CPLD與絕對式編碼器的高精度高速伺服單元

  •  本設(shè)計已經(jīng)完成了硬件及軟件的全部設(shè)計,讀取帶有絕對式編碼器的電動機轉(zhuǎn)子的任何一個位置數(shù)據(jù)只需31μs,通信速率可達2.5Mb/s,將本設(shè)計集成在伺服驅(qū)動單元中,驅(qū)動和控制電動機轉(zhuǎn)數(shù)可達6000轉(zhuǎn)/分,控制電動機轉(zhuǎn)子的位置精度可達μM級。
  • 關(guān)鍵字: CPLD  絕對式編碼器  高精度  高速伺服單元    

基于DSP+CPLD的異步電動機控制系統(tǒng)開發(fā)平臺設(shè)計

  • 隨著電力電子技術(shù)、電機控制理論和微控制器的不斷發(fā)展,現(xiàn)代交流調(diào)速技術(shù)在國民經(jīng)濟中得到了廣泛應(yīng)用。目前,高...
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基于Verilog簡易UART的FPGA/CPLD實現(xiàn)

  • 基于Verilog簡易UART的FPGA/CPLD實現(xiàn),目標(biāo):在xo640上實現(xiàn)一個簡單的Uart,能夠解析串口數(shù)據(jù),并在寄存器中存儲,用FIFO實現(xiàn)數(shù)據(jù)的傳遞。那么后期可以通過開發(fā)板上的串口經(jīng)CPLD訪問各種數(shù)據(jù)。比如PC=CPLD=EEPROM等等,極大方便后期的開發(fā)和調(diào)試。
  • 關(guān)鍵字: FPGA/CPLD  實現(xiàn)  UART  簡易  Verilog  基于  

基于CPLD/FPGA的多串口設(shè)計與實現(xiàn)

  • 摘要:在工業(yè)控制中如何提高一對多的串口通訊可靠性和系統(tǒng)的集成性成為研究熱點。本文利用嵌入式技術(shù),提出基于CPLD/FPGA的多串口擴展設(shè)計方案。實現(xiàn)并行口到多個全雙工異步通訊口之間的轉(zhuǎn)換,并根據(jù)嵌入式系統(tǒng)實時
  • 關(guān)鍵字: CPLD  FPGA  多串口    
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