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基于CPLD和嵌入式系統(tǒng)的LED點(diǎn)陣顯示

  • 基于CPLD和嵌入式系統(tǒng)的LED點(diǎn)陣顯示,采用自頂向下的設(shè)計(jì)思想，綜合運(yùn)用EDA 技術(shù)、CPLD技術(shù)和共享式雙口RAM，解決了大屏幕LED點(diǎn)陣顯示屏無(wú)閃爍顯示的技術(shù)難題。給出了系統(tǒng)設(shè)計(jì)方法及實(shí)際電路。
  • 關(guān)鍵字： 點(diǎn)陣  顯示  LED  系統(tǒng)  CPLD  嵌入式  基于  

采用圖像傳感器的CPLD視覺(jué)系統(tǒng)設(shè)計(jì)方法

  • 采用圖像傳感器的CPLD視覺(jué)系統(tǒng)設(shè)計(jì)方法,采用圖像傳感器的CPLD視覺(jué)系統(tǒng)設(shè)計(jì)方法搭建一種低成本的嵌入式視覺(jué)系統(tǒng)，系統(tǒng)由CMOS圖像傳感器、CPLD、ARM7微處理器以及SRAM構(gòu)成。其中，CPLD識(shí)別時(shí)序，解決了圖像采集系統(tǒng)存在的嚴(yán)格時(shí)序同步和雙CPU共享一片SRAM的總
  • 關(guān)鍵字： 系統(tǒng)  設(shè)計(jì)  方法  視覺(jué)  CPLD  圖像  傳感器  采用  

基于Matlab/Simulink的滑模軟起動(dòng)器仿真研究

基于CPLD的USB總線的隔離接口實(shí)現(xiàn)

  • 本設(shè)計(jì)的主要?jiǎng)?chuàng)新點(diǎn)在于 USB總線的協(xié)議的復(fù)雜性和快速性為設(shè)計(jì)實(shí)現(xiàn)必須面對(duì)許多的挑戰(zhàn)，能在分析協(xié)議的基礎(chǔ)上利用 CPLD解決了 USB總線隔離的問(wèn)題，巧妙的檢測(cè)信息包起始、快切換和包結(jié)束的難題，克服了傳輸信息包結(jié)束慢上拉與過(guò)渡，保證系統(tǒng)的完整性。
  • 關(guān)鍵字： CPLD  USB  總線  隔離接口    

CPLD在線纜快速測(cè)試技術(shù)中的應(yīng)用

  • 1.引言隨著電子技術(shù)的發(fā)展，復(fù)雜可編程邏輯器件CPLD（ComplexProgrammableLogicDevice）以其高速、高...
  • 關(guān)鍵字： CPLD  線纜快速測(cè)試  

基于CPLD的視頻疊加

  • 上個(gè)月接到任務(wù)，要求設(shè)計(jì)一視頻鉆孔機(jī)，用攝像頭檢測(cè)孔位，腳踏開(kāi)關(guān)控制電機(jī)鉆孔。由于要對(duì)準(zhǔn)孔位，因此顯示器上要...
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基于CPLD/FPGA高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

  • 0引言傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)一般采用單片機(jī)，系統(tǒng)大多通過(guò)PCI總線完成數(shù)據(jù)的傳輸。其缺點(diǎn)是數(shù)學(xué)運(yùn)算能力差...
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基于CPLD和Embedded System的LED點(diǎn)陣顯示

  • 基于CPLD和Embedded System的LED點(diǎn)陣顯示,摘要：采用自頂向下的設(shè)計(jì)思想，綜合運(yùn)用EDA 技術(shù)、CPLD技術(shù)和共享式雙口RAM，解決了大屏幕LED點(diǎn)陣顯示屏無(wú)閃爍顯示的技術(shù)難題。給出了系統(tǒng)設(shè)計(jì)方法及實(shí)際電路。LED點(diǎn)陣顯示屏是顯示公共信息的一種重要顯示終端，其中
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基于DSP與CPLD的多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

  • 基于DSP與CPLD的多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì),用于實(shí)時(shí)控制系統(tǒng)的嵌入式系統(tǒng)經(jīng)常需要對(duì)模擬量進(jìn)行測(cè)量，通常的方法是以MCU為主產(chǎn)生采集控制時(shí)序控制模數(shù)轉(zhuǎn)換器，并通過(guò)中斷或查詢(xún)的方式讀取轉(zhuǎn)換后的結(jié)果。由MCU產(chǎn)生采集控制時(shí)序?qū)⒄加幂^多的系統(tǒng)軟硬件資源。而在
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基于DSP的視頻采集存儲(chǔ)系統(tǒng)的研究與設(shè)計(jì)

  • 數(shù)字圖象處理技術(shù)在電子通信與信息處理領(lǐng)域得到了廣泛的應(yīng)用，設(shè)計(jì)一種功能靈活、使用方便、便于嵌入到系統(tǒng)中...
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基于DSP+CPLD的智能IED設(shè)計(jì)

  • 基于DSP+CPLD的智能IED設(shè)計(jì),本文的設(shè)計(jì)師基于DSP和CPLD搭建的智能IED(Intelligent Electronic Device，智能電力監(jiān)測(cè)裝置)可以同時(shí)采集多路信號(hào)，并通過(guò)FFT算法得到電網(wǎng)運(yùn)行的關(guān)鍵數(shù)據(jù)?！　』贗EC61850的智能變電站的邏輯如圖1所示。IEC61850協(xié)
  • 關(guān)鍵字： IED  設(shè)計(jì)  智能  CPLD  DSP  基于  

基于CPLD系統(tǒng)的信號(hào)發(fā)生器設(shè)計(jì)

  • 摘要：文中采用Quartus II開(kāi)發(fā)平臺(tái)，基于可編程邏輯器件CPLD設(shè)計(jì)出多波形信號(hào)發(fā)生器，可輸出頻率、幅度可調(diào)的三角波、正弦波和方波。任意波形模塊可由用戶(hù)輸出用戶(hù)所需的特殊波形，滿(mǎn)足了教學(xué)實(shí)驗(yàn)和開(kāi)發(fā)新的實(shí)驗(yàn)項(xiàng)目
  • 關(guān)鍵字： CPLD  系統(tǒng)  信號(hào)發(fā)生器    

基于CPLD／PPGA的出租車(chē)計(jì)費(fèi)系統(tǒng)

  • 介紹了出租車(chē)計(jì)費(fèi)器系統(tǒng)的組成及工作原理，簡(jiǎn)述了在EDA平臺(tái)上用單片CPLD器件構(gòu)成該數(shù)字系統(tǒng)的設(shè)計(jì)思想和實(shí)現(xiàn)過(guò)程。論述了車(chē)型調(diào)整模塊、計(jì)程模塊、計(jì)費(fèi)模塊、譯碼動(dòng)態(tài)掃描模塊等的設(shè)計(jì)方法與技巧。

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基于CPLD／FPGA的USB讀寫(xiě)控制器

  • 引言
    隨著計(jì)算機(jī)科技的發(fā)展，無(wú)紙辦公日益成為各單位日常辦公的主要形式。而隨著USB存儲(chǔ)設(shè)備日益廣泛的使用，數(shù)據(jù)泄漏的危害也越來(lái)越嚴(yán)重。因此在單位內(nèi)部對(duì)USB存儲(chǔ)設(shè)備的操作權(quán)限進(jìn)行控制是很有必要的。
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降低CPLD的功耗的嵌入式應(yīng)用

  • 　引言　　從事便攜式或手持產(chǎn)品設(shè)計(jì)的工程師都明白，在如今的設(shè)計(jì)中，必須要最大限度地降低功耗。但是，只有經(jīng)驗(yàn)豐富的工程師理解盡可能地延長(zhǎng)系統(tǒng)的電池壽命的那些微妙但又重要的細(xì)節(jié)。本文中我們將重點(diǎn)放在這些經(jīng)
  • 關(guān)鍵字： CPLD  功耗  嵌入式應(yīng)用    
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