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FPGA/CPLD設(shè)計思想與技巧

  • FPGA/CPLD設(shè)計思想與技巧,　　本文討論的四種常用FPGA/CPLD設(shè)計思想與技巧：乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化，都是FPGA/CPLD邏輯設(shè)計的內(nèi)在規(guī)律的體現(xiàn)，合理地采用這些設(shè)計思想能在FPGA/CPLD設(shè)計工作中取得事半功倍的效果?！?/li>
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基于ARM7和CPLD的數(shù)字公交站亭系統(tǒng)設(shè)計

  • 基于ARM7和CPLD的數(shù)字公交站亭系統(tǒng)設(shè)計, 摘要：提出了一種基于ARM7 和CPLD 架構(gòu)的數(shù)字公交站亭系統(tǒng)。系統(tǒng)通過GPRS 模塊與公交控制中心實時通信，使用CA 認(rèn)證保證通信的安全性，采用兩塊SRAM 組成具有“乒乓邏輯”的高速緩存確保顯示數(shù)據(jù)的連續(xù)性
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基于MAX7000系列CPLD的數(shù)據(jù)采集系統(tǒng)

  • CPLD是復(fù)雜的PLD，專指那些集成規(guī)模大于1000門以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路...
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基于CPLD技術(shù)的槍械電磁扳機(jī)控制儀設(shè)計

  • 針對目前靶場測試領(lǐng)域尤其是外彈道測試通常采用人工擊發(fā)槍械的方式，存在安全性差、無法精確控制等問題，設(shè)計一種基于CPLD技術(shù)的槍械電磁扳機(jī)控制儀。采用步進(jìn)電機(jī)作為執(zhí)行單元，CPLD作為主控制器實現(xiàn)邏輯控制、通信功能。設(shè)計中著重考慮了電磁兼容及安全性，通過機(jī)械及電氣兩部分聯(lián)鎖確?？刂苾x無誤觸發(fā)。通過靶場試驗，該控制儀能夠適應(yīng)靶場電磁環(huán)境，而且對其他儀器無干擾，其通信功能還可實現(xiàn)整體測試系統(tǒng)的同步性、自動化、網(wǎng)絡(luò)化及遠(yuǎn)程控制。
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利用CPLD實現(xiàn)數(shù)字濾波及抗干擾

  • 利用CPLD實現(xiàn)數(shù)字濾波及抗干擾,1 濾波和抗干擾概述

    單片機(jī)應(yīng)用系統(tǒng)的輸入信號常含有種種噪聲和干擾，它們來自被測信號源、傳感器、外界干擾源等。為了提高測量和控制精度，必須消除信號中的噪聲和干擾。噪聲有兩大類：一類為周期性的；另一類為
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基于MAX7000系列CPLD的數(shù)據(jù)采集系統(tǒng)

  • 基于MAX7000系列CPLD的數(shù)據(jù)采集系統(tǒng),CPLD是復(fù)雜的PLD，專指那些集成規(guī)模大于1000門以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路、輸出宏單元組成，具有門電路集成度高、可配置為多種輸入輸出形式、多時鐘驅(qū)動、內(nèi)含ROM或FLASH(部分支持在系
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基于AVR和CPLD的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計

  • 輸入系統(tǒng)的信息大多數(shù)是模擬量，為使計算機(jī)能夠處理這些模擬量，必須經(jīng)由數(shù)據(jù)采集系統(tǒng)將模擬量轉(zhuǎn)化為數(shù)字量...
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利用電阻觸摸屏和CPLD來實現(xiàn)多點觸摸系統(tǒng)的替代

  • 　觸摸屏是成熟的技術(shù)，最基本、也是最常用的是4/5線電阻觸摸屏。很多標(biāo)準(zhǔn)屏支持多種尺寸，可以選擇多種解碼模擬解決方案。電阻觸摸屏支持多種輸入方法，比如手指、觸摸筆、手套和指甲等等。電容觸摸屏是一種新的解決
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基于VHDL 的矩陣鍵盤及顯示電路設(shè)計

  • 摘　要:為了有效防止機(jī)械式鍵盤按鍵抖動帶來的數(shù)據(jù)錯誤,這里在Quartus Ⅱ開發(fā)環(huán)境下,采用VHDL 語言設(shè)計了一種能夠?qū)C(jī)械式4 times;4 矩陣鍵盤的按鍵值依次顯示到8 個7 段數(shù)碼管上的矩陣鍵盤及顯示電路。仿真結(jié)果表
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基于CPLD內(nèi)部的反向器實現(xiàn)振蕩器應(yīng)用

  • 　　摘要：使用CPLD內(nèi)部的資源施密特觸發(fā)器和反相器,只需外加一個RC就可以設(shè)計出一個穩(wěn)定的振蕩器，為CPLD或外圍器件提供時鐘源。靈活方便的設(shè)計及低成本的特性，使之具有很好的產(chǎn)品商業(yè)使用價值。 　　關(guān)鍵字：CPLD;施密特觸發(fā)器;振蕩器 　　前言 　　電子技術(shù)的飛速發(fā)展，尤其是消費類電子產(chǎn)品在成本、產(chǎn)品功能及品質(zhì)的更高要求，使消費類電子產(chǎn)品的設(shè)計不是簡單地要求設(shè)計出來，而是要考慮低成本高品質(zhì)。 CPLD的成本低，占用PCB面積小，功耗低和靈活的后期可編程特性在嵌入式設(shè)計中得到越來越廣泛的應(yīng)用。
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FPGA/CPLD狀態(tài)機(jī)的穩(wěn)定性設(shè)計

  • FPGA/CPLD狀態(tài)機(jī)的穩(wěn)定性設(shè)計,　　隨著大規(guī)模和超大規(guī)模FPGA/CPLD器件的誕生和發(fā)展,以HDL(硬件描述語言)為工具、FPGA/CPLD器件為載體的EDA技術(shù)的應(yīng)用越來越廣泛.從小型電子系統(tǒng)到大規(guī)模SOC(Systemonachip)設(shè)計,已經(jīng)無處不在.在FPGA/CPLD設(shè)計中,狀
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基于AVR和CPLD的高速數(shù)據(jù)采集系統(tǒng)

  • 為了提高數(shù)據(jù)采集卡的速度，同時降低成本，設(shè)計一種并行數(shù)據(jù)采集系統(tǒng)，要求并行采集速度大于10 Mb／s。整個系統(tǒng)由AVR與CPLD控制實現(xiàn)，通過MAXl308完成模數(shù)轉(zhuǎn)換，并設(shè)計搭建了其外圍電路。采用12路數(shù)據(jù)存儲模式存儲高速采集的數(shù)據(jù)。實驗依據(jù)存儲要求搭建硬件電路并調(diào)試，示波器顯示的波形結(jié)果8組脈沖序列完全對齊，沒有出現(xiàn)時序混亂，同時并行處理過程中不相互影響，實現(xiàn)了低成本高速多路采集的設(shè)計要求。
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單片機(jī)和CPLD的望遠(yuǎn)鏡伺服控制器設(shè)計

  • 摘要：設(shè)計基于高速單片機(jī)C8051F120和CPLD的高精度大型望遠(yuǎn)鏡的伺服控制器，由單片機(jī)實現(xiàn)閉環(huán)控制算法、上位機(jī)通信和LCD顯示控制，CPLD實現(xiàn)增量式編碼器計數(shù)、電機(jī)驅(qū)動波形發(fā)生以及I／O接口。該控制器可獨立進(jìn)行電機(jī)
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一種基于CPLD的聲發(fā)射信號傳輸系統(tǒng)設(shè)計

  • 聲發(fā)射技術(shù)是光纖傳感技術(shù)和聲發(fā)射技術(shù)相結(jié)合的產(chǎn)物，是目前聲發(fā)射技術(shù)的發(fā)展趨勢。它將高靈敏度聲發(fā)射傳...
  • 關(guān)鍵字： CPLD  FPGA  信號傳輸  聲發(fā)射  
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