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EEPW首頁 >> 主題列表 >> cpld-pci接口

基于CPLD／FPGA的CMI編碼設計與實現(xiàn)

  • 根據(jù)CMI碼的特性，介紹了一種新的編程思路實現(xiàn)CMI編碼，在Max+PlusⅡ開發(fā)平臺上使用VHDL編程實現(xiàn)CMI編碼，并得到仿真波形。實驗結果表明，這種編程思路簡單、清晰。在產(chǎn)生7位偽隨機序列的前提下，分別對“O”，“1”進行編碼。這種思路為其他碼型設計提供了參考。
  • 關鍵字： CPLD  FPGA  CMI  編碼    

一種基于CPLD的壓電生物傳感器檢測電路的設計

  • 本文介紹了一種基于復雜可編程邏輯器件(CPLD)的壓電生物傳感器檢測電路.該檢測電路以高性能CPLD(MAX7128)為核心,實現(xiàn)了對壓電生物傳感器10MHz高頻信號的測量與采集,以及所采集的頻率數(shù)據(jù)動態(tài)、實時顯示以及頻率數(shù)據(jù)串行通信等功能.該電路體積小、集成度高,具有可靠性高、實時性高的特點.此外該系統(tǒng)還可以通過RS-232串行接口與計算機連接進行數(shù)據(jù)傳輸和數(shù)據(jù)存儲及分析.詳細闡明了系統(tǒng)整體結構設計以及系統(tǒng)硬件部分的實現(xiàn),并給出了CPLD內(nèi)核仿真結果和數(shù)據(jù)采集軟件實測頻率曲線.
  • 關鍵字： 檢測  電路  設計  傳感器  生物  CPLD  壓電  基于  功率模塊  

使用用CPLD和Flash實現(xiàn)FPGA的配置

  • 電子設計自動化EDA(ElectronicDesignAutomation)是指以計算機為工作平臺，以EDA軟件為開發(fā)環(huán)境，以硬件描...
  • 關鍵字： CPLD  FPGA  Flash  RAM  EDA  VHDL  

基于CPLD器件的單穩(wěn)態(tài)脈沖展寬電路的設計

  • 在數(shù)字電路設計中，當需要將一輸入的窄脈沖信號展寬成具有一定寬度和精度的寬脈沖信號時，往往很快就想到利...
  • 關鍵字： FPGA  CPLD  寬脈沖信號  ISP  

一種基于EP2SGX系列FPGA的PCI接口設計

  • 0引言在現(xiàn)代雷達數(shù)據(jù)處理系統(tǒng)和其他應用系統(tǒng)中，傳統(tǒng)的ISA、EISA等總線已逐漸無法適應高速數(shù)據(jù)傳...
  • 關鍵字： FPGA  EP2SGX  PCI接口  雷達  數(shù)據(jù)處理  

一種基于VC++程序的FPGA重配置方案設計

  • 引言隨著大規(guī)模集成電路的快速發(fā)展，系統(tǒng)設計已從傳統(tǒng)的追求大規(guī)模、高密度逐漸轉向提高資源利用率，...
  • 關鍵字： FPGA  VC++  DSP  CPCI  CPLD  

CPLD設計的CCD信號發(fā)生器技術

  • CPLD設計的CCD信號發(fā)生器技術,本文設計了一種基于CPLD的可編程高精度CCD信號發(fā)生器。充分利用CPLD的可編程性．模擬出滿足系統(tǒng)要求的CD信號，輸出信號頻率達到1IMHZ。1 引言

    CCD (Charge Coupled Devices)電荷藕合器件是20世紀70年代初發(fā)展起來
  • 關鍵字： 技術  信號發(fā)生器  CCD  設計  CPLD  

CPLD設計的驅動數(shù)碼顯示電路案例

  • CPLD設計的驅動數(shù)碼顯示電路案例,顯示原理：
    八段數(shù)碼顯示管如圖1.1 所示，八段數(shù)碼管每一段為一發(fā)光二極管，共有a～g 以及小數(shù)點dp 八個發(fā)光二極管。將八段數(shù)碼管中的每個二極管的陰極并聯(lián)在一起，組成公共陰極端。這樣把共陰極管腳接地，此時
  • 關鍵字： 電路  案例  顯示  數(shù)碼  設計  驅動  CPLD  

一種基于CPLD的DSP人機接口模塊設計

  • CPLD(ComplexprogrammableLogicDevice，復雜可編程邏輯器件)是在傳統(tǒng)的PAL、GAL基礎上發(fā)展而來的，具有...
  • 關鍵字： CPLD  DSP  人機接口模塊  

利用VHDL語言進行可變速彩燈控制器的設計

  • 0引言硬件描述語言(HDL)是相對于一般的計算機軟件語言如C，Pascal而言的。HDL是用于設計硬件電子系...
  • 關鍵字： VHDL  FPGA  CPLD  可變速  彩燈控制器  

常用FPGA/CPLD四種設計技巧

  • 常用FPGA/CPLD四種設計技巧,FPGA/CPLD的設計思想與技巧是一個非常大的話題，本文僅介紹一些常用的設計思想與技巧，包括乒乓球操作、串并轉換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導日
  • 關鍵字： 技巧  設計  FPGA/CPLD  常用  

基于VHDL/CPLD的I2C串行總線控制器設計及實現(xiàn)

  • 分析了I2C串行總線的數(shù)據(jù)傳輸機制，用VHDL設計了串行總線控制電路，其中包括微處理器接口電路和I2C總線接口電路。采用ModelSim Plus 6.0 SE軟件進行了前仿真和調(diào)試,并在Xilinx ISE 7.1i開發(fā)環(huán)境下進行了綜合、后仿真和CPLD器件下載測試。 結果表明實現(xiàn)了I2C串行總線協(xié)議的要求。
  • 關鍵字： 控制器  設計  實現(xiàn)  總線  串行  VHDL/CPLD  I2C  基于  

利用FPGA和CPLD數(shù)字邏輯實現(xiàn)ADC

  • 數(shù)字系統(tǒng)的設計人員擅長在其印制電路板上用FPGA和CPLD將各種處理器、存儲器和標準的功能元件粘合在一起來實現(xiàn)數(shù)字設計。除了這些數(shù)字功能之外，F(xiàn)PGA和CPLD還可以使用LVDS輸入、簡單的電阻電容(RC)電路和一些FPGA或CP
  • 關鍵字： FPGA  CPLD  ADC  數(shù)字邏輯    
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