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利用P89C669的23 b的線性地址并采用CPLD外部擴(kuò)展設(shè)備

P89C669是PHILIPS半導(dǎo)體一款51MX(存儲器擴(kuò)展)內(nèi)核的微處理器，其指令執(zhí)行速度2倍于標(biāo)準(zhǔn)的80C51器件，線性地址經(jīng)擴(kuò)展后可支持高達(dá)8 MB的程序存儲器和8 MB的數(shù)據(jù)存儲器，這是他相對于標(biāo)準(zhǔn)51內(nèi)核的最大優(yōu)點(diǎn)。目前的單片
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應(yīng)用于晶體管圖示儀的CPLD控制器設(shè)計(jì)

晶體管圖示儀是電路設(shè)計(jì)中常用的電子儀器，它能夠顯示晶體管的輸入特性、輸出特性和轉(zhuǎn)移特性等多種曲線和參數(shù)。它不僅可以測量晶體二極管和三極管，還可以測量場效應(yīng)管、隧道二極管、單結(jié)晶體管、可控硅和光耦
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基于單片機(jī)和CPLD實(shí)時(shí)數(shù)據(jù)采集顯示系統(tǒng)設(shè)計(jì)

數(shù)據(jù)采集是對信號處理的重要手段。針對導(dǎo)引頭電壓的檢測需求，提出一種實(shí)時(shí)數(shù)據(jù)采集顯示系統(tǒng)設(shè)計(jì)方法，給出信號預(yù)處理電路，應(yīng)用可編程邏輯器件EPM7128SLC和8路模擬多路選擇器ADG508A實(shí)現(xiàn)采集信號的選通設(shè)計(jì)，介紹單片機(jī)80C196KB內(nèi)A／D轉(zhuǎn)換器在采集電路中的使用方法，使用雙端口存儲器IDT7130實(shí)現(xiàn)數(shù)據(jù)的雙機(jī)傳輸，在并口EPP模式下，采用WDM驅(qū)動方式，完成采集數(shù)據(jù)實(shí)時(shí)讀取和顯示。通過實(shí)踐證明，該系統(tǒng)能夠滿足多通道電壓采集實(shí)時(shí)顯示要求，電路設(shè)計(jì)方法簡單，可靠性高，且采集通道具有擴(kuò)展性。
關(guān)鍵字：顯示系統(tǒng) 設(shè)計(jì) 數(shù)據(jù)采集實(shí)時(shí) 單片機(jī) CPLD 基于

基于DSP的運(yùn)動控制器的開發(fā)

基于DSP的運(yùn)動控制器的開發(fā), 運(yùn)動控制器是一種用于多種運(yùn)動控制場合的上位控制單元，通常采用專業(yè)運(yùn)動控制芯片或高速DSP來控制步進(jìn)電機(jī)或伺服電機(jī)。運(yùn)動控制器與PC機(jī)構(gòu)成主從結(jié)構(gòu)。PC機(jī)負(fù)責(zé)人機(jī)交互界面的管理和控制系統(tǒng)的實(shí)時(shí)監(jiān)控工作；控制
關(guān)鍵字：開發(fā) 控制器運(yùn)動 DSP 基于光學(xué)工程，運(yùn)動控制器，DSP，CPLD

基于CPLD的高速存儲設(shè)計(jì)

O 引言
信息存儲是信息科學(xué)研究的重要內(nèi)容之一。在信號處理、智能儀器及工業(yè)自動控制等領(lǐng)域都存在著信息存儲的內(nèi)容。隨著技術(shù)的不斷發(fā)展，對數(shù)據(jù)信息存儲的速度要求越來越高，因此，數(shù)據(jù)高速存儲在系統(tǒng)設(shè)計(jì)過程
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基于CPLD的光伏逆變器鎖相及保護(hù)電路設(shè)計(jì)

0 引言
在光伏并網(wǎng)系統(tǒng)的逆變器電路中，對電網(wǎng)電壓的鎖相是一項(xiàng)關(guān)鍵技術(shù)。由于電力系統(tǒng)在工作時(shí)會產(chǎn)生較大的電磁干擾，因此，其簡單的鎖相方法很容易受到干擾而失鎖，從而導(dǎo)致系統(tǒng)無法正常運(yùn)行。在這種情況下
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便攜式產(chǎn)品具有低功耗意識的FPGA設(shè)計(jì)方法

ILGOO系列低功耗FPGA產(chǎn)品Actel公司的ILGOO系列器件是低功耗FPGA產(chǎn)品，是在便攜式產(chǎn)品設(shè)計(jì)中替代ASIC...
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一種基于CPLD的交通燈控制系統(tǒng)設(shè)計(jì)

0 引言
隨著我國經(jīng)濟(jì)的快速發(fā)展，車輛擁有量也隨之急劇增加，再加上人口數(shù)量的膨脹，城市的交通擁擠問題變得日益突出。如何使交通燈的控制更加合理，使現(xiàn)有的交通資源發(fā)揮更大的效益，已經(jīng)成為城市管理者和科
關(guān)鍵字：設(shè)計(jì) 控制系統(tǒng) 交通 CPLD 基于 CPLD

基于CPLD/FPGA的多功能分頻器的設(shè)計(jì)與實(shí)現(xiàn)

引言分頻器在CPLD/FPGA設(shè)計(jì)中使用頻率比較高,盡管目前大部分設(shè)計(jì)中采用芯片廠家集成的鎖相環(huán)資源 ,但是對于要求奇數(shù)倍分頻（如3、5等）、小數(shù)倍（如2.5、3.5等）分頻、占空比50%的應(yīng)用場合卻往往不能滿足要求。
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基于CPLD和Embedded System的LED點(diǎn)陣顯示系統(tǒng)的實(shí)

　LED點(diǎn)陣顯示屏是顯示公共信息的一種重要顯示終端，其中大屏幕LED點(diǎn)陣顯示屏在許多場合得以應(yīng)用。大屏幕顯示所采用的技術(shù)比中小屏幕顯示難度更大，因?yàn)槠淦聊淮蟆ED點(diǎn)數(shù)多，要求在極短的時(shí)間內(nèi)刷新每個(gè)點(diǎn)，使得其掃
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基于CPLD的脈沖密度功率調(diào)節(jié)高頻逆變電源

目前高頻感應(yīng)加熱電源的輸出功率調(diào)整主要是通過改變逆變器的輸出頻率或改變逆變器的輸入直流電壓方式來實(shí)現(xiàn)的，這種方法開關(guān)損耗大。該設(shè)計(jì)采用CPLD實(shí)現(xiàn)一種脈沖均勻密度的功率調(diào)節(jié)式100 kHz串聯(lián)諧振逆變電源，在逆變橋進(jìn)行功率調(diào)節(jié)，彌補(bǔ)了這一缺點(diǎn)。以往脈沖密度調(diào)節(jié)方式的實(shí)現(xiàn)主要通過計(jì)數(shù)器等模擬電路實(shí)現(xiàn)，該設(shè)計(jì)采用CPLD實(shí)現(xiàn)，具有控制電路簡單，可靠性高等優(yōu)點(diǎn)。在此介紹了脈沖均勻調(diào)制的原理及其CPLD的設(shè)計(jì)實(shí)現(xiàn)，給出了CPLD程序模塊圖以及仿真波形和試驗(yàn)結(jié)果，證明了本設(shè)計(jì)的可行性。
關(guān)鍵字：調(diào)節(jié) 高頻逆變電源功率密度 CPLD 脈沖基于

三線制同步串行通信控制器接口設(shè)計(jì)

0 引言
航天工程領(lǐng)域中，星地通訊等遠(yuǎn)距離遙測遙控是嵌入式衛(wèi)星數(shù)管計(jì)算機(jī)重要功能之一，利用三線制同步串行遙測遙控通道對指令和數(shù)據(jù)進(jìn)行收發(fā)操作是通信鏈路的重要環(huán)節(jié)。
目前許多處理器芯片都已集成了
關(guān)鍵字：接口設(shè)計(jì) 控制器通信同步串行三線 PLD CPLD FPGA

一種基于CPLD的單片機(jī)與PCI接口設(shè)計(jì)方案

0引言8位單片機(jī)在嵌入式系統(tǒng)中應(yīng)用廣泛，然而讓它直接與PCI總線設(shè)備打交道卻有其固有缺陷。8位單片機(jī)...
關(guān)鍵字： CPLD 單片機(jī) PCI接口設(shè)計(jì)

Altera公司今天宣布推出Quartus II軟件9.1

　　Altera公司今天宣布推出Quartus® II軟件9.1——在CPLD、FPGA和HardCopy® ASIC設(shè)計(jì)方面，業(yè)界性能和效能最好的軟件。與以前的軟件版本相比，Quartus II軟件9.1新特性和增強(qiáng)功能將編譯時(shí)間縮短了20%，編譯時(shí)間比競爭高密度40-nm和65-nm設(shè)計(jì)仍然快2到3倍。軟件新特性是快速重新編譯，對于較小的設(shè)計(jì)改動，這一特性大大縮短了編譯時(shí)間，而且還支持Altera最新發(fā)布的Cyclone®IV FPGA。　　Quar
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Altera增強(qiáng)MAX II系列，進(jìn)一步拓展其CPLD應(yīng)用

　　Altera公司今天宣布，提供工業(yè)級溫度范圍以及功耗更低的MAX IIZ器件，從而進(jìn)一步增強(qiáng)了MAX II® CPLD系列。MAX IIZ CPLD完美的結(jié)合了邏輯密度、I/O和小外形封裝，靜態(tài)功耗降低了55%，非常適合低成本和低功耗應(yīng)用。這些新功能拓展了MAX IIZ CPLD的市場應(yīng)用，例如工業(yè)、計(jì)算機(jī)和辦公自動化、醫(yī)療和消費(fèi)類等領(lǐng)域。　　Altera公司器件產(chǎn)品市場資深總監(jiān)Luanne Schirrmeister評論說：“Altera第一次在市場上推出MAX IIZ CP
關(guān)鍵字： Altera CPLD MAX IIZ