- 在系統(tǒng)設計時,各個網(wǎng)絡的頻率特性對該系統(tǒng)的穩(wěn)定性、工作頻帶、傳輸特性等都具有重要影響。實際操作中,掃頻儀大大簡化了測量操作,提高了工作效率,達到了測量過程快速、直觀、準確、方便的目的,在生產(chǎn)、科研、教學上得到廣泛運用。
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頻率特性 掃頻儀 FPGA
- 在通信和控制系統(tǒng)中,常使用異步串行通信控制器(UART)實現(xiàn)系統(tǒng)輔助信息的傳輸。為實現(xiàn)多點通信,通常用軟件識別發(fā)往本站點或其它站點的數(shù)據(jù),這會加大CPU的開銷。介紹了一種基于FPGA的UART IP,由硬件實現(xiàn)多點通信時的數(shù)據(jù)過濾功能,降低了CPU的負擔,提高了系統(tǒng)性能。
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UART IP FPGA
- 在FPGA/CPLD設計中,狀態(tài)機是最典型、應用最廣泛的時序電路模塊,如何設計一個穩(wěn)定可靠的狀態(tài)機是我們必須面對的問題.
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時序電路 狀態(tài)機 FPGA
- 時延估計是雷達、聲納等領域經(jīng)常遇到的一個問題,提出了利用相關計算法實現(xiàn)時延估計,并通過互譜插值提高估計精度。結合FPGA器件特性,運用VHDL語言編程,實現(xiàn)了整個相關算法。利用QuartusⅡ和Mat
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時延估計 估計精度 FPGA 內(nèi)插
- 面對似乎層出不窮的新 I/O 標準,目前嵌入式系統(tǒng)設計人員繼續(xù)依靠 FPGA 來部署系統(tǒng)日益重要的外部 I/O 接口.
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IO標準 可配置 FPGA
- 相對其他成熟的計算機體系,SOPC系統(tǒng)現(xiàn)在還沒有命令行。為了更好的推廣SOPC應用,筆者開發(fā)了一個智能的命令行模塊,可以調(diào)用系統(tǒng)中的任意函數(shù),降低了開發(fā)人員的使用難度。
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SOPC 命令行 FPGA
- 顯示器因為其輸出信息量大,輸出形式多樣等特點已經(jīng)成為現(xiàn)在大多數(shù)設計的常用輸出設備。在 FPGA 的設計中可以使用很少的資源,就產(chǎn)生 VGA 各種控制信號。這個示例在 RHicSP2200B FPGA 開發(fā)板/學習板上使用 VGA 接口在顯示器上顯示了文字以及簡單的圖形,可以作為VGA 顯示設計的參考,如果在使用這個例子的過程
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VGA 接口 FPGA
- 據(jù)估計,目前盛行的假冒電子產(chǎn)品已經(jīng)占到整個市場份額的10%,這一數(shù)據(jù)得到了美國反灰色市場和反假冒聯(lián)盟(AGMA)的支持。AGMA是由惠普、思科和其它頂級電子OEM公司組成的一個行業(yè)組織。據(jù)該組織估計,制造商因盜版造成的損失超過1000億美元,而對最終用戶來說,信譽損毀和可靠性問題帶來的隱性成本則更難以確定。
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AGMA 可編程邏輯 FPGA
- 隨著數(shù)據(jù)存儲量的日益加大以及存儲速度的加快,大容量的高速存儲變得越來越重要。內(nèi)存條既能滿足大容量的存儲又能滿足讀寫速度快的要求,這樣使得對內(nèi)存條控制的應用越來越廣泛。首先介紹了內(nèi)存條的工作原理,內(nèi)存條電路設計的注意事項,以及如何使用FPGA實現(xiàn)對DDR內(nèi)存條的控制,最后給出控制的仿真波形。
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DDR 內(nèi)存條 FPGA
- 隨著信息技術的發(fā)展,基于微處理器的數(shù)字信號處理在測控、通訊、雷達等各個領域得到廣泛的應用。被處理的模擬信號也在向高頻、寬帶方面發(fā)展,但這需要高速、高分辨率的數(shù)字采集卡以將模擬信號數(shù)字化。美國國家半導體公司新推出的系列高速、高分辨率模/數(shù)轉換器(如CLC5958)就非常適用于需要高速、高分辨率的信號采集系統(tǒng)。
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CLC5958型 A/D轉換器 FPGA PCI
- 采用ARM+FPGA結構給出一種高性能的便攜式食用花生油質(zhì)量快速分析儀的設計。將可編程片上系統(tǒng)應用到儀器開發(fā)中,簡化系統(tǒng)硬件電路,提高系統(tǒng)設計靈活性。充分利用ARM芯片的高效控制功能結合FPGA靈活的多硬件接口模擬特性,便于攜帶,適合現(xiàn)場免化學試劑快速檢測。
- 關鍵字:
ARM 檢測儀 FPGA
- 全自動焦度儀光學系統(tǒng)是產(chǎn)品設計的核心,為了提高自動焦度計的測量精度,提出一種新的測量圖像。該圖像在建立了16點數(shù)學模型并推導了鏡片相關參數(shù)的計算方法。該算法將16個點分為四組進行計算,并取各組計算結果
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自動焦度計 16點數(shù)學模型 FPGA 面陣CCD
- 0 引 言 本系統(tǒng)以AD7892SQ和CPLD(復雜可編程邏輯器件)為核心設計了一個多路信號采集電路,包括模擬多路復用、集成放大、A/D轉換,CPLD控制等。采用硬件描述語言V
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EDA CPLD FPGA
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