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何謂SOPC

SOPC一詞主要是源自Altera, 其涵義是因為目前CPLD/FPGA的容量愈來愈大, 性能愈來愈好, 加上價格下跌的推波助瀾之下, 以往ASIC產(chǎn)品才能具有的 SoC觀念, 也能移植到CPLD/FPGA上, 并且因為CPLD/FPGA的可編程(Programmable)能力, 使得CPLD/FPGA不僅能實現(xiàn)一個高復(fù)難度的系統(tǒng), 而且還能快速改變系統(tǒng)的特性. 類似的觀念也鑒于Xilinx的Platfor
關(guān)鍵字： SOPC CPLD FPGA SoC ASIC

基于狀態(tài)機的語音電子密碼鎖設(shè)計

　　引言　　隨著電子技術(shù)的發(fā)展，具有防盜報警、語音提示等功能的電子密碼鎖代替密碼量少、安全性差的機械式密碼鎖已是必然趨勢。目前大部分密碼鎖采用單片機進行設(shè)計，電路較復(fù)雜，性能不夠靈活。本文采用先進的EDA(電子設(shè)計自動化)技術(shù)，利用QuartusⅡ工作平臺和VHDL(超高速集成電路硬件描述語言)，設(shè)計了一種新型的電子密碼鎖。該密碼鎖具有密碼預(yù)置、修改、語音提示和3次輸入錯誤則系統(tǒng)進入定時鎖定并報警等功能，用FPGA(現(xiàn)場可編程門陣列)芯片和語音芯片ISD2560實現(xiàn)。由于充分利用了FPGA芯片密度大
關(guān)鍵字：工業(yè)控制 FPGA 電子密碼鎖 VHDL 遙控技術(shù)

Altera面向低成本FPGA收發(fā)器設(shè)計發(fā)售Arria GX開發(fā)套件

　　Altera宣布開始提供Arria™ GX FPGA系列的第一款開發(fā)套件，該系列是唯一帶有收發(fā)器的無風險、低成本FPGA。Arria GX開發(fā)套件為PCI Express (PCIe)、Serial RapidIO® (SRIO)和千兆以太網(wǎng)(Gbe)等高速串行接口設(shè)計提供了可靠的開發(fā)和測試環(huán)境。套件幫助系統(tǒng)設(shè)計人員大大降低了成本，節(jié)省了設(shè)計時間。系統(tǒng)設(shè)計人員可以利用該套件作為自己設(shè)計的起點。　　Arria GX開發(fā)套件面向PCIe x1和x4、SRIO以及千兆以太網(wǎng)設(shè)計。它包
關(guān)鍵字：嵌入式系統(tǒng) 單片機 Altera FPGA MCU和嵌入式微處理器

GiDEL在最新的開發(fā)系統(tǒng)中采用Altera的Stratix FPGA系列

　　Altera宣布，GiDEL的新一代PROC算法加速板和PROCxM原型開發(fā)系統(tǒng)的PC_X8 PCI Express (PCIe)適配器采用了Stratix® II、Stratix II GX和Stratix III FPGA。高性能Altera® Stratix FPGA使GiDEL能夠在新的PCIe應(yīng)用和設(shè)計人員開發(fā)系統(tǒng)中集成更多的功能，提升系統(tǒng)性能。　　GiDEL的PROCStar III開發(fā)系統(tǒng) 　　面向基于PCIe的嵌入式處理應(yīng)用，GiDEL的PROCStar III開
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什么是可編程邏輯？

概述了可編程邏輯的特點以及主要的兩種可編程邏輯-PLD和FPGA的區(qū)別? ? 　　什么是可編程邏輯？　　在數(shù)字電子系統(tǒng)領(lǐng)域，存在三種基本的器件類型：存儲器、微處理器和邏輯器件。存儲器用來存儲隨機信息，如數(shù)據(jù)表或數(shù)據(jù)庫的內(nèi)容。微處理器執(zhí)行軟件指令來完成范圍廣泛的任務(wù)，如運行字處理程序或視頻游戲。邏輯器件提供特定的功能，包括器件與器件間的接口、數(shù)據(jù)通信、信號處理、數(shù)據(jù)顯示、定時和控制操作、以及系統(tǒng)運行所需要的所有其它功能。? 　　固定邏輯與可編程邏輯　　邏輯器件可分為兩大類&
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利用Freeze技術(shù)的FPGA實現(xiàn)低功耗設(shè)計

由于更嚴格的功耗限制、規(guī)范和標準要求，系統(tǒng)設(shè)計師現(xiàn)在比什么時候都關(guān)注功耗問題。
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基于FPGA設(shè)計安全的汽車通信網(wǎng)絡(luò)

汽車工業(yè)正在經(jīng)歷一場無線技術(shù)革命，但安全威脅不解決，則可能削弱這塊新興的市場。由于高速網(wǎng)絡(luò)連接正設(shè)法進入汽車領(lǐng)域，設(shè)計師面臨新通信標準實施的挑戰(zhàn)。許多已經(jīng)習慣于漫長開發(fā)周期的設(shè)計師, 現(xiàn)在則在為迅速給新型車輛配備用戶需求的電子設(shè)備而進行競爭。為調(diào)整上市時間并駕馭出現(xiàn)的多個標準，設(shè)計師正轉(zhuǎn)向采用FPGA(現(xiàn)場可編程門陣列)。遺憾的是，由于汽車工業(yè)匆忙采用下一代基于fpga的汽車遠程信息系統(tǒng)，幾乎沒有設(shè)計師能夠充分明白他們選擇的fpga在安全上意味著什么。構(gòu)建安全的網(wǎng)絡(luò)首先要設(shè)計安全的系統(tǒng)，而且選擇
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基于FPGA的數(shù)字交換系統(tǒng)的設(shè)計與實現(xiàn)

　　專用交換機過于強大專業(yè)的功能，以及昂貴的價格，并非小型建網(wǎng)的理想選擇;同時，傳統(tǒng)的PBX的模擬交換方式存在著失真大、欠靈活以及隨規(guī)模增大而復(fù)雜度劇增的不足。本文提出的方案，有別于常用PBX的模擬交換，是一種適用于一定規(guī)模局域網(wǎng)的數(shù)字交換機。FPGA的使用在保證了性能提高的同時，在復(fù)雜度和擴展性方面也有了明顯的改進。　　一、系統(tǒng)結(jié)構(gòu) 　　本系統(tǒng)實現(xiàn)了帶有16路內(nèi)線電話、同時具備4路外線接口的數(shù)字交換機，系統(tǒng)結(jié)構(gòu)如圖1。　　　　(1)用戶接口及PCM編碼部分　　用戶接口電路選
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基于FPGA設(shè)計安全的汽車通信網(wǎng)絡(luò)

　　汽車工業(yè)正在經(jīng)歷一場無線技術(shù)革命，但安全威脅不解決，則可能削弱這塊新興的市場。由于高速網(wǎng)絡(luò)連接正設(shè)法進入汽車領(lǐng)域，設(shè)計師面臨新通信標準實施的挑戰(zhàn)。許多已經(jīng)習慣于漫長開發(fā)周期的設(shè)計師, 現(xiàn)在則在為迅速給新型車輛配備用戶需求的電子設(shè)備而進行競爭。為調(diào)整上市時間并駕馭出現(xiàn)的多個標準，設(shè)計師正轉(zhuǎn)向采用FPGA(現(xiàn)場可編程門陣列)。遺憾的是，由于汽車工業(yè)匆忙采用下一代基于fpga的汽車遠程信息系統(tǒng)，幾乎沒有設(shè)計師能夠充分明白他們選擇的fpga在安全上意味著什么。構(gòu)建安全的網(wǎng)絡(luò)首先要設(shè)計安全的系統(tǒng)，而且選擇適當?shù)?/li>
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致力推動FPGA深入高校教育，Altera舉辦全國大學教師會議

近日，Altera公司在清華大學拉開了全國大學教師會議的序幕，來自全國118所高校的近300名教師、Altera公司高層參加了這一為期兩天的學術(shù)盛會。這已是Altera公司第五次舉辦的全國范圍內(nèi)的大學教師會議。自2003年以來，Altera公司一年一度的大學教師會議，將全國各大高校的教師匯聚一堂，通過若干專題研討會以及經(jīng)驗交流，讓廣大高校老師對可編程邏輯技術(shù)的發(fā)展及其在大學課程中的應(yīng)用有更深入的了解，對課程設(shè)置的改革有更清晰的概念，為高校教師的應(yīng)用教學搭建起交流學習的平臺。在今年
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致力推動FPGA深入高校教育，Altera舉辦全國大學教師會議

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基于FPGA+PCI的并行計算平臺實現(xiàn)

　　當前對于各種加密算法.除了有針對性的破解算法，最基本的思想就是窮舉密鑰進行匹配，通常稱為暴力破解算法。由于暴力破解算法包含密鑰個數(shù)較多，遍歷的時間超過實際可接受的范圍。如果計算速度提高到足夠快。這種遍歷的算法因結(jié)構(gòu)設(shè)計簡便而具有實際應(yīng)用的前景。　　PCI總線(外設(shè)互聯(lián)總線)與傳統(tǒng)的總線標準——ISA總線(工業(yè)標準結(jié)構(gòu)總線)相比，具有更高的傳輸率(132MBps)、支持32位處理器及DMA和即插即用等優(yōu)點，用于取代ISA總線而成為目前臺式計算機的事實I/O總線標準，在普通PC機和工控機上有著廣泛的應(yīng)
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基于FPGA的分布式算法FIR濾波器設(shè)計

　　引言　　FIR(finite impulse response)濾波器是數(shù)字信號處理系統(tǒng)中最基本的元件，它可以在保證任意幅頻特性的同時具有嚴格的線性相頻特性，同時其單位沖激響應(yīng)是有限的，沒有輸入到輸出的反饋，是穩(wěn)定的系統(tǒng)。因此，F(xiàn)IR濾波器在通信、圖像處理、模式識別等領(lǐng)域都有著廣泛的應(yīng)用。　　目前FIR濾波器的硬件實現(xiàn)有以下幾種方式：　　一種是使用單片通用數(shù)字濾波器集成電路，這種電路使用簡單，但是由于字長和階數(shù)的規(guī)格較少，不易完全滿足實際需要。雖然可采用多片擴展來滿足要求，但會增加體積和
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FPGA奔向45納米

　　Altera公司技術(shù)開發(fā)副總裁Mojy Chian博士來到北京，在媒體座談會上介紹了該公司45nm IC開發(fā)的情況。他說，45nm相對65nm的優(yōu)勢要比65nm相對90nm的優(yōu)勢更大，同時開發(fā)難度也更高。Altera通過選擇正確的合作伙伴、采用“第一片硅投產(chǎn)”的方法以及協(xié)作設(shè)計和工藝開發(fā)的方式來實現(xiàn)2008年45nm FPGA的生產(chǎn)。　　那個叫Moore的人真幸運。他沒有發(fā)現(xiàn)真正的物理定律。他只不過總結(jié)并預(yù)測了半導體產(chǎn)業(yè)的發(fā)展規(guī)律，但他可能比大多數(shù)發(fā)現(xiàn)真正定律的物理學家都著名。說他幸運，是因為那個
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C語言平臺　縮短SoC前期設(shè)計時間

　　在設(shè)計上能減少結(jié)構(gòu)探索時間的C語言平臺，在結(jié)構(gòu)上如何以新思考突破? 　　以往半導體業(yè)者大多使用FPGA(Field Programmable Gate Array)製作樣品(Prototype)，接著鎖定幾項晶片重要規(guī)格，依此找出最適合該晶片的結(jié)構(gòu)，這種方式最大缺點是作業(yè)時間非常冗長。然而，C語言平臺的設(shè)計方式則是，利用軟體模擬分析檢討晶片結(jié)構(gòu)，以往FPGA平臺的樣品，大約需要半年左右的結(jié)構(gòu)探索時間，如果採用C語言平臺的設(shè)計方式，只需要花費約2周~1個月的時間。　　目前開發(fā)最快的是日本沖電氣，以
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fpga 介紹

FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可 [ 查看詳細 ]