- 深亞微米時代，傳統材料、結構乃至工藝都在趨于極限狀態(tài)，摩爾定律也已有些捉襟見肘。而步入深亞納米時代，晶體管的尺寸就將接近單個原子，無法再往下縮減。傳統ASIC和ASSP設計不可避免地遭遇了諸如設計流程復雜、生產良率降低、設計周期過長，研發(fā)制造費用劇增等難題，從某種程度上大大放緩了摩爾定律的延續(xù)。
顯而易見的是，在巨額的流片成本面前，很多中小規(guī)模公司不得不改變策略，更多的轉向FPGA的開發(fā)和設計。反觀FPGA市場，即便是5年前，其相對于ASIC的市場增速還是相當遲緩的，但在近些年，尤其是邁進90n
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FPGA CPU
- Altera宣布將主辦2015年Altera技術大會(Altera Technology Day，ATD)活動，這是橫跨亞太地區(qū)八個地點的一系列以技術為導向的研討會，包括臺灣、印度、新加坡、馬來西亞、韓國與中國，時間將從2015年8月6日至9月23日。
Altera技術及市場專家將會分享在電子系統設計上的最新趨勢， Terasic、MathWorks與Tektronix等合作夥伴也將展示在電子設計與產品上使用Altera的FPGA、SoC、IP與電源解決方案，以提供加速產品上市的價值。關于研討會
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Altera FPGA
- 可穿戴技術受到了用戶的追捧，因為這些設備有助于分析人們的日常活動，并可通過一種直觀的方式交換信息，極大改善我們的生活方式，給我們帶來便利。市場上有各種各樣的可穿戴電子設備，最有名的是智能手表、活動監(jiān)測器和健身手環(huán)。這些高度便攜式設備被戴在用戶身上，或以其它方式附著在人身上，能夠通過一個或多個傳感器測量和捕獲信息(參見圖1)。
圖1：一個典型的可穿戴設備能夠整合用戶數據和外部數據，它與一個外部設備配合工作，分析并向用戶顯示信息。
這些設
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SoC 傳感器
- 嵌入式微處理器(CPU)是數字信息產品的核心引擎，其市場格局伴隨市場環(huán)境的變遷而變化。國產嵌入式CPU在市場浪潮中經歷過洗禮和磨礪，因互聯網而興起，為物聯網而發(fā)力。作為本土CPU設計公司的代表，北京君正集成電路股份有限公司創(chuàng)業(yè)十年，已走出一條具有中國特色的創(chuàng)新型嵌入式CPU平臺的道路。本文通過采訪君正副總經理周生雷，剖析國產嵌入式CPU市場化的探索與開拓。
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君正 MIPS XBurst SOC 可穿戴設備 201508
- CSR公司日前宣布推出一款集成式片上系統(SOC)Quatro 5500，進一步豐富其打印機SOC產品線，以推進新一代工作組級多功能打印機(MFP)與移動設備、云端、傳統PC及服務器之間的無縫連接，從而實現快速、高品質打印。Quatro 5500系列為傳統MFP解決方案提供了低成本SOC替代方案，它將分立CPU與具有打印機專用功能的定制ASIC結合起來，并為MFP制造商顯著降低物料成本。
Quatro 5500系列每款SOC均集成了雙ARM Cortex-A15 內核和一個Cortex-A7
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CSR SoC
- 最近，航天子系統采用的先進半導體最底限是需有多個低電壓、具高電流軌條件，例如核心電壓小于1伏特(V)/30安培(A)的現場可編程門陣列(FPGA)。此外，各個負載也須具有獨特的排序、暫瞬、線路與負載調節(jié)的要求，這樣會讓配電網絡的設計變得更復雜。
目前航天總線提供28和100伏特不穩(wěn)定的電源軌，可用于為最新的航天級半導體生成隔離的、有效率的穩(wěn)壓電源。為滿足未來航天子系統的需求，開發(fā)一個低成本、可擴展的配電架構，且可重復的設計是尋求從28或100伏特兩種輸入中，可有效地生成多個較小的電軌，并同時限制
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FPGA PCB
- 盡管很多人聽說過FPGA和CPLD，但是關于FPGA與CPLD之間的區(qū)別，了解的人可能不是很多。雖然FPGA與CPLD都是“可反復編程的邏輯器件”，但是在技術上卻有一些差異。簡單地說，FPGA就是將CPLD的電路規(guī)模、功能、性能等方面強化之后的產物。(特權同學版權所有)
一般而言， FPGA與CPLD之間的區(qū)別如表1.1所示。(特權同學版權所有)
表1.1 FPGA和CPLD的比較
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總而言之，FPGA和CPLD最大的區(qū)別是他們的存儲
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FPGA CPLD
- 物聯網晶片市場將呈現新戰(zhàn)局。物聯網應用風潮帶動超低功耗、少量多樣設計趨勢，激勵許多微控制器(MCU)開發(fā)商乘勢大展拳腳，并提出整合MCU、無線通訊、嵌入式記憶體、射頻(RF)、感測器及電源管理的物聯網系統單晶片(SoC)解決方案，期在產業(yè)典范轉移之際，取得更有利的市場立足點，進而搶下物聯網晶片市場一哥寶座。
芯科實驗室副總裁暨MCU與無線產品部門總經理Daniel Cooley認為，Thread同時擁有低功耗、長距離傳輸和IP網狀網路支援等優(yōu)勢，發(fā)展?jié)摿Σ蝗莺鲆暋?
芯科實驗室(Silico
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物聯網 SoC
- 當前對于各種加密算法。除了有針對性的破解算法，最基本的思想就是窮舉密鑰進行匹配，通常稱為暴力破解算法。由于暴力破解算法包含密鑰個數較多，遍歷的時間超過實際可接受的范圍。如果計算速度提高到足夠快。這種遍歷的算法因結構設計簡便而具有實際應用的前景。
PCI總線(外設互聯總線)與傳統的總線標準——ISA總線(工業(yè)標準結構總線)相比，具有更高的傳輸率(132MBps)、支持32位處理器及DMA和即插即用等優(yōu)點，用于取代ISA總線而成為目前臺式計算機的事實I/O總線標準，在普通PC
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FPGA PCI
- FPGA豐富的邏輯資源、充沛的I/O引腳以及較低的功耗，被廣泛應用于嵌入式系統和高速數據通信領域?，F如今，各大FPGA生產廠商為方便用戶的設計和使用，提供了較多的、可利用的IP核資源，極大地減少了產品的開發(fā)周期和開發(fā)難度，從而使用戶得以更專注地構思各種各樣創(chuàng)意且實用的功能，而不是把大量時間浪費在產品的調試和驗證中。
千兆以太網技術在工程上的應用是當前的研究熱點之一。相比于其他RS-232或RS-485等串口通信，千兆以太網更加普及和通用，可以直接與Internet上的其他終端相連;相比于百兆網絡
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FPGA DDR2
- 因為硬件有了更多的模塊，及其解決方案，給人一種假象：硬件設計好像很簡單的一樣，實際呢，硬件設計才真正是考驗功底的。
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硬件設計 FPGA
- Altera公司開發(fā)了基于其Arria® 10 SoC的存儲參考設計，與目前的NAND閃存相比，NAND閃存的使用壽命將加倍，程序擦除周期數增加了7倍。參考設計在經過優(yōu)化的高性價比單片解決方案中包括了一片Arria 10 SoC和集成雙核ARM® Cortex®A9處理器，同時采用了Mobiveil的固態(tài)硬盤(SSD)控制器，以及NVMdurance的NAND優(yōu)化軟件。這一參考設計提高了NAND應用的性能和靈活性，同時延長了數據中心設備的使用壽命，從而降低了NAND陣列的成本。
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Altera FPGA
- 本文檔主要講解實現一個1024點的16位正弦波數據的生成，并將該數據制作成quartus II使用的mif文件，使用此文件，我們便可以使用FPGA，基于直接數字合成(DDS)原理生成標準的正弦波，即實現信號發(fā)生器的功能。小梅哥的DDS實驗已經做完，目前還沒有進行文檔的編寫。朋友今天邀請我為他制作一個1024點的16位的正弦波mif文件，實現之后，發(fā)現過程中涉及到MATLAB軟件、Excel軟件、Quartus II軟件的使用，每個過程簡單，但是步驟較多，因此在這里以文檔的方式記錄下來，分享給需要的朋友
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FPGA mif
- 本文介紹了一種以FPGA為基礎的數字密碼鎖。采用自頂向下的數字系統設計方法，將數字密碼鎖系統分解為若干子系統，并且進一步細劃為若干模塊，然后用硬件描述語言VHDL來設計這些模塊，同時進行硬件測試。測試結果表明該數字密碼鎖能夠校驗10位十進制數字密碼，且可以預置密碼，設有斷電保護裝置，解碼有效指示等相應功能。
1功能概述
(1)密碼鎖的工作時鐘由外部晶振提供，時鐘頻率為50MHz，運算速度高，工作性能穩(wěn)定。
(2)密碼的設置和輸入由外接鍵盤完成，控制電路的安全系數高，操作方便;
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FPGA 數字密碼鎖
- 即將于2015年秋天提供Stratix 10 FPGA和SoC工程樣片的Altera公司，近日發(fā)布其Stratix 10 FPGA和SoC體系結構和產品細節(jié)，在性能、集成度、密度和安全特性方面實現了突破?！ tratix 10 FPGA和SoC采用了Altera革命性的HyperFlex FPGA架構，由Intel 14nm三柵極工藝技術制造，內核性能是前一代FPGA的2倍。性能好、密度高、具有先進的嵌入式處理功能的FPGA與GPU類浮點計算性能和異構3D SiP集成特性相結合，支持Altera客戶
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Stratix 10 FPGA SoC工程樣片 Altera 201507
fpga soc介紹
您好，目前還沒有人創(chuàng)建詞條fpga soc!
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