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EEPW首頁 >> 主題列表 >> fpga soc

基于FPGA的數(shù)字化變電站計量儀表研究與設(shè)計

  • 提出一種基于IEC61850和SoPC的數(shù)字化變電站計量儀表設(shè)計方案。在DE2—70開發(fā)板的基礎(chǔ)上，首先依據(jù)IEC61850標準對數(shù)字化變電站計量儀表進行了總體設(shè)計；其次對基于FPGA的電量參數(shù)算法進行了研究；最后完成了光纖通信電路、快速以太網(wǎng)接口電路、雙軟核SoPC系統(tǒng)等硬件電路的設(shè)計?；贔PGA的數(shù)字化變電站計量儀表設(shè)計方案具有設(shè)計
  • 關(guān)鍵字： 數(shù)字化變電站  SOPC  FPGA  

利用FPGA的M4K作為移位寄存器的邏輯分析儀設(shè)計

  • 采用Altera公司的Cyclone系列EPlC3T144C8作為控制芯片，QuartusⅡ為軟件平臺，用硬件描速語言設(shè)計了一個具有變頻采樣時鐘和16路采樣通道，基于VGA顯示的邏輯分析僅．該設(shè)計方案利用FPGA內(nèi)部的M4K決作為移位寄存器不斷地進行讀進數(shù)據(jù)的方式，提高了工作速度、性能穩(wěn)定性以及分析的范圍和質(zhì)量。該邏輯分析儀實現(xiàn)簡單，價格低，具有較高的使用價值。
  • 關(guān)鍵字： 采樣模式  邏輯分析儀  FPGA  

基于FPGA的生物電阻抗成像系統(tǒng)設(shè)計

  • 根據(jù)電阻抗斷層成像技術(shù)要求，設(shè)計了以Spartan3E系列XC3S500E FPGA為核心的16電極生物電阻抗成像系統(tǒng)，系統(tǒng)嵌入8 bit微處理器PicoBlaze實現(xiàn)邏輯控制并產(chǎn)生激勵信號實現(xiàn)高速A/D采集及實現(xiàn)數(shù)字解調(diào)，通過RS232將采集數(shù)據(jù)傳輸?shù)絇C機，重建人體內(nèi)部的電阻率分布或其變化圖像。為廣泛應(yīng)用研究電阻抗斷層成像技術(shù)提供一種
  • 關(guān)鍵字： Spartan3E  生物電阻抗成像系統(tǒng)  FPGA  

基于FPGA的VLIW微處理器的設(shè)計與實現(xiàn)

  • 超長指令字VLIW微處理器架構(gòu)采用了先進的清晰并行指令設(shè)計。VLIW微處理器的最大優(yōu)點是簡化了處理器的結(jié)構(gòu)，刪除了處理器內(nèi)部許多復(fù)雜的控制電路，它能從應(yīng)用程序中提取高度并行的指令數(shù)據(jù)，并把這些機器指
  • 關(guān)鍵字： VLIW微處理器  并行指令控制  FPGA  

FPGA的雙緩沖模式PCI Express總線設(shè)計

  • 介紹了軟件無線電平臺中基于FPGA的雙緩沖模式PCI Express（PCIE）總線的設(shè)計與實現(xiàn)。設(shè)計了基于Xilinx Virtex6 FPGA的通用軟件無線電平臺，開發(fā)了基于Linux系統(tǒng)的驅(qū)動程序和PCIE硬核的DMA控制器。雙緩沖提高了數(shù)據(jù)傳輸速度，節(jié)約了硬件資源。測試結(jié)果顯示，該系統(tǒng)工作穩(wěn)定可靠，讀寫速度可達402 MB/s。
  • 關(guān)鍵字： PCIExpress總線  雙緩沖模式  FPGA  

基于FPGA的模糊控制交通燈控制方案設(shè)計

  • 針對目前交叉路口交通控制信號燈的綠信比固定不變的問題，提出一種模糊控制的方案。根據(jù)當前相位的車流量和當前相位與下一相位車流量之差，實時控制相位綠信比，縮減車輛在交叉路口的排隊長度。綠信比可在FPGA上模擬實現(xiàn)，采用EElements ISE Development Kit開發(fā)套件，使用ISE10.1軟件設(shè)計工具，對上述控制方案進行仿真。
  • 關(guān)鍵字： 模糊控制  交通燈控制方案  FPGA  

基于FPGA的PUSCH信道估計仿真與實現(xiàn)

  • 基于最小平方 (LS) 算法，利用FPGA實現(xiàn)了一種適用于TD-LTE系統(tǒng)的上行信道估計算法。主要研究了如何利用FPGA實現(xiàn)LS算法，包括算法的介紹、方案的形成、FPGA實現(xiàn)的處理流程、FPGA實現(xiàn)結(jié)果及分析。以Virtex-5芯片為硬件平臺，完成了仿真、綜合、板級驗證等工作。實現(xiàn)結(jié)果表明，該信道估計算法應(yīng)用到TD-LTE系統(tǒng)具有良好的穩(wěn)
  • 關(guān)鍵字： PUSCH  信道估計仿真  FPGA  

FPGA設(shè)計系統(tǒng)時鐘的影響因素及其分析

  • 時鐘是整個電路最重要、最特殊的信號，系統(tǒng)內(nèi)大部分器件的動作都是在時鐘的跳變沿上進行， 這就要求時鐘信號時延差要非常小， 否則就可能造成時序邏輯狀態(tài)出錯；因而明確FPGA設(shè)計中決定系統(tǒng)時鐘的因素，盡量較小時鐘的延時對保證設(shè)計的穩(wěn)定性有非常重要的意義。
  • 關(guān)鍵字： 信號時延  系統(tǒng)時鐘  FPGA  

一種基于FPGA技術(shù)的紅外視頻采集系統(tǒng)設(shè)計

  • 介紹了一種基于FPGA技術(shù)的紅外視頻采集系統(tǒng)組成架構(gòu)，給出了各功能模塊的實現(xiàn)方法,包括主要的HDL代碼、SignaltapII波形以及QuartusII頂層原理，并制作電路板進行調(diào)試，最終的紅外圖像通過VGA實時顯示。結(jié)果表明該系統(tǒng)能充分利用FPGA技術(shù)的優(yōu)勢，具有擴展性好、控制靈活、開發(fā)周期短等特點。
  • 關(guān)鍵字： 紅外視頻采集系統(tǒng)  ADV7181B  FPGA  

JavaCard指令處理器的FPGA設(shè)計和實現(xiàn)

  • 給出了一種基于微碼的JavaCard指令處理器的FPGA設(shè)計和實現(xiàn)，以此JavaCard CPU為核心搭建的測試平臺已集成在一塊FPGA上實現(xiàn)。
  • 關(guān)鍵字： JavaCard  復(fù)雜指令集  FPGA  

基于FPGA的LBS控制器設(shè)計

  • 通過對LBS控制器的控制信號、LBS總線讀寫操作時序、LBS狀態(tài)機進行分析，設(shè)計并實現(xiàn)了一個高效、可靠的LBS控制器來實現(xiàn)FPGA和PEX8311的通信系統(tǒng)，在PEX8311和FPGA接口中運行狀態(tài)正常，穩(wěn)定性強，成功應(yīng)用于某視頻采集卡、某PCIe數(shù)據(jù)采集卡等，基于FPGA設(shè)計的LBS控制器具有靈活性強、可編程能力強、適應(yīng)性強等優(yōu)點。
  • 關(guān)鍵字： LBS控制器  PEX8311  FPGA  

FPGA設(shè)計流程及其布線資源解析

  • 電路設(shè)計與輸入是指通過某些規(guī)范的描述方式，將工程師電路構(gòu)思輸入給EDA工具。常用的設(shè)計方法有硬件描述語言（HDL）和原理圖設(shè)計輸入方法等。原理圖設(shè)計輸入法在早期應(yīng)用得比較廣泛，它根據(jù)設(shè)計要求，選用器件、繪制原理圖、完成輸入過程。這種方法的有點是直觀、便于理解、元器件庫資源豐富。但是在大型設(shè)計中，這種方法的可維護性較差，不利于模塊構(gòu)造與重用
  • 關(guān)鍵字： 布線資源  功能仿真  FPGA  

基于FPGA的海量數(shù)據(jù)采集系統(tǒng)設(shè)計

  • 最近幾年，F(xiàn)PGA以其應(yīng)用的靈活方便蓬勃發(fā)展，在通信、航空航天、醫(yī)療設(shè)備、消費類電子產(chǎn)品等領(lǐng)域一展身手。使用FPGA控制CF的技術(shù)到目前為止還沒有成熟，本文從硬件和軟件角度出發(fā)，介紹了FPGA與CF卡的接口設(shè)計、給出了用雙RAM訪問CF卡的編程，并且利用FPGA作為FIFO對AD采集的數(shù)據(jù)進行緩沖，然后存儲到大容量的CF卡中。
  • 關(guān)鍵字： 海量數(shù)據(jù)采集  THS4052  MAX4125  FPGA  

基于FPGA的空間電場信號數(shù)據(jù)采集與處理系統(tǒng)設(shè)計

  • 提出一種基于FPGA的空間電場信號數(shù)據(jù)采集與處理系統(tǒng)的設(shè)計方案，F(xiàn)PGA為主控制器控制A／D采樣和同步422發(fā)送。X，Y，Z三個方向的空間電場信號經(jīng)過信號處理和A／D采樣，在FPGA片內(nèi)濾波劃分為不同的頻段，通過同步422接口發(fā)送到后續(xù)設(shè)備。該系統(tǒng)性能可靠穩(wěn)定，致力于應(yīng)用在探空火箭有效載荷——箭載電場儀上，對其他電場信號采集與處理系統(tǒng)也有
  • 關(guān)鍵字： 空間電場  數(shù)據(jù)采集  FPGA  

基于FPGA的跳頻通信系統(tǒng)設(shè)計

  • 本跳頻系統(tǒng)中，F(xiàn)PGA是硬件邏輯的載體，完成基帶信號采樣后的混頻、濾波等操作及對DDS、ADC等外部邏輯的控制；dsp控制FPGA內(nèi)部邏輯以及DDS、ADC等邏輯單元完成跳頻通信系統(tǒng)基帶部分的發(fā)射與接收及其一系列計算任務(wù)；高精度時鐘源為整個系統(tǒng)提供時間基準，經(jīng)過dsp、FPGA、DDS等器件內(nèi)部鎖相環(huán)倍頻，為各器件提供主時鐘。
  • 關(guān)鍵字： 跳頻通信  基帶模塊  FPGA  
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