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EEPW首頁 >> 主題列表 >> fpga:quartusⅡ

如何用單個賽靈思FPGA數(shù)字化數(shù)百個信號

  • 如何用單個賽靈思FPGA數(shù)字化數(shù)百個信號-  在新型賽靈思 FPGA 上使用低電壓差分信號(LVDS),只需一個電阻和一個電容就能夠數(shù)字化輸入信號。由于目前這一代賽靈思器件上提供有數(shù)百個 LVDS 輸入,理論上使用單個 FPGA 就能夠數(shù)字化數(shù)百個模擬信號。
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工程師談FPGA時序約束七步法

  • 工程師談FPGA時序約束七步法-時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但這還不是最完整的時序約束。
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FMC+ 標(biāo)準(zhǔn)將嵌入式設(shè)計(jì)推到全新的高度

  • FMC+ 標(biāo)準(zhǔn)將嵌入式設(shè)計(jì)推到全新的高度-更新后的 FPGA 夾層卡規(guī)范提供無與倫比的高 I/O 密度、向后兼容性。
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如何擴(kuò)展 FPGA 的工作溫度范圍

  • 如何擴(kuò)展 FPGA 的工作溫度范圍-  任何電子器件的使用壽命均取決于其工作溫度。在較高溫度下器件會加快老化,使用壽命會縮短。但某些應(yīng)用要求電子產(chǎn)品工作在器件最大額定工作結(jié)溫下。以石油天然氣產(chǎn)業(yè)為例來說明這個問題以及解決方案。
  • 關(guān)鍵字: 賽靈思  XA6SLX45  FPGA  

如何使用FPGA加速機(jī)器學(xué)習(xí)算法

  • 如何使用FPGA加速機(jī)器學(xué)習(xí)算法-  當(dāng)前,AI因?yàn)槠銫NN(卷積神經(jīng)網(wǎng)絡(luò))算法出色的表現(xiàn)在圖像識別領(lǐng)域占有舉足輕重的地位?;镜腃NN算法需要大量的計(jì)算和數(shù)據(jù)重用,非常適合使用FPGA來實(shí)現(xiàn)。上個月,Ralph Wittig(Xilinx CTO Office的卓越工程師)在2016年OpenPower峰會上發(fā)表了約20分鐘時長的演講并討論了包括清華大學(xué)在內(nèi)的中國各大學(xué)研究CNN的一些成果。
  • 關(guān)鍵字: FPGA  GPU  AuvizDNN  

基于ARM和FPGA的多路電機(jī)控制方案

  • 基于ARM和FPGA的多路電機(jī)控制方案-專用控制器由ARM(LPC2214)、FPGA(EP2C5T144C8)、驅(qū)動器接口電路、編碼器接口電路、限位檢測電路和電源電路等組成,ARM通過串口實(shí)現(xiàn)與上位機(jī)之間的通信,解析從上位機(jī)獲得的控制指令,并通過FPGA產(chǎn)生相應(yīng)輸出信號給驅(qū)動器接口,驅(qū)動器接口外接驅(qū)動器。
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詳解FPGA開發(fā)流程中每一環(huán)節(jié)的物理含義和實(shí)現(xiàn)目標(biāo)

  • 詳解FPGA開發(fā)流程中每一環(huán)節(jié)的物理含義和實(shí)現(xiàn)目標(biāo)-FPGA的開發(fā)流程是遵循著ASIC的開發(fā)流程發(fā)展的,發(fā)展到目前為止,F(xiàn)PGA的開發(fā)流程總體按照圖1進(jìn)行,有些步驟可能由于其在當(dāng)前項(xiàng)目中的條件的寬度的允許,可以免去,比如靜態(tài)仿真過程,這樣來達(dá)到項(xiàng)目時間上的優(yōu)勢。
  • 關(guān)鍵字: FPGA  

一文了解FPGA與DSP的區(qū)別、特點(diǎn)及用途

  • 一文了解FPGA與DSP的區(qū)別、特點(diǎn)及用途-FPGA是一種可編程的硅芯片,DSP是數(shù)字信號處理,當(dāng)系統(tǒng)設(shè)計(jì)人員在項(xiàng)目的架構(gòu)設(shè)計(jì)階段就面臨到底采用FPGA還是DSP的重要問題。本文將首先分別介紹FPGA和DSP的特點(diǎn),然后再從內(nèi)部資源、編程語言、功能多個角度解析兩者的不同。
  • 關(guān)鍵字: FPGA  DSP  

通過FPGA智能調(diào)試工具縮短驗(yàn)證時間

  • 通過FPGA智能調(diào)試工具縮短驗(yàn)證時間-設(shè)計(jì)人員選擇具有優(yōu)秀調(diào)試能力的FPGA器件,可以縮短開發(fā)周期并降低成本,同時顯著加快上市速度。
  • 關(guān)鍵字: FPGA  邏輯分析儀  

基于FPGA的虛擬現(xiàn)實(shí)定位系統(tǒng)

  • 基于FPGA的虛擬現(xiàn)實(shí)定位系統(tǒng)-虛擬現(xiàn)實(shí)技術(shù)是目前計(jì)算機(jī)信息科學(xué)中的前沿學(xué)科,文中設(shè)計(jì)了一種以FPGA 為核心的數(shù)據(jù)采集處理系統(tǒng).利用HMC5883L和ADXL345對虛擬場景中物體的方位和朝向進(jìn)行確定并通過以太網(wǎng)給虛擬場景主機(jī)發(fā)送數(shù)據(jù).整個系統(tǒng)以 FPGA作為主控制器,配以傳感器數(shù)據(jù)采集,內(nèi)部FIFO存儲,以太網(wǎng)高速傳輸,從而把定位系統(tǒng)參數(shù)實(shí)時傳送到上位機(jī)中,具有傳輸速度快.實(shí)時性等優(yōu)點(diǎn),實(shí)現(xiàn)了虛擬現(xiàn)實(shí)高精度定位的功能.
  • 關(guān)鍵字: FPGA  虛擬現(xiàn)實(shí)  

電路設(shè)計(jì)常見的八個誤區(qū)

  • 電路設(shè)計(jì)常見的八個誤區(qū)-電路設(shè)計(jì)常見的八個誤區(qū):現(xiàn)象一:這板子的PCB設(shè)計(jì)要求不高,就用細(xì)一點(diǎn)的線,自動布吧;現(xiàn)象二:這些總線信號都用電阻拉一下,感覺放心些;現(xiàn)象三:CPU和FPGA的這些不用的I/O口怎么處理呢?先讓它空著吧,以后再說。
  • 關(guān)鍵字: 電路設(shè)計(jì)  PCB  fpga  

FPGA實(shí)戰(zhàn)開發(fā)技巧(6)

  • FPGA實(shí)戰(zhàn)開發(fā)技巧(6)-時序性能是FPGA 設(shè)計(jì)最重要的指標(biāo)之一。造成時序性能差的根本原因有很多,但其直接原因可分為三類:布局較差、邏輯級數(shù)過多以及信號扇出過高。
  • 關(guān)鍵字: FPGA  時序性能  

FPGA實(shí)戰(zhàn)開發(fā)技巧(7)

  • FPGA實(shí)戰(zhàn)開發(fā)技巧(7)-通常我們會為工程添加UCF 約束指定時序要求和管腳約束。但是UCF 約束是給MAP,PAR 等實(shí)現(xiàn)使用的,綜合工具XST 并不能感知系統(tǒng)的時序要求。而為XST 添加XCF 約束卻是使實(shí)現(xiàn)結(jié)果擁有最高頻率的關(guān)鍵。
  • 關(guān)鍵字: FPGA  XCF  UCF  

利用FPGA的自身特性實(shí)現(xiàn)隨機(jī)數(shù)發(fā)生器

  • 利用FPGA的自身特性實(shí)現(xiàn)隨機(jī)數(shù)發(fā)生器-本文主要介紹利用FPGA的自身的特性實(shí)現(xiàn)隨機(jī)數(shù)發(fā)生器,在Virtex-II Pro開發(fā)板上用ChipScope觀察隨機(jī)數(shù)序列,以及在PCIe4Base(基于Virtex-4 FPGA)上實(shí)現(xiàn)。
  • 關(guān)鍵字: fpga  

談?wù)勅绾卫肍PGA開發(fā)板進(jìn)行ASIC原型開發(fā)

  • 談?wù)勅绾卫肍PGA開發(fā)板進(jìn)行ASIC原型開發(fā)-ASIC設(shè)計(jì)在尺寸和復(fù)雜性上不斷增加,現(xiàn)代FPGA的容量和性能的新進(jìn)展意味著這些設(shè)計(jì)中的2/3能夠使用單個FPGA進(jìn)行建模。
  • 關(guān)鍵字: FPGA  ASIC  
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