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一種基于FPGA的T-MPLS網(wǎng)絡(luò)Gb/s核心節(jié)點(diǎn)的設(shè)計(jì)

  • 主要內(nèi)容是為實(shí)現(xiàn)T-MPLS技術(shù)于傳送網(wǎng)絡(luò)中的應(yīng)用。新的面向連接的分組傳送技術(shù)T-MPLS中，高速率的數(shù)據(jù)轉(zhuǎn)發(fā)交換是其實(shí)現(xiàn)的關(guān)鍵。項(xiàng)目設(shè)計(jì)了一種基于FPGA的四端口千兆速率T-MPLS交換芯片的實(shí)現(xiàn)方案，用以完成T-MPLS網(wǎng)絡(luò)中數(shù)據(jù)交換轉(zhuǎn)發(fā)，同時(shí)在邊緣節(jié)點(diǎn)完成業(yè)務(wù)的上下路，并進(jìn)一步完成網(wǎng)絡(luò)控制和管理平面的設(shè)計(jì)。
  • 關(guān)鍵字： T-MPLS網(wǎng)絡(luò)  核心節(jié)點(diǎn)  FPGA  VIIPro  

基于軟件無線電的通信系統(tǒng)試驗(yàn)平臺(tái)的設(shè)計(jì)實(shí)現(xiàn)，軟硬件原理、架構(gòu)

  • 本項(xiàng)目為一個(gè)基于 DSP 和 FPGA 的軟件無線電實(shí)驗(yàn)平臺(tái)。是由可編程器件 DSP 和可重構(gòu)邏輯器件 FPGA 搭建而成的，可提供了一個(gè)良好的數(shù)字無線通信環(huán)境，可以將多種調(diào)制解調(diào)算法在實(shí)驗(yàn)平臺(tái)上實(shí)現(xiàn)，并能實(shí)現(xiàn)多種模式之間的切換。為學(xué)生可能通過自主編程來實(shí)現(xiàn)通信系統(tǒng)的相關(guān)功能，有助于學(xué)習(xí)和鞏固相關(guān)知識(shí)。
  • 關(guān)鍵字： 軟件無線電  通信系統(tǒng)  FPGA  QPSK  Spartan3E  

基于FPGA的指紋識(shí)別模塊設(shè)計(jì)

  • 本模塊采用xilinx公司的Spartan 3E系列XC3S500E型FPGA作為核心控制芯片，通過富士通公司的MFS300滑動(dòng)式電容指紋傳感器對(duì)指紋圖象進(jìn)行提取，然后對(duì)提取的指紋圖像進(jìn)行灰度濾波、圖像增強(qiáng)、二值化、二值去噪、細(xì)化等預(yù)處理，得到清晰的指紋圖象，再從清晰的指紋圖象中提取指紋特征點(diǎn)，存入外部FLASH作為建檔模板
  • 關(guān)鍵字： 指紋識(shí)別  傳感器  FPGA  

基于FPGA的2.45G RFID閱讀器基帶系統(tǒng)設(shè)計(jì)，硬件原理、框圖

  • 主要實(shí)現(xiàn)基帶信號(hào)處理與信息管理。具體包括：曼徹斯編碼、米勒解碼、GMSK調(diào)制/解調(diào)、BPSK解調(diào)/解調(diào)、防碰撞算法、網(wǎng)絡(luò)接口協(xié)議。
  • 關(guān)鍵字： RFID  閱讀器基帶  FPGA  多普勒頻移  數(shù)字補(bǔ)償  

基于FPGA的點(diǎn)陣LED顯示屏控制器的設(shè)計(jì)

  • LED屏幕在現(xiàn)代信息化的社會(huì)里應(yīng)用越來越廣泛，而它的靈魂是其內(nèi)部的控制器。傳統(tǒng)的LED控制器絕大部分是基于單片機(jī)設(shè)計(jì)的，這種控制器在控制單色或雙色點(diǎn)陣是足夠的，但是使用它來控制多彩色的LED屏和高分辨率的LED屏，是非常困難的。為解決這一問題，本文提出了一種基于FPGA的LED點(diǎn)陣屏的控制器設(shè)計(jì)。
  • 關(guān)鍵字： 控制器  LED顯示  FPGA  

SOPC實(shí)現(xiàn)4路高清攝像頭視頻處理的方案設(shè)計(jì)，軟硬件架構(gòu)

  • 本項(xiàng)目基于高性能FPGA開發(fā)平臺(tái)，實(shí)現(xiàn)4路高速CCD攝像頭視頻數(shù)據(jù)采集，采用基于SIFT特征點(diǎn)提取算法進(jìn)行圖像特征提取與匹配，并采用了加權(quán)平均方法對(duì)視頻進(jìn)行拼接，實(shí)現(xiàn)4路視頻的實(shí)時(shí)拼接的環(huán)視SOC系統(tǒng)設(shè)計(jì)。
  • 關(guān)鍵字： SOPC  視頻處理  SIFT算法  FPGA  Spartan-6  

DIY你的體感游戲：人體動(dòng)作識(shí)別系統(tǒng)的設(shè)計(jì)，提供軟硬件實(shí)現(xiàn)方案

  • 本項(xiàng)目使用Virtex-5 OpenSPARC評(píng)估平臺(tái)，首先通過VGA解碼芯片，將PC機(jī)中的視頻流數(shù)據(jù)解碼出R、G、B信號(hào)值和場(chǎng)、行信號(hào)。然后使用OV7670數(shù)字?jǐn)z像頭，攝取人體的手部動(dòng)作，運(yùn)用一定的算法，對(duì)攝像頭數(shù)據(jù)進(jìn)行處理，判定此時(shí)的人體動(dòng)作，然后將其與RGB分量信號(hào)進(jìn)行疊加，通過配置DVI接口芯片，將疊加后的圖像送至顯示器顯示。
  • 關(guān)鍵字： Virtex-5  動(dòng)作識(shí)別  DIY  數(shù)字?jǐn)z像頭  FPGA  

大熱的虹膜身份識(shí)別系統(tǒng)設(shè)計(jì)，提供軟硬件參考解決方案

  • 使用FPGA進(jìn)行虹膜特征的提取和匹配計(jì)算。將用戶的虹膜特征數(shù)據(jù)事先存儲(chǔ)在數(shù)據(jù)庫中，捕獲測(cè)試者的虹膜圖像，通過預(yù)處理以及特征提取，得到待測(cè)特征數(shù)據(jù)，與數(shù)據(jù)庫中的特征數(shù)據(jù)進(jìn)行模式匹配，根據(jù)Bayes最大后驗(yàn)概率準(zhǔn)則判斷測(cè)試者的身份。
  • 關(guān)鍵字： 虹膜身份識(shí)別  Spartan3E  攝像頭  虹膜圖像  FPGA  

DIY小發(fā)明：打造你自己的流媒體播放器，解決方案、硬件框圖

  • 主要內(nèi)容為利用Xilinx的Virtex-2 Pro FPGA 上豐富的邏輯資源來實(shí)現(xiàn)一個(gè)自定義的模塊，該模塊能作為流媒體播放過程中的一個(gè)功能部件。
  • 關(guān)鍵字： DIY  流媒體播放器  Virtex-2Pro  FPGA  

基于FPGA的IIR數(shù)字濾波器的設(shè)計(jì)方案

  • 用FPGA實(shí)現(xiàn)數(shù)字濾波器具有實(shí)時(shí)性強(qiáng)、靈活性高、處理速度快以及小批量生產(chǎn)成本低等優(yōu)點(diǎn)，所以得到了較為廣泛的應(yīng)用。本文以巴特沃思數(shù)字帶通濾波器為例，較為詳細(xì)地介紹了其設(shè)計(jì)和實(shí)現(xiàn)方法。給定巴特沃茲數(shù)字帶通濾波器的抽樣頻率為500Hz，上、下邊帶截止頻率分別為150Hz和30Hz。
  • 關(guān)鍵字： IIR數(shù)字濾波器  雙線性變換法  FPGA  matlab  

FPGA設(shè)計(jì)頻率計(jì)算方法

  • 我們的設(shè)計(jì)需要多大容量的芯片？我們的設(shè)計(jì)能跑多快？這是經(jīng)常困擾工程師的兩個(gè)問題。對(duì)于前一個(gè)問題，我們可能還能先以一個(gè)比較大的芯片實(shí)現(xiàn)原型，待原型完成再選用大小合適的芯片實(shí)現(xiàn)。對(duì)于后者，我們需要一個(gè)比較精確的預(yù)估。
  • 關(guān)鍵字： 頻率計(jì)算  D觸發(fā)器  FPGA  Tlogic  

14nm的FPGA需要什么樣的電源管理IC？

  • 現(xiàn)在的FPGA不僅僅是一個(gè)邏輯器件，它現(xiàn)在更加像一個(gè)平臺(tái)，在一個(gè)FPGA中常常會(huì)包含有數(shù)字信號(hào)處理、嵌入式處理、高速串行和其他高端技術(shù)模塊。那么，這樣的FPGA需要什么樣的電源管理IC來與之配合呢？
  • 關(guān)鍵字： 電源管理IC  14nm  FPGA  Enpirion  CycloneVSoC  

分析FPGA的基本結(jié)構(gòu)

  • FPGA由6部分組成，分別為可編程輸入/輸出單元、基本可編程邏輯單元、嵌入式塊RAM、豐富的布線資源、底層嵌入功能單元和內(nèi)嵌專用硬核等。
  • 關(guān)鍵字： 硬核  輸入/輸出  FPGA  邏輯單元  RAM  

如何通過RTL分析、SDC約束和綜合向?qū)Ц焱瞥鯢PGA設(shè)計(jì)

  • EDA 公司和 FPGA 廠商不斷開發(fā)新的工具和方法，推進(jìn)繁瑣任務(wù)的自動(dòng)化，幫助設(shè)計(jì)團(tuán)隊(duì)集中精力做好創(chuàng)造性工作。下面我們就來看看 FPGA 工具流程的演進(jìn)發(fā)展，了解一下現(xiàn)代 FPGA 團(tuán)隊(duì)是如何利用 RTL分析、約束生成和綜合導(dǎo)向來減少設(shè)計(jì)迭代的。
  • 關(guān)鍵字： RTL  SDC  綜合向?qū)?/a>  FPGA  

用智能的調(diào)試與綜合技術(shù)隔離FPGA設(shè)計(jì)中的錯(cuò)誤

  • Synopsys公司的Synplify Premier 和Synplify Pro FPGA設(shè)計(jì)工具以及Identify RTLDebugger 等產(chǎn)品能幫助設(shè)計(jì)人員完成上述工作。這些工具的特性使得設(shè)計(jì)人員能快速隔離錯(cuò)誤，有效縮短運(yùn)行時(shí)間，并減少開發(fā)板啟動(dòng)所需的迭代次數(shù)。
  • 關(guān)鍵字： 智能調(diào)試  SynplifyPremier  FPGA  SynplifyProFPGA  
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