- 只要輸入信號同時變化,(經(jīng)過內(nèi)部走線)組合邏輯必將產(chǎn)生毛刺。將它們的輸出直接連接到時鐘輸入端、清零或置位端口的設(shè)計方法是錯誤的,這可能會導致嚴重的后果。 所以我們必須檢查設(shè)計中所有時鐘、清零和置位等對毛刺敏感的輸入端口,確保輸入不會含有任何毛刺。
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毛刺 置位信號 FPGA
- 介紹在QUATUSII環(huán)境下,采用FPGA可編程邏輯器件開發(fā)的電子密碼鎖,并利用狀態(tài)機(FSM)實現(xiàn)鍵盤消抖及系統(tǒng)主控模塊的行為控制,從實際工程設(shè)計角度闡述了系統(tǒng)所有模塊及其工作原理、軟件設(shè)計方法,提出了系統(tǒng)設(shè)計注意要點。
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QUATUSII 密碼鎖 FPGA 狀態(tài)機
- FPGA能滿足MP3整個系統(tǒng)的價格、功耗和性能要求,它們靈活的結(jié)構(gòu)使系統(tǒng)設(shè)計人員能在每種MP3播放機中最佳地實現(xiàn)各種功能。
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MP3 邏輯模塊 FPGA
- 在系統(tǒng)設(shè)計時,各個網(wǎng)絡(luò)的頻率特性對該系統(tǒng)的穩(wěn)定性、工作頻帶、傳輸特性等都具有重要影響。實際操作中,掃頻儀大大簡化了測量操作,提高了工作效率,達到了測量過程快速、直觀、準確、方便的目的,在生產(chǎn)、科研、教學上得到廣泛運用。
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頻率特性 掃頻儀 FPGA
- 在通信和控制系統(tǒng)中,常使用異步串行通信控制器(UART)實現(xiàn)系統(tǒng)輔助信息的傳輸。為實現(xiàn)多點通信,通常用軟件識別發(fā)往本站點或其它站點的數(shù)據(jù),這會加大CPU的開銷。介紹了一種基于FPGA的UART IP,由硬件實現(xiàn)多點通信時的數(shù)據(jù)過濾功能,降低了CPU的負擔,提高了系統(tǒng)性能。
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UART IP FPGA
- 設(shè)計了一種H.264標準的CAVLC編碼器,對原有軟件流程進行部分改進,提出了并行處理各編碼子模塊的算法結(jié)構(gòu)。
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變長編碼 非零系數(shù)級編碼 FPGA
- 在FPGA/CPLD設(shè)計中,狀態(tài)機是最典型、應用最廣泛的時序電路模塊,如何設(shè)計一個穩(wěn)定可靠的狀態(tài)機是我們必須面對的問題.
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時序電路 狀態(tài)機 FPGA
- 本文介紹了數(shù)字下變頻的組成結(jié)構(gòu),并通過一個具體的實例,給出了FPGA實現(xiàn)的具體過程。
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數(shù)字變頻 VHDL FPGA
- 時延估計是雷達、聲納等領(lǐng)域經(jīng)常遇到的一個問題,提出了利用相關(guān)計算法實現(xiàn)時延估計,并通過互譜插值提高估計精度。結(jié)合FPGA器件特性,運用VHDL語言編程,實現(xiàn)了整個相關(guān)算法。利用QuartusⅡ和Mat
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時延估計 估計精度 FPGA 內(nèi)插
- 面對似乎層出不窮的新 I/O 標準,目前嵌入式系統(tǒng)設(shè)計人員繼續(xù)依靠 FPGA 來部署系統(tǒng)日益重要的外部 I/O 接口.
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IO標準 可配置 FPGA
- 相對其他成熟的計算機體系,SOPC系統(tǒng)現(xiàn)在還沒有命令行。為了更好的推廣SOPC應用,筆者開發(fā)了一個智能的命令行模塊,可以調(diào)用系統(tǒng)中的任意函數(shù),降低了開發(fā)人員的使用難度。
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SOPC 命令行 FPGA
- 顯示器因為其輸出信息量大,輸出形式多樣等特點已經(jīng)成為現(xiàn)在大多數(shù)設(shè)計的常用輸出設(shè)備。在 FPGA 的設(shè)計中可以使用很少的資源,就產(chǎn)生 VGA 各種控制信號。這個示例在 RHicSP2200B FPGA 開發(fā)板/學習板上使用 VGA 接口在顯示器上顯示了文字以及簡單的圖形,可以作為VGA 顯示設(shè)計的參考,如果在使用這個例子的過程
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VGA 接口 FPGA
- 據(jù)估計,目前盛行的假冒電子產(chǎn)品已經(jīng)占到整個市場份額的10%,這一數(shù)據(jù)得到了美國反灰色市場和反假冒聯(lián)盟(AGMA)的支持。AGMA是由惠普、思科和其它頂級電子OEM公司組成的一個行業(yè)組織。據(jù)該組織估計,制造商因盜版造成的損失超過1000億美元,而對最終用戶來說,信譽損毀和可靠性問題帶來的隱性成本則更難以確定。
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AGMA 可編程邏輯 FPGA
- 隨著數(shù)據(jù)存儲量的日益加大以及存儲速度的加快,大容量的高速存儲變得越來越重要。內(nèi)存條既能滿足大容量的存儲又能滿足讀寫速度快的要求,這樣使得對內(nèi)存條控制的應用越來越廣泛。首先介紹了內(nèi)存條的工作原理,內(nèi)存條電路設(shè)計的注意事項,以及如何使用FPGA實現(xiàn)對DDR內(nèi)存條的控制,最后給出控制的仿真波形。
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DDR 內(nèi)存條 FPGA
- 隨著信息技術(shù)的發(fā)展,基于微處理器的數(shù)字信號處理在測控、通訊、雷達等各個領(lǐng)域得到廣泛的應用。被處理的模擬信號也在向高頻、寬帶方面發(fā)展,但這需要高速、高分辨率的數(shù)字采集卡以將模擬信號數(shù)字化。美國國家半導體公司新推出的系列高速、高分辨率模/數(shù)轉(zhuǎn)換器(如CLC5958)就非常適用于需要高速、高分辨率的信號采集系統(tǒng)。
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CLC5958型 A/D轉(zhuǎn)換器 FPGA PCI
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