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FPGA與CPLD的概念及其區(qū)別

  • 一、FPGA與CPLD的基本概念1.CPLDCPLD主要是由可編程邏輯宏單元(LMC，Logic Macro Cell)圍繞中心的可編程互連矩陣單元組成，其中LMC邏輯結(jié)構(gòu)較復(fù)雜，并具有復(fù)雜的I/O單元互連結(jié)構(gòu)，可由用戶根據(jù)需要生成特定的電路結(jié)
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Lark Board評(píng)估板 Cyclone V SoC的專用舞臺(tái)

  • 隨著FPGA技術(shù)的高速發(fā)展，芯片規(guī)模不斷提升，帶來(lái)了更強(qiáng)的性能的同時(shí)，也實(shí)現(xiàn)了更低的功耗。FPGA憑借其強(qiáng)大的并行信號(hào)處理能力，在應(yīng)對(duì)控制復(fù)雜度低、數(shù)據(jù)量大的運(yùn)算時(shí)具有較強(qiáng)的優(yōu)勢(shì)。但是在復(fù)雜算法的實(shí)現(xiàn)上，F(xiàn)PGA
  • 關(guān)鍵字： FPGA  RISC  英蓓特  

全球知名的PCB設(shè)計(jì)工具 Cadsoft EAGLE

  • 相信對(duì)于很多電子專業(yè)的學(xué)生和從事PCB設(shè)計(jì)有關(guān)工作的工程師來(lái)說(shuō)，Cadsoft公司的EAGLE PCB設(shè)計(jì)軟件算得上是一個(gè)耳熟能詳?shù)拿至?。EAGLE是“Easily Applicable Graphical Layout Editor”的首字母縮寫，意
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FPGA工程師的研發(fā)之道――總線的研究

  • 如果設(shè)計(jì)中有多個(gè)模塊，每個(gè)模塊內(nèi)部有許多寄存器或者存儲(chǔ)塊需要配置或者提供讀出那么實(shí)現(xiàn)方式有多種，主要如下：實(shí)現(xiàn)方式一：可以在模塊頂部將所有寄存器引出，提供統(tǒng)一的模塊進(jìn)行配置和讀出。這種方式簡(jiǎn)單是簡(jiǎn)單，
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駿龍科技Andrew ―― FPGA資深FAE的經(jīng)驗(yàn)獨(dú)白

  • 看似簡(jiǎn)單的幾個(gè)問(wèn)題，Andrew卻回答的井井有條，小編已經(jīng)沒(méi)有辦法有什么其他詞語(yǔ)去形容了。本文Andrew不僅僅對(duì)FPGA入門學(xué)習(xí)流程做了詳細(xì)的分享，更是對(duì)FPGA開(kāi)發(fā)工作的要求分成大公司和小公司兩個(gè)層面來(lái)分析。你能想象
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基于FPGA的BPSK信號(hào)載頻估計(jì)單元設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要：根據(jù)BPSK調(diào)制信號(hào)調(diào)制機(jī)理和平方倍頻法原理，在FPGA平臺(tái)上設(shè)計(jì)實(shí)現(xiàn)了BPSK調(diào)制信號(hào)載波頻率估計(jì)單元。利用ModelSim仿真環(huán)境對(duì)載頻估計(jì)功能進(jìn)行仿真，驗(yàn)證了平方倍頻法對(duì)BPSK信號(hào)進(jìn)行載波信號(hào)估計(jì)的有效性。仿真
  • 關(guān)鍵字： FPGA  載頻估計(jì)  平方倍頻  BPSK  

基于FPGA的振動(dòng)信號(hào)采集處理系統(tǒng)設(shè)計(jì)

  • 摘要：在振動(dòng)信號(hào)采集和處理系統(tǒng)設(shè)計(jì)中，信號(hào)的處理時(shí)間與可靠性決定著系統(tǒng)應(yīng)用的可行性。本文設(shè)計(jì)了一種基于FPGA的振動(dòng)信號(hào)采集處理系統(tǒng)，該系統(tǒng)通過(guò)振動(dòng)信號(hào)采集電路、抗混疊濾波電路、AD采樣電路將電荷信號(hào)轉(zhuǎn)化為
  • 關(guān)鍵字： 振動(dòng)信號(hào)采集  數(shù)據(jù)流控制  時(shí)鐘時(shí)標(biāo)  FPGA  

FPGA更適用于視覺(jué)處理

  • 美國(guó)國(guó)家儀器公司將工程的視覺(jué)處理移植到FPGA上實(shí)現(xiàn)，可獲得更高的處理性能Jeff Bier 是嵌入式視覺(jué)聯(lián)盟的創(chuàng)始人，本月在德克薩斯州奧斯汀舉辦的NI WEEK大會(huì)上，Jeff關(guān)注了國(guó)家儀器公司的一個(gè)演示系統(tǒng)，這個(gè)系統(tǒng)是國(guó)
  • 關(guān)鍵字： FPGA    視覺(jué)處理  

FPGA 101：用Vivado HLS為軟件提速

  • 在編寫軟件時(shí)，您有沒(méi)有遇到過(guò)無(wú)論怎么努力編碼，軟件都不能按您期望的速度運(yùn)行?我遇到過(guò)。您有沒(méi)有想過(guò)，“有沒(méi)有什么簡(jiǎn)單而且成本不高的方法可將一些代碼輸入多個(gè)定制處理器或定制硬件?”畢竟，您的應(yīng)用
  • 關(guān)鍵字： FPGA    Vivado  

采用Altera 10代FPGA實(shí)現(xiàn)低延時(shí)小尺寸設(shè)計(jì)

  • 由于電子設(shè)計(jì)日漸復(fù)雜，設(shè)計(jì)人員通常需要采用各種不同類型的功能，但他們無(wú)法具備所有的專業(yè)知識(shí)、資源和時(shí)間。這促使了半導(dǎo)體知識(shí)產(chǎn)權(quán)(SIP)市場(chǎng)的增長(zhǎng)，預(yù)計(jì)2017年將達(dá)到57億美元。某些復(fù)雜設(shè)計(jì)使用的各種SIP模塊甚
  • 關(guān)鍵字： FPGA  低延遲  Altera  

基于OpenCL標(biāo)準(zhǔn)的FPGA設(shè)計(jì)

  • 在可編程技術(shù)發(fā)展的最初階段，可編程能力出現(xiàn)了兩個(gè)極端。一個(gè)極端的代表是單核CPU和DSP單元。這些器件使用含有一系列可執(zhí)行指令的軟件來(lái)進(jìn)行編程。對(duì)于編程人員，在概念上以連續(xù)的方式來(lái)開(kāi)發(fā)這些指令，而高級(jí)處理器
  • 關(guān)鍵字： OpenCL    FPGA  

MicroBlaze AXI總線實(shí)現(xiàn)OLED顯示

  • OLED作為從設(shè)備，主設(shè)備通過(guò)SPI控制協(xié)議和OLED模塊進(jìn)行通信，硬件接口為PMOD接口，OLED模塊內(nèi)部集成SRAM存儲(chǔ)設(shè)備緩存顯示數(shù)據(jù)。OLED模塊使用4wire SPI串行方式,其信號(hào)包含：SCK(時(shí)鐘),CS(片選),MOSI(master output
  • 關(guān)鍵字： NANO2    microblaze    FPGA    OLED  

一種FPGA高速訪問(wèn)USB設(shè)備的設(shè)計(jì)方案

  • 摘要：針對(duì)FPGA訪問(wèn)USB設(shè)備存在傳輸速率低、資源消耗大、開(kāi)發(fā)復(fù)雜的缺點(diǎn)，提出了一種將ARM處理器與FPGA相結(jié)合實(shí)現(xiàn)高速訪問(wèn)USB設(shè)備的方案。該方案利用ARM處理器的USB Host讀取USB設(shè)備數(shù)據(jù)井緩存于高速內(nèi)存，采用乒乓
  • 關(guān)鍵字： USB設(shè)備  數(shù)據(jù)訪問(wèn)  FPGA  嵌入式系統(tǒng)  

FPGA+DSP架構(gòu)的HD-SDI高清圖像處理系統(tǒng)設(shè)計(jì)

  • 摘要：隨著圖像處理技術(shù)及傳感器技術(shù)的不斷發(fā)展，高清數(shù)字圖像取代模擬圖像成為一種趨勢(shì)。設(shè)計(jì)了一種基于HD-SDI技術(shù)的高清圖像處理系統(tǒng)，可通過(guò)FPGA+DSP架構(gòu)對(duì)1080P全高清圖像進(jìn)行采集和字符疊加，并實(shí)時(shí)進(jìn)行目標(biāo)提
  • 關(guān)鍵字： HD-SDI  圖像處理  DVI  FPGA  

高效非反向降壓-升壓轉(zhuǎn)換器設(shè)計(jì)標(biāo)準(zhǔn)

  • SEPIC，Zeta和雙開(kāi)關(guān)降壓-升壓轉(zhuǎn)換器是三款常見(jiàn)的非反向降壓-升壓拓?fù)浣Y(jié)構(gòu)，這些拓?fù)浣Y(jié)構(gòu)提供正向輸出以及升壓/降壓功能。當(dāng)運(yùn)行在降壓-升壓模式中時(shí)，所有三個(gè)轉(zhuǎn)換器會(huì)經(jīng)歷高電流應(yīng)力和高傳導(dǎo)損耗。然而，通過(guò)使雙開(kāi)
  • 關(guān)鍵字： 轉(zhuǎn)換器  PCB  
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fsp:fpga-pcb介紹

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