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實(shí)際案例說明用基于FPGA的原型來測(cè)試、驗(yàn)證和確認(rèn)IP——如何做到魚與熊掌兼得？

本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用硅知識(shí)產(chǎn)權(quán)（IP）內(nèi)核來開發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問題。全文從介紹使用IP核這種預(yù)先定制功能電路的必要性開始，通過闡述開發(fā)ASIC原型設(shè)計(jì)時(shí)需要考慮到的IP核相關(guān)因素，用八個(gè)重要主題詳細(xì)分享了利用ASIC IP來在FPGA上開發(fā)原型驗(yàn)證系統(tǒng)設(shè)計(jì)時(shí)需要考量的因素。同時(shí)還提供了實(shí)際案例來對(duì)這些話題進(jìn)行詳細(xì)分析。這八個(gè)主題包括：一款原型和最終ASIC實(shí)現(xiàn)之間的要求有何不同
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FPGA能做什么？比單片機(jī)厲害嗎？

學(xué)習(xí)單片機(jī)的同學(xué)，一般都會(huì)接觸FPGA。有讀者大概問了這樣的問題：FPGA能做什么？比單片機(jī)厲害嗎？這么說吧，F(xiàn)PGA在某方面也能實(shí)現(xiàn)單片機(jī)做的事，在某些領(lǐng)域，F(xiàn)PGA遠(yuǎn)比單片機(jī)強(qiáng)的多。當(dāng)然，F(xiàn)PGA和單片機(jī)各有各的特點(diǎn)，在應(yīng)用上也有一些區(qū)別。下面說說FPGA 常見的幾大應(yīng)用的領(lǐng)域：1.通信系統(tǒng)FPGA 在通信領(lǐng)域的應(yīng)用可以說是無所不能，得益于 FPGA 內(nèi)部結(jié)構(gòu)的特點(diǎn)，它可以很容易地實(shí)現(xiàn)分布式的算法結(jié)構(gòu)，這一點(diǎn)對(duì)于實(shí)現(xiàn)無線通信中的高速數(shù)字信號(hào)處理十分有利。因?yàn)樵跓o線通信系統(tǒng)中，許多功能模塊通常都需要大量
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FPGA是什么 —— 它的工作原理及其用途

FPGA是什么？現(xiàn)場(chǎng)可編程門陣列（Field Programmable Gate Array，簡稱 FPGA）是一種集成電路（IC），可以開發(fā)定制邏輯，用于快速原型設(shè)計(jì)和最終系統(tǒng)設(shè)計(jì)。FPGA與其他定制或半定制的集成電路不同，其自身的靈活性使其可以通過下載軟件進(jìn)行編程和重新編程，適應(yīng)所設(shè)計(jì)的大型系統(tǒng)不斷變化的需求。FPGA非常適合當(dāng)今各類快速發(fā)展的應(yīng)用，如網(wǎng)絡(luò)邊緣計(jì)算、人工智能（AI）、系統(tǒng)安全、5G、工廠自動(dòng)化和機(jī)器人技術(shù)。為什么使用FPGA而不是其他類型的集成電路？FPGA的主要優(yōu)勢(shì)在于其可編程架構(gòu)，
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晶振為什么不能放置在PCB邊緣？

晶振在布局時(shí)，一般是不能放置在PCB邊緣的，今天以一個(gè)實(shí)際案例講解。某行車記錄儀，測(cè)試的時(shí)候要加一個(gè)外接適配器，在機(jī)器上電運(yùn)行測(cè)試時(shí)發(fā)現(xiàn)超標(biāo)，具體頻點(diǎn)是84MHz、144MHz、168MHz，需要分析其輻射超標(biāo)產(chǎn)生的原因，并給出相應(yīng)的對(duì)策，輻射測(cè)試數(shù)據(jù)如下：圖1：輻射測(cè)試數(shù)據(jù)1、輻射源頭分析該產(chǎn)品只有一塊PCB，板子上有一個(gè)12MHz的晶體。其中超標(biāo)頻點(diǎn)恰好都是12MHz的倍頻，而分析該機(jī)器容易EMI輻射超標(biāo)的屏和攝像頭，發(fā)現(xiàn)LCD-CLK是33MHz，而攝像頭MCLK是24MHz。通過排除法，發(fā)現(xiàn)去掉攝
關(guān)鍵字：晶振電路設(shè)計(jì) PCB

網(wǎng)絡(luò)安全宣傳月：與萊迪思一起應(yīng)對(duì)不斷變化的網(wǎng)絡(luò)安全環(huán)境

隨著全球互連程度加以及對(duì)數(shù)字技術(shù)依賴性的增加，網(wǎng)絡(luò)犯罪也日益猖獗。事實(shí)上，據(jù)《福布斯》報(bào)道，2023年的數(shù)據(jù)泄露事件比2021年增加了72%，而2021年就已經(jīng)創(chuàng)下紀(jì)錄。隨著網(wǎng)絡(luò)威脅變得越來越復(fù)雜和頻繁，企業(yè)必須采取積極主動(dòng)的方法來保護(hù)其系統(tǒng)、數(shù)據(jù)和運(yùn)營。其中一種方法包括實(shí)施網(wǎng)絡(luò)彈性：抵御攻擊、響應(yīng)威脅和從攻擊中恢復(fù)的能力，從而實(shí)現(xiàn)持續(xù)的保護(hù)和最小程度的中斷。每年十月是CISA.gov（網(wǎng)絡(luò)安全和基礎(chǔ)設(shè)施安全局）推出的網(wǎng)絡(luò)安全宣傳月，旨在促進(jìn)網(wǎng)絡(luò)彈性文化的發(fā)展。在萊迪思，我們常年致力于幫助我們的客戶和合作
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八層板PCB設(shè)計(jì)，電腦主板設(shè)計(jì)分析

來源于網(wǎng)絡(luò)的前輩PCB作品學(xué)好PCB設(shè)計(jì)的方法之一就是通過前輩的作品學(xué)習(xí)前輩的設(shè)計(jì)方法和技巧。我們能在前輩的作品中學(xué)到元件布局、板層設(shè)置、線路布線。板層置1. 信號(hào)層（TOP）第一層信號(hào)層，又叫頂層，實(shí)物打板回來是能夠看得見的一層，可以擺放電子元件的一層。由上圖可見這層布線比較多。原因之一就是電子元件的擺放在同一層，走線的過程中不需要設(shè)置過孔轉(zhuǎn)換層。這樣可以避免過孔阻礙其它層的走線。在多層板布線反而要注意過孔的設(shè)置。2. 電源層（VCC）在這層沒有看到走線。是因?yàn)檫@一層都是電源網(wǎng)絡(luò)。在設(shè)計(jì)時(shí)使用特定的線進(jìn)
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英特爾傳將出售Altera少數(shù)股權(quán)換現(xiàn)金

英特爾（Intel）傳向多家私募股權(quán)與投資人詢問，有意出售Altera部分股權(quán)，以尋求從中換得數(shù)十億美元的現(xiàn)金，而Altera為英特爾在2015年以167億美元收購的子公司，曾被看作是英特爾重要的核心業(yè)務(wù)之一。英特爾不斷尋求做出重大改變，如今將想法動(dòng)到2015年以167億美元收購的邏輯芯片設(shè)計(jì)廠Altera，傳將出售Altera部分股權(quán)換現(xiàn)金，并期望Altera估值能達(dá)170億美元來交易。Altera年初開始獨(dú)立運(yùn)營，預(yù)計(jì)2025年1月1日前完成分離，而英特爾執(zhí)行長基辛格（Pat Gelsinger）上個(gè)
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在米爾電子MPSOC實(shí)現(xiàn)12G SDI視頻采集H.265壓縮SGMII萬兆以太網(wǎng)推流

4K視頻為何越來越糊？SGMII與HEVC如何重拾高碼流體驗(yàn)
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萬源通IPO：助力汽車電子領(lǐng)域PCB發(fā)展

汽車電子領(lǐng)域的印制電路板規(guī)格主要以4-8層的多層板為主，占據(jù)了印制電路板用板中的45%。雙層板占比為12%，厚銅板占比為6.5%。隨著汽車電動(dòng)化和智能化的發(fā)展趨勢(shì)，汽車電子用板逐漸向金屬基板、厚銅板等高技術(shù) PCB 方案演進(jìn)。特別是通過埋銅、嵌銅和厚銅工藝，增強(qiáng)了散熱能力，滿足汽車電子產(chǎn)品對(duì)散熱性能的需求。單車的 PCB 用量增加，技術(shù)難度也隨之提高。在這樣的發(fā)展趨勢(shì)下，汽車電子領(lǐng)域的印制電路板不僅需要滿足高技術(shù)要求，還具有多品種、小批量的特點(diǎn)。生產(chǎn)過程中由于換型、調(diào)參導(dǎo)致生產(chǎn)成本較高，因此需要采用一系列
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10個(gè)PCB設(shè)計(jì)技巧幫你減少EMC

今天主要是關(guān)于：EMC，PCB設(shè)計(jì)中如何降低EMC?一、EMC是什么？在PCB設(shè)計(jì)中，主要的EMC問題包括3種：傳導(dǎo)干擾、串?dāng)_干擾、輻射干擾。1、傳導(dǎo)干擾傳導(dǎo)干擾通過引線去耦和共模阻抗去耦影響其他電路，例如：噪聲通過電源電路進(jìn)入系統(tǒng)，支持電路將受到噪聲的影響。下圖顯示了通過共模阻抗進(jìn)行的噪聲去耦。電路1和電路2通過同一根導(dǎo)線獲得電源電壓的和接地環(huán)路。如果其中一個(gè)電路的電壓突然需要提高，另一個(gè)電路將降低，因?yàn)楣搽娫春蛢蓚€(gè)回路之間的阻抗。2、串?dāng)_干擾串?dāng)_干擾是指一根信號(hào)線對(duì)相鄰信號(hào)線的干擾，通常發(fā)生在相鄰的
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將ASIC IP核移植到FPGA上——如何測(cè)試IP核的功能和考慮純電路以外的其他因素

本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來開發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問題。文章從介紹使用預(yù)先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設(shè)計(jì)時(shí)需要考慮到的IP 核相關(guān)因素，用八個(gè)重要主題詳細(xì)分享了利用ASIC IP來在FPGA上開發(fā)原型驗(yàn)證系統(tǒng)設(shè)計(jì)時(shí)需要考量的因素。在上篇文章中，我們分享了第五到第六主題，介紹了我們?nèi)绾未_保在FPGA上實(shí)現(xiàn)所需的性能和在時(shí)鐘方面必須加以考量的因素有哪些。本篇
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從邊緣到云，Altera以可擴(kuò)展產(chǎn)品組合加快FPGA創(chuàng)新

近期，英特爾子公司Altera推出了一系列FPGA軟、硬件和開發(fā)工具，使其可編程解決方案更易應(yīng)用于廣泛的用例和市場(chǎng)。Altera在年度開發(fā)者大會(huì)上公布了下一代能效與成本優(yōu)化的Agilex? 3 FPGA情況，并宣布針對(duì)Agilex 5 FPGA提供新的開發(fā)套件和軟件支持。?“通過與生態(tài)系統(tǒng)和分銷合作伙伴保持緊密的合作，Altera將持續(xù)提供基于FPGA的解決方案，為創(chuàng)新者提供易于設(shè)計(jì)和部署的前沿可編程技術(shù)。通過此次新品發(fā)布，我們將繼續(xù)利用可編程技術(shù)塑造未來，幫助客戶在數(shù)據(jù)中心、通信基礎(chǔ)設(shè)施、汽車
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電源設(shè)計(jì)器件布局和布線要點(diǎn)

在電源設(shè)計(jì)中，精心的布局和布線對(duì)于能否實(shí)現(xiàn)出色設(shè)計(jì)至關(guān)重要，要為尺寸、精度、效率留出足夠空間，以避免在生產(chǎn)中出現(xiàn)問題。我們可以利用多年的測(cè)試經(jīng)驗(yàn)，以及布局工程師具備的專業(yè)知識(shí)，最終完成電路板生產(chǎn)。精心的設(shè)計(jì)的效率設(shè)計(jì)從圖紙上看起來可能毫無問題（也就是說，從原理圖角度），甚至在模擬期間也沒有任何問題，但真正的測(cè)試其實(shí)是在布局、PCB制造，以及通過載入電路實(shí)施原型制作應(yīng)力測(cè)試之后。這部分使用真實(shí)的設(shè)計(jì)示例，介紹一些技巧來幫助避開陷阱。我們將介紹幾個(gè)重要概念，以幫助避開設(shè)計(jì)缺陷和其他陷阱，以免未來需要重新設(shè)計(jì)和
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NMPSM3軟處理器

NMPSM3概述在UCSC擴(kuò)展學(xué)院上了第一門FPGA課后，我對(duì)這些設(shè)備為普通人提供的功能感到驚訝，我決定更深入地研究它們。我最終意識(shí)到我有足夠的邏輯設(shè)計(jì)知識(shí)，可以構(gòu)建自己的簡單處理器。在了解了KCPSM（nanoblaze）之后，我開始構(gòu)建自己的處理器，并將其稱為NMPSM（Nick Mikstas可編程狀態(tài)機(jī)）。我花了三遍迭代才能制作出功能全面的處理器，因此命名為NMPSM3。即使NMPSM3受到nanoblaze IO方案的啟發(fā)，其內(nèi)部結(jié)構(gòu)也完全不同。NMPSM3是具有四個(gè)獨(dú)立中斷和一個(gè)復(fù)位的16位處
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用FPGA實(shí)現(xiàn)各種數(shù)字濾波器

FPGA濾波器實(shí)施概述本篇部分內(nèi)容來自網(wǎng)站FPGA濾波器實(shí)現(xiàn)的一些項(xiàng)目，源于一位在校學(xué)生的學(xué)習(xí)和設(shè)計(jì)- 了解并在FPGA上實(shí)現(xiàn)幾種類型的數(shù)字濾波器器，設(shè)計(jì)的所有濾波器均為15階濾波器，并使用16位定點(diǎn)數(shù)學(xué)運(yùn)算，該學(xué)生有一篇PPT可供參考：FPGA濾波器實(shí)現(xiàn)研究項(xiàng)目期間創(chuàng)建的Verilog源文件如下。FIR濾波器FIR濾波器是四個(gè)濾波器中最簡單、最快的，它利用了預(yù)加器的對(duì)稱性，而且使用加法器樹來最小化組合路徑延遲。FIR_Filter.v`define FILT_LENGTH 16&nb
關(guān)鍵字： FPGA 濾波器 Verilog