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EEPW首頁 >> 主題列表 >> pb-b-rs485

IRIG-B碼對(duì)時(shí)方式在繼電保護(hù)裝置中的應(yīng)用

  • 摘要:隨著變電站自動(dòng)化技術(shù)的發(fā)展,對(duì)變電站內(nèi)時(shí)間的精確和統(tǒng)一提出了更高的要求。本文提出了一種采用IRIG-B時(shí)間碼來時(shí)時(shí)的方案。在這種對(duì)時(shí)方案中,每個(gè)變電站只安裝一個(gè)GPS接收裝置,利用RS422/485總線傳輸IRIG-
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RS485轉(zhuǎn)以太網(wǎng)的應(yīng)用、解決方案和關(guān)鍵技術(shù)

  • 1.RS485轉(zhuǎn)以太網(wǎng)的應(yīng)用  RS485通信技術(shù)在工程上用得很多,其主要優(yōu)點(diǎn)如下:  布線簡(jiǎn)單:只需要2根線,現(xiàn)在一般采用網(wǎng)線的屏蔽線接口?! ⊥ㄐ啪嚯x遠(yuǎn):由于采用了差模通信方式,比RS232的通信距離要遠(yuǎn)?! 】梢?/li>
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CAN總線的嵌入式Web服務(wù)器設(shè)計(jì)

液晶顯示多級(jí)漢字菜單的方法及電路

  • 摘 要:以8031單片機(jī)控制MGLS-240128液晶顯示器為例,介紹利用CCDOS中的漢字庫(HZK16)實(shí)現(xiàn)多級(jí)漢字菜單顯示的方法。當(dāng)顯示內(nèi)容改變時(shí),不需要更改程序,只要更改菜單參數(shù)即可顯示。
    關(guān)鍵詞:液晶顯示器;MGLS
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    1. 引言  

RS485總線穩(wěn)定性解決方案

  • RS485總線穩(wěn)定性解決方案,一、關(guān)于485總線的幾個(gè)概念:  1、485總線的通訊距離可以達(dá)到1200米?! 「鶕?jù)485總線結(jié)構(gòu)理論,在理想環(huán)境的前提下,485總線傳輸距離可以達(dá)到1200米。其條件是通訊線材優(yōu)質(zhì)達(dá)標(biāo),波特率為9600,只負(fù)載一臺(tái)485設(shè)備,
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TCP/IP協(xié)議單片機(jī)在網(wǎng)絡(luò)通信中的數(shù)據(jù)傳輸技術(shù)

EWSD交換機(jī)如何實(shí)現(xiàn)對(duì)非法呼叫的限制

SD178A型集成式TTS處理器及其串行接口

  • SD178A型集成式TTS處理器及其串行接口,SDA178是臺(tái)灣翔音公司推出的集成式“文字轉(zhuǎn)發(fā)音”(TTS)單芯片處理器,該處理器以真人發(fā)音為樣本,輸出的語音真實(shí)、自然。介紹該處理器的工作原理及應(yīng)用,給出SD178A與微處理器的接口電路及軟件程序。
    關(guān)
  • 關(guān)鍵字: 文字轉(zhuǎn)發(fā)音  SD178A  串行接口  處理器

    1 引言  

基于FPGA的IRTG-B碼編解碼器的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要:為提高整個(gè)系統(tǒng)時(shí)間的同步精度,以便為測(cè)量設(shè)備提供可靠的時(shí)間信息和標(biāo)準(zhǔn)頻率信號(hào),給出了一種基于FPGA的IRIG-B編解碼器的設(shè)計(jì)與實(shí)現(xiàn)方法。新系統(tǒng)基于模塊化設(shè)計(jì),其中編碼部分完成標(biāo)準(zhǔn)時(shí)間信息及相應(yīng)的BCD碼的
  • 關(guān)鍵字: IRTG-B  FPGA  編解碼器    

SPMC75F2413A單片機(jī)在DC變頻空調(diào)中的應(yīng)用

  • 本文主要介紹利用SPMC75F2413A單片機(jī)構(gòu)成DC變頻空調(diào)控制方案。DC變頻空調(diào)控制器工作機(jī)理,重點(diǎn)介紹SPMC75F2413A 在DC變頻空調(diào)器中的使用方法。
    關(guān)鍵詞:SPMC75F2413A、PS21865A、模糊控制、凌陽單片機(jī) 1 引言
  • 關(guān)鍵字: SPMC75F2413A、PS21865A、模糊控制、凌陽單片機(jī)

    1 引言  

FPGA實(shí)現(xiàn)IRIG-B(DC)碼編碼和解碼的設(shè)計(jì)

  • 為達(dá)到IRIG-B碼與時(shí)間信號(hào)輸入、輸出的精確同步,采用現(xiàn)代化靶場(chǎng)的IRIG-B碼編碼和解碼的原理,從工程的角度出發(fā),提出了使用現(xiàn)場(chǎng)可編程門陣列(FPGA)來實(shí)現(xiàn)IRIG-B碼編碼和解碼的設(shè)計(jì)方案和體系結(jié)構(gòu),設(shè)計(jì)中會(huì)涉及到幾個(gè)不同的時(shí)鐘頻率,F(xiàn)PGA對(duì)時(shí)鐘的同步性具有靈活性、效率高、且功耗低??垢蓴_性好的特點(diǎn)。結(jié)果表明,F(xiàn)PGA能夠確保為從設(shè)備提供同源的時(shí)鐘基準(zhǔn),使時(shí)鐘與信號(hào)的延遲控制在200 ns以內(nèi),從而得到了IRIG-B碼與時(shí)間精確同步的效果。
  • 關(guān)鍵字: IRIG-B  FPGA  DC  編碼    

MAX3082 RS232至RS485的轉(zhuǎn)換

  • 轉(zhuǎn)換是從一種能量形式變成另一種能量形式 [附件:MAX3082 RS232至RS485的轉(zhuǎn)換] ...
  • 關(guān)鍵字: MAX3082  RS232  RS485  

MAX202 RS232至RS485的轉(zhuǎn)換

  • MAX202 RS232至RS485的轉(zhuǎn)換
  • 關(guān)鍵字: RS232  RS485  
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